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VHDL/FPGA/Verilog 8194个

mux 2 to 4,mux 4 to 1...

标签: mux 2 to 4 mux 4 to 1 reg 8 bit 发布者:lvsiqi_gold上传时间:2016-03-27
VerilogHDL教程

标签: VerilogHDL 教程发布者:buptbaishikele上传时间:2016-03-27
这是汇编语言

标签: 汇编语言发布者:BO__1上传时间:2016-03-27
CAN总线

标签: CAN 总线发布者:lingyun579上传时间:2016-03-27
8点阵列LED显示屏的 VHDL扫描程序

标签: VHDL LED 点阵显示屏发布者:LiuRong上传时间:2016-03-26
数字电路EDA 入门：VHDL 程序实例集,对于初学VHDL有很大帮助

标签: VHDL EDA 数字电路程序实例发布者:Sundaymorn上传时间:2016-03-25
用VHDL来实现I2C的功能（实验过）

标签: VHDL I2C 实验发布者:stealler上传时间:2016-03-25
基于VHDL的电子钟

标签: VHDL 电子钟发布者:pj117上传时间:2016-03-24
本程序是在Quartus7.2环境下编译的一个简单的(2,1,3)卷积码

标签: Quartus 7.2 程序环境发布者:nassdaq上传时间:2016-03-24
一个VHDL电梯控制器的程序 1、每层电梯的入口处设有上下请求开关

标签: VHDL 电梯控制器电梯开关发布者:setixp上传时间:2016-03-24
利用此源碼可以使用ALTERA DE2開發板將鍵盤變成一部電子琴

标签: ALTERA DE2 鍵盤发布者:a415834839上传时间:2016-03-23
这是FPGA系统的一个简单的与上位机串行通讯的的小程序

标签: FPGA 上位机串行通讯发布者:mengcong18上传时间:2016-03-23
FPGA调试基础知识

标签: FPGA调试发布者:vlismxc上传时间:2016-03-22
FPGA设计实战

标签: FPGA实践训练的资料发布者:vlismxc上传时间:2016-03-22
Access IDE harddisk by Xilinx FPGA Support PIO2

标签: harddisk Support Access Xilinx 发布者:gjq2000上传时间:2016-03-22
VHDL的IIR数字滤波器

标签: VHDL IIR 数字滤波器发布者:zwendong上传时间:2016-03-21
采用Verilog HDL语言编写的步进电机位置系统

标签: Verilog HDL 语言编写发布者:ATT320上传时间:2016-03-21
采用Verilog HDL语言编写的多功能数字钟

标签: Verilog HDL 语言编写发布者:limaoxiansheng上传时间:2016-03-21
采用Verilog HDL语言编写的交通灯控制系统

标签: Verilog HDL 语言编写发布者:diablo_he1987上传时间:2016-03-21
采用Verilog HDL语言编写的数字频率计

标签: Verilog HDL 语言编写发布者:sfdong上传时间:2016-03-21
在quartus中用VHDL语言开发的crc校验

标签: quartus VHDL crc 语言发布者:IsABC上传时间:2016-03-21
电子锁的vhdl实现（pld数字系统设计上）

标签: vhdl pld 电子锁数字系统设计发布者:fpeisheng上传时间:2016-03-21
PS2接口键盘扫描码截取电路

标签: PS2 接口键盘扫描电路发布者:evenxyz上传时间:2016-03-20
VHDL计数器的TestBench

标签: TestBench VHDL 计数器发布者:susanxuwenjun上传时间:2016-03-20
两人抢答器,有抢答,倒计时,记分,响铃功能.

标签: 抢答器抢答分计时发布者:lingyun579上传时间:2016-03-19
基本VERILOG模块

标签: VERILOG 模块发布者:pjamytian上传时间:2016-03-19
基于VHDL的8位十进制频率计的详细设计。

标签: VHDL 8位十进制频率计发布者:zhaoyanguangaaa上传时间:2016-03-19
在quartus中仿真通过的移位加程序的vhdl代码

标签: quartus vhdl 仿真代码发布者:setixp上传时间:2016-03-18
用VHDL为MCU编写的可用UART-通用异步收发器程序

标签: VHDL UART MCU 编写发布者:dsjacky上传时间:2016-03-18
sdram controller.verilog

标签: controller verilog sdram 发布者:xushenghao001上传时间:2016-03-17