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VHDL/FPGA/Verilog 8194个

basics of language vhdl , how it operates etc can be laernt

标签: language operates basics laernt 发布者:fufuaihaitun上传时间:2017-09-27
A VHDL program to simulate the behaviour of a device,

标签: behaviour simulate program device 发布者:smashup上传时间:2017-09-26
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标签: source vhdl 发布者:z3021440上传时间:2017-09-26
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标签: source vhdl vhd 发布者:yangbaochun上传时间:2017-09-26
基于FPGA的直流电机的PWM控制和步进电机的细分驱动控制。使用VHDL语言编写

标签: FPGA VHDL PWM 直流电机发布者:wangcong200500上传时间:2017-09-26
vhdl语言详解

标签: vhdl 语言发布者:cy_jing上传时间:2017-09-26
电子系统设计实例设计语言VHDL 实验仪器杭州康芯gw48eda 开发系统

标签: VHDL eda 48 gw 发布者:A15117704533上传时间:2017-09-26
bch 编码和译码

标签: bch 编码译码发布者:Even_Moon上传时间:2017-09-25
四人抢答器

标签: 抢答器发布者:borisliuyuan上传时间:2017-09-25
用VHDL设计四人抢答器,vhdl学习的基础

标签: VHDL vhdl 抢答器发布者:laoniu上传时间:2017-09-25
Genode FX is a composition of hardware and software components that enable the creation of fully fl

标签: composition components hardware creation 发布者:zxyxwd6上传时间:2017-09-24
VHDL source codes of a 65xx compatible cpu core. Version 302.

标签: compatible Version source codes 发布者:foreverNewcomer上传时间:2017-09-24
VHDL source codes of the FPGA64, a fpga implementation of the C64 computer. Version for the c-one fp

标签: the implementation computer Version 发布者:gdmichael上传时间:2017-09-24
Verilog, c and asm source codes of the Minimig system, a fpga implementation of the Amiga computer.

标签: implementation the computer Verilog 发布者:wodn76上传时间:2017-09-24
自动售货机模型

标签: 自动售货机模型发布者:wanglp094上传时间:2017-09-24
基于FPGA的乐曲发生器设计

标签: FPGA 发生器发布者:evenxyz上传时间:2017-09-24
4位微处理器系统的顶层描述代码

标签: 微处理器系统代码发布者:hlwang523上传时间:2017-09-24
全加器仿真程序代码

标签: 全加器仿真程序代码发布者:yiranshamaoer上传时间:2017-09-24
加法器和全加器参考程序

标签: 加法器全加器参考程序发布者:zhaoyanguangaaa上传时间:2017-09-24
Interfacing to External Static Ram This module colntroller is for srams

标签: Interfacing colntroller External Static 发布者:xinxinduan上传时间:2017-09-24
基于verilog hdl的UART串口发送子程序。

标签: verilog UART hdl 串口发送发布者:wuliaowenti上传时间:2017-09-24
基于verilog hdl的UART串口接收子程序。

标签: verilog UART hdl 串口接收发布者:zjqkpgz上传时间:2017-09-24
简易电子琴

标签: 电子琴发布者:SLing2008上传时间:2017-09-23
在数据的输入过程中可完成并行数据和串行数据的转换

标签: 数据并行数据串行数据输入发布者:pc1667pc1667上传时间:2017-09-23
具有流水灯报点的数字钟实验含有报告

标签: 流水灯数字实验报告发布者:wwangllei上传时间:2017-09-23
很多仪器都输出同步时钟

标签: 仪器输出时钟发布者:reed2453上传时间:2017-09-21
一个用vHDL语言编的同步程序

标签: vHDL 语言程序发布者:yashashi上传时间:2017-09-21
adder 4 + 4 bits, for use with a Altera, and 2 displays 7 segments

标签: displays segments Altera adder 发布者:archimedes88上传时间:2017-09-20
基于VHDL（verilog）语言的UART的设计与实现。全面模仿AVR的UART功能

标签: UART verilog VHDL AVR 发布者:heyuyutu上传时间:2017-09-20
基于ALTERA公司的NIOSII的I2C总线传输应用设计

标签: ALTERA NIOSII I2C 总线传输发布者:horse2000上传时间:2017-09-20