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VHDL/FPGA/Verilog 8194个

采用测频法设计一个8位十进制数字显示的数字频率计。测量范围1-499999hz。

标签: 499999 hz 测频 8位发布者:p200630864515上传时间:2017-07-28
VHDL Design of BCD to 7-segment decoder using PROM

标签: decoder segment Design using 发布者:LOOK1980上传时间:2017-07-28
Hardware Design with VHDL Design Example: UART

标签: Design Hardware Example with 发布者:snowpilce上传时间:2017-07-28
数字逻辑基础与Verilog设计,针对verilog语言的特点

标签: Verilog verilog 数字逻辑语言发布者:KuFly上传时间:2017-07-28
用CADENCE做VHDL语言实验的教程

标签: CADENCE VHDL 语言实验教程发布者:xx87293767上传时间:2017-07-27
8051内核的设计

标签: 8051 内核发布者:yitiaojin135上传时间:2017-07-27
verilog编写的16qam调制程序

标签: verilog qam 16 编写发布者:autojacky上传时间:2017-07-26
verilog　初学者原代码

标签: verilog 初学者代码发布者:GUAIGUAICHENGTI上传时间:2017-07-25
In this paper, a new method is introduced to implement chaotic generators based on the Henon map and

标签: introduced generators implement chaotic 发布者:zh64077118上传时间:2017-07-24
PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定

标签: Q5 数据 PLL 输入发布者:cz6891297上传时间:2017-07-24
This is UART Receiver interface C code Tested on Sparton 3 xilinx FPGA.

标签: interface Receiver Sparton Tested 发布者:ivanyeh上传时间:2017-07-24
The purpose of this booklet is to give you a quick introduction to VHDL. This is done by informally

标签: introduction informally purpose booklet 发布者:leaveyourjam上传时间:2017-07-24
用Verilog 编写的8位risc cpu

标签: Verilog risc cpu 8位发布者:jinhongfei0528上传时间:2017-07-24
这是CPLD原始代码程序

标签: CPLD 代码程序发布者:xulei147上传时间:2017-07-23
RS-232 interface example for FPGA/EDA developers

标签: developers interface example FPGA 发布者:dsjacky上传时间:2017-07-22
VHDL function for calculate X25 CRC

标签: calculate function VHDL CRC 发布者:maige49上传时间:2017-07-22
VHDL function for calculate USB Token CRC

标签: calculate function Token VHDL 发布者:szjunhui899上传时间:2017-07-22
VHDL function for calculate ethernet crc

标签: calculate function ethernet VHDL 发布者:kens上传时间:2017-07-22
VHDL function for calculate CRC10

标签: calculate function VHDL CRC 发布者:wzy1上传时间:2017-07-22
VHDL function for calculate ATM CRC

标签: calculate function VHDL ATM 发布者:chenqiyun1990上传时间:2017-07-22
100个学习ＶＨＤＬ的程序

标签: 100 程序发布者:xiaochonghan上传时间:2017-07-21
communication spi adc for spartan 3e

标签: communication spartan adc spi 发布者:bing1728上传时间:2017-07-21
学习VHDL非常好的一本书

标签: VHDL 发布者:heyuyutu上传时间:2017-07-21
主要介绍xilinxFPGA时序约束的方法和技巧。FPGA开发人员进一步提高的必看资料。

标签: xilinxFPGA FPGA 时序约束发布者:pipiooxx上传时间:2017-07-21
主要介绍moore状态机的详细功能及应用

标签: moore 状态发布者:sea_and_sun上传时间:2017-07-21
基于VHDL语言的一个新型串行数字通信模块。

标签: VHDL 语言串行数字通信发布者:foxfsk上传时间:2017-07-21
VHDL语言的高频时钟分频模块。一种新的分频器实现方法。

标签: VHDL 语言分频模块发布者:lovely19891019上传时间:2017-07-21
一个串口RS-232 发送模块。基于VHDL语言。

标签: VHDL 232 RS 串口发布者:susanxuwenjun上传时间:2017-07-21
RF CMOS Low-Phase-Noise LC Oscillator Through Memory Reduction Tail Transistor

标签: Low-Phase-Noise Oscillator Transistor Reduction 发布者:feiguohaihu上传时间:2017-07-21
VHDL语言编写8位乘法器非常实用语言绝对正确经过仿真的

标签: VHDL 语言 8位编写发布者:myc上传时间:2017-07-21