随着现代信息系统发展，网络系统尤其是分布式系统日益广泛地用于各个行业和领域，其中很多的关键应用需要基于时间同步进行。传统采用精准时钟对设备物理时钟进行精准调节以达到时钟同步的方式，以及单纯的在局域网内部通过相关时间协议进行时间同步的方式，由于受诸多限制，不能很好地解决分布式精确时钟同步的问题。然而人们对分布式时间精准度和时间同步的精确度要求越来越高，新型分布式网络时间同步研究成为一个需要亟待解决的关键性问题。既有工程应用价值，也有一定的理论意义。 首先从分布式系统应用的角度出发，首先对GNSS卫星授时、NTP协议、嵌入式系统及uClinux操作系统等理论和技术进行了阐述。重点讨论了如何解决分布式系统中的精确授时与同步问题的必要性和工程意义，分析了GNSS卫星授时特点和NTP网络协议的机制。 其次在充分考虑到网络同步实时性要求高的特点的基础上，提出了一种基于GNSS的嵌入式NTP授时服务器的设计架构，对各主要模块的功能、结构和工作原理进行了功能和性能分析。硬件具体以32位ARMS3C44B0X作为硬件控制核心的微处理器，开发了具有多通信端口的应用电路主板，并集成了GNSS卫星通信模块。 再次在软件方面具体对uClinux操作系统底层接口进行了较为深入的分析，在所设计的服务器硬件平台上移植了uClinux嵌入式操作系统及相关的驱动程序，并采用模块化的设计思想进行了NTP应用程序的设计与集成，实现了NTP协议的编译和NTP授时服务，其中对NTP协议主要参数和具体工作过程进行了系统性分析和设置应用。 最后在获取精准的系统统一时钟、通过NTP协议提供授时服务的基础上，结合实际在人工影响天气通信指挥系统中具体应用，实现了分布式人工降雨火箭弹发射点按命令精确同步进行发射的应用集成。初步测试表明，本文所设计的授时服务器应用情况良好，实现了不同层次分布式应用对于时间精准同步的高要求。
上传时间： 2013-04-24
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正交频分复用(Orthogonal Frequency Division Multiplexing，OFDM)技术是一种多载波传输技术，它的基本思想是在频域内将给定信道划分成几个相互正交的子信道，每个子信道使用一个子载波进行调制，各子载波并行传输。该技术可以有效提高频谱利用率，能够对抗多径效应产生的频率选择性衰弱和载波间干扰，在时变、频变、多径干扰严重的水声信道中具有较强的优势。 随着计算机和多媒体通信技术的发展，嵌入式系统在各个领域的应用不断深入。其中，基于ARM技术知识产权(IP)核的微处理器依靠其高性能、低功耗和易扩展的特点，在工业控制、无线通信、消费电子等多个领域得到广泛的应用；随着嵌入式系统复杂度的提高，操作系统已成为嵌入式系统不可缺少的一部分。其中，嵌入式Linux凭借免费开源、功能强大、成熟稳定等特点，目前已成为主要的嵌入式操作系统之一。 数字信号处理器(Digital Signal Processor，DSP)具有很强的数字信号处理能力，可以满足各种高实时要求，但其寻址范围小，I/O功能较差。ARM+DSP双处理器的结构可以充分利用ARM和DSP各自的优势实现协同工作。 本论文的主要工作是研究和实现一个基于OFDM技术的由ARM+DSP硬件平台实现的能够完成水下声信道图像传输的系统。主要研究内容包括OFDM系统的基本原理、ARM+DSP底层硬件的驱动和控制，Linux操作系统的移植、MiniGUI人机界面的设计、相关应用软件的编写以及在TMS320VC5502上初步实现OFDM的调制解调，以期对今后水下图像传输系统的实现能具有较大的参考价值。
上传时间： 2013-05-20
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能精确计算C语言延时程序中延时时间的小工具
上传时间： 2013-07-29
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随着全球经济不断增长和信息技术持续发展，越来越多用户提出了对数据、语音和视讯等宽带接入业务的需求。传统的接入网技术己成为新一代宽带通信网络建设的瓶颈，通信网络的宽带化成为一个必然的趋势。在众多新兴的接入技术中，宽带无线接入技术以其特有的优势成为近年来通信技术市场的最大亮点。基于IEEE802．16e的WiMAX技术作为一种面向无线城域网(WMAN)的宽带接入方案，正以其优异的性能和广阔的市场前景而倍受关注。 本文是基于WiMAX技术的网络终端的设计，根据IEEE802.16e协议，物理层需要对收发信息进行编解码、调制解调等的处理，其中包含很多运算密集的算法；这些处理有些适合硬件逻辑实现，有些适合数字信号处理器实现，所以设计采用了FPGAs+DSPs的实现方式。考虑对接收和发送数据的不同处理，在详细分析上行和下行链路的工作过程的基础上，对模块的进行了详细划分，并对系统的FPGA部分进行了详细设计。 设计中本文充分考虑了FPGA和DSP之间处理的优缺点，并注意避免器件之间通信的复杂化，在满足器件之间数据流量的同时，尽量使数据流向简单化，避免了延时增加和接口带宽调度的复杂化。最终整个设计完成完整的802.16e网络终端的物理层基带处理功能。
上传时间： 2013-06-01
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纠错码技术是一种通过增加一定冗余信息来提高信息传输可靠性的有效方法。RS码是一种典型的纠错码，在线性分组码中，它具有最强的纠错能力，既能纠正随机错误，也能纠正突发错误，在深空通信、移动通信、磁盘阵列、光存储及数字视频广播(DVB)等系统中具有广泛的应用。 DVD是一种高容量的存储媒质。DVD技术的应用很广泛，在数字技术中占有重要地位。DVD系统中采用里德-所罗门乘积码(RS-PC：Reed-Solomon ProductCode)进行纠错，RS码译码器在伺服芯片中具有重要作用。 FPGA在开发阶段具有安全、方便、可随时修改设计等不可替代的优点，在电子系统中采用FPGA可以极大的提升硬件系统设计的灵活性，可靠性，同时提高硬件开发的速度和降低系统的成本。FPGA的固有优点使其得到越来越广泛的应用，FPGA设计技术也被越来越多的设计人员所掌握。 本文首先介绍了编码理论和常用的RS编译码算法，提出RS编码器实现方案，详细分析了译码器的ME算法和改进BM算法的实现，针对ME算法提出了一种流水线结构的纠删纠错RS译码器实现方案，在译码器复杂度和延时上作了折衷，降低了译码器的复杂度并提高了最高工作频率，利用有限域乘法器的特性对编译码电路进行优化。这些技术的采用大大的提高了RS编译码器的效率，节省了RS编译码器占用的资源。在Xilinx公司的Virtex-II系列FPGA上设计并成功实现了RS(208，192)编译码器。
上传时间： 2013-07-20
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随着电子技术和集成电路技术的飞速发展，数字信号处理已经广泛地应用于通信、信号处理、生物医学以及自动控制等领域中。离散傅立叶变换(DFT)及其快速算法FFT作为数字信号处理中的基本变换，有着广泛的应用。特别是近年来，基于FFT的ODFM技术的兴起，进一步推动了对高速FFT处理器的研究。 FFT 算法从出现到现在已有四十多年代历史，算法理论已经趋于成熟，但是其具体实现方法却值得研究。面向高速、大容量数据流的FFT实时处理，可以通过数据并行处理或者采用多级流水线结构来实现。特别是流水线结构使得FFT处理器在进行不同点数的FFT计算时可以通过对模块级数的控制很容易的实现。 本文在分析和比较了各种FFT算法后，选择了基2和基4混合频域抽取算法作为FFr处理器的实现算法，并提出了一种高速、处理点数可变的流水线结构FFT处理器的实现方法。利用这种方法实现的FFT处理器成功的应用到DAB接收机中，RTL级仿真结果表明FFT输出结果与C模型输出一致，在FPGA环境下仿真波形正确，用Ouaaus Ⅱ软件综合的最高工作频率达到133MHz，满足了高速处理的设计要求。
上传时间： 2013-05-29
上传用户：GavinNeko
超宽带冲激雷达是一种新体制雷达，其发射信号是无高频载频，宽度仅为纳秒级的冲激脉冲。得益于这种特殊的发射信号，超宽带冲激雷达具有优异的探测性能和广泛的应用前景。自然地，对于发射机的研究，在超宽带冲激雷达研究领域有着极其重要的地位。本文在超宽带冲激雷达实验系统的基础上，对其发射机进行了深入研究，主要内容如下： 1、介绍了超宽带冲激雷达发射机，尤其是脉冲源的原理及设计。 2、分析了决定超宽带冲激雷达探测距离的因素。在此基础上寻求通过提高发射信号脉冲重复频率来增大发射机的能量输出；提出了一种提高脉冲重复频率的方法。设计了基于现场可编程门阵列的延时控制电路，对提高脉冲重复频率予以工程实现。 3、提出了超宽带冲激雷达波束扫描的实现方法：通过精密控制各发射机脉冲源触发时间，在各路发射信号之间产生一定的延时。设计了运用现场可编程门阵列实现这种控制的精密延时电路。
上传时间： 2013-08-05
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这篇论文以数字电视条件接收系统为研究对象，系统硬件设计以DSP和FPGA为实现平台，采用以DSP实现其加密算法、以FPGA实现其外围电路，对数字电视条件接收系统进行设计。首先根据数字电视条件接收系统的原理及其软硬分离的发展趋势，提出采用 DSP+FPGA结构的设计方式，将ECC与AES加密算法应用于SK与CW的加密；根据其原理对系统进行总体设计，同时对系统各部分的硬件原理图进行详细设计，并进行 PCB设计。其次采用从上而下的设计方式，对FPGA实现的逻辑功能划分为各个功能模块，然后再对各个模块进行设计、仿真。采用Quartus Ⅱ7.2软件对FPGA实现的逻辑功能进行设计、仿真。仿真结果表明：基于通用加扰算法(CSA)的加扰器模块，满足TS流加扰要求；块加密模块的最高时钟频率达到229.89MHz，流加密模块的最高时钟频率达到331.27MHz，对于实际的码流来说，具有比较大的时序裕量；DSP接口模块满足 ADSP BF-535的读写时序；包处理模块实现对加密后数据的包处理。最后对条件接收系统中加密算法程序采用结构化、模块化的编程方式进行设计。 ECC设计时采用C语言与汇编语言混合编程，充分利用两种编程语言的优势。将ECC 与AES加密算法在VisualDSP++3.0开发环境下进行验证，并下载至ADSP BF-535评估板上运行。输出结果表明：有限域运算汇编语言编程的实现方式，其运行速度明显提高， 192位加法提高380个时钟周期，32位乘法提高92个时钟周期；ECC与AES达到加密要求。上述工作对数字电视条件接收系统的设计具有实际的应用价值。关键词：条件接收，DSP，FPGA，ECC，AEs
上传时间： 2013-07-03
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WinAVR中自带的延时函数说明 WinAVR中自带的延时函数说明
上传时间： 2013-06-14
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基于单片机的秒,分,时可调时钟的设计相关程序 。有关始终的设计请进入http://www.21ic.com/app/ce/201209/141515.htm
上传时间： 2013-08-01
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