卷积编码是深空通信系统和无线通信系统中常用的一种编码方式。Viterbi码算法是卷积码的一种最大似然译码算法，它按照最大似然译码准则，在网格图上找出一条最大似然路径来得到译码结果。本设计的主要内容是3比特软判决Viterbi译码器的FPGA实现，设计是采用硬件VHDL语言来完成，并在ModelSim和Quartus Ⅱ软件环境下进行编译和仿真。在论文中介绍了Viterbi译码器的各模块的各种算法，并着重介绍了本设计所采用的具体方法，通过仿真和测试，验证了设计的正确性。最后，介绍了Viterbi译码器在未来通信中的发展和应用。
上传时间： 2013-07-02
上传用户：坏天使kk
基于FPGA的Turbo码编译码器实现基于FPGA的Turbo码编译码器实现
上传时间： 2013-06-13
上传用户：ippler8
针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置到Altera公司Stratix III系列的EP3SL150F1152C2N中。测试结果表明，系统运行稳健可靠，并具有良好的移植性；集成化一体设计，为LTE标准下Turbo码 ASIC的开发提供了参考。
上传时间： 2013-10-28
上传用户：d815185728
针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置到Altera公司Stratix III系列的EP3SL150F1152C2N中。测试结果表明，系统运行稳健可靠，并具有良好的移植性；集成化一体设计，为LTE标准下Turbo码 ASIC的开发提供了参考。
上传时间： 2013-10-08
上传用户：回电话#
ADI BF535 DSP 3*3的二维卷积汇编优化源码
上传时间： 2015-02-09
上传用户：bibirnovis
ADI BF535 DSP 图象5*5卷积计算汇编优化源码
上传时间： 2014-11-11
上传用户：weiwolkt
通过对用硬件描述语言VHDL表示的某个专用部件（如中断控制器、差错控制码编码/译码器，此为译码器）的代码分析，构建它的逻辑结构，加深对相关部件设计技术的理解。 试验平台：MaxPlusII
上传时间： 2015-04-08
上传用户：lps11188
信道编码线性分组码hamming码的编码器译码器设计与仿真实现。
上传时间： 2015-06-11
上传用户：古谷仁美
卷积编码、维特比译码的MATLAB代码，程序来自《现代通信系统－使用matlab》英文版，个人用着不错：）
上传时间： 2014-01-04
上传用户：Breathe0125
该文件夹给出了卷积编码、交织及维特比软译码仿真程序
上传时间： 2013-12-11
上传用户：黑漆漆
