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VHDL/FPGA/Verilog
> 数字秒表的设计
数字秒表的设计
资源大小:
303 K
上传时间:
2013-12-12
上传用户:
zhangyan
资源积分:
2 下载积分
标 签:
数字秒表
资 源 简 介
数字秒表的设计,reset为归零设置,start为重新计时设置
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