全加器,有半加器和或门组成.元件例化语句.
资源简介:全加器,有半加器和或门组成.元件例化语句.
上传时间: 2013-12-27
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资源简介:用例化语句和case语句编写的全加器的VHDL描述。
上传时间: 2017-06-15
上传用户:zhangyi99104144
资源简介:EDA 全减器 包括半减器
上传时间: 2014-10-10
上传用户:561596
资源简介:4位乘法器,4位除法器 8位数据锁存器,8位相等比较器,带同步复位的状态 机,元件例化与层次设计,最高优先级编码器
上传时间: 2014-12-07
上传用户:pompey
资源简介:此程序采用VHDL语言,利用元件例化语句,在带BCD码转换的4位加法器的基础上完成8位加法器的例化
上传时间: 2016-06-18
上传用户:tb_6877751
资源简介:各种电子器件管脚图,THD-1型数字电路实验箱简介,门电路及参数测试,半加器、全加器,数据选择器,数码比较器,译码器和数码显示器,锁存器和触发器,中规模计数器,双向移位寄存器,三态门和数据总线,半导体存储器,多谐振荡器,单稳态触发器,CMOS门电路及集成施密特触...
上传时间: 2013-12-19
上传用户:heart520beat
资源简介:vhdl基于半加器的全加器描述及仿真
上传时间: 2014-11-25
上传用户:zycidjl
资源简介:全加器的详细设计思路和用VHDL语言编写的详细源代码
上传时间: 2014-01-12
上传用户:zhaiyanzhong
资源简介:半加器 或门 1位二进制全加器顶层设计描述
上传时间: 2014-01-03
上传用户:cursor
资源简介:1位全加器的vhdl设计 通过两个半加起实现
上传时间: 2017-01-12
上传用户:徐孺
资源简介:用VHDL语言实现半加器。已经通过编译和仿真
上传时间: 2013-12-30
上传用户:cc1915
资源简介:利用两个半加器来组成的全加器,是简单的vhdl语言入门
上传时间: 2017-06-09
上传用户:leixinzhuo
资源简介:用VHDL设计一个4位二进制并行半加器,要求将被加数、加数和加法运算和用动态扫描的方式共阴数码管一同时显示出
上传时间: 2014-11-24
上传用户:haohaoxuexi
资源简介:四位二进制计数器与半加器
上传时间: 2013-12-24
上传用户:来茴
资源简介:大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟,数码显示,74ls138,8,4位计数器,d,rs触发器,加法器,交通灯等,此原码基于长江大学可编程器件实验箱,如要运行在其他平台上需要重新定义管脚
上传时间: 2013-12-23
上传用户:qiaoyue
资源简介:用VHDL编写的8位全加器,数字分频器等程序
上传时间: 2013-12-16
上传用户:ztj182002
资源简介:本文件包是在MAX+plus II 软件环境下实现半加器的逻辑功能
上传时间: 2014-01-15
上传用户:磊子226
资源简介:DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低.
上传时间: 2013-12-26
上传用户:希酱大魔王
资源简介:4位八段数码管的十进制加计数仿真实验,程序采用汇编语言编写。此程序在仿真软件上与EDN-51实验板上均通过。仿真图中的数码管位驱动采用74HC04,如按EDN-51板上用想同的PNP三极管驱动在仿真软件上则无法正常显示。程序共分5块,STAR0为数据初始化,STAR2为计...
上传时间: 2013-10-11
上传用户:sssl
资源简介:用1位半减器构成一位全减器,之后再构成8位全减器。有三个组件:h_suber,一位半减器,f_suber,一位全减器,f_suber8,8位全减器。
上传时间: 2016-06-30
上传用户:mpquest
资源简介:文本编辑器有一微软的记事本,没有再比这好的文本编辑工具了,支持多种语言的加亮显示。
上传时间: 2013-12-08
上传用户:yepeng139
资源简介:SIGMA-DELTA 原理 实现的用LPC900系列单片机的比较器实现16位A/D。 有详细的说明和源代码(汇编格式,但是可以在KEIL下的C中调用)。
上传时间: 2014-01-16
上传用户:懒龙1988
资源简介:Ripple Adder: 16-bit 全加,半加及ripple adder的设计及VHDL程序 Carry Look ahead Adder:4, 16, 32 bits 前置进位加法器的设计方案及VHDL程序 Carry Select Adder:16 Bits 进位选择加法器的设计方案及VHDL程序
上传时间: 2015-05-13
上传用户:我们的船长
资源简介:VRay光影追踪渲染器有Basic Package 和 Advanced Package两种包装形式。Basic Package具有适当的功能和较低的价格,适合学生和业余艺术家使用。Advanced Package 包含有几种特殊功能,适用于专业人员使用。
上传时间: 2014-12-01
上传用户:xhz1993
资源简介:用VHDL结构描述设计一全减器,全减器可由两个半减器和一个或门组成。
上传时间: 2013-12-22
上传用户:思琦琦
资源简介:电子阅读器,适合处学者使用和学习.有意见联系我 .
上传时间: 2014-12-01
上传用户:hustfanenze
资源简介:x5045有四种功能:分别是上电复位、看门狗定时器、电源电压监控和块锁保护串行eeprom的功能, 该程序通过改变控制寄存器的参数可以实现看门狗定时器监视电压和设置保护rom区,每次复位后 地址计数器都是该区的首地址(个人观点),即断点地址。 问题:其实...
上传时间: 2015-11-10
上传用户:chens000
资源简介:TLC549是一种采用8位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、8位A/D转换器、数据寄存器以及控制逻辑电路。TLC549每25uS重复一次“输入—转换—输出”。器件有两个控制输入:I/O CLOCK和片选(CS)。 内部系统时钟和I/O CLOCK可独立使用...
上传时间: 2014-01-17
上传用户:qiaoyue
资源简介:对于BDA可调控制,有A/D功能和比较器比较输出
上传时间: 2013-12-18
上传用户:fnhhs
资源简介:手机RPG游戏的最终运行代码(内帶有地图编辑器和jar和jad)
上传时间: 2016-06-03
上传用户:gdgzhym