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second-CLOCK

  • 电磁兼容 EMI Prevention in Clock-Distribution Circuits

    详细介绍电磁兼容原理,设计,及解决问题的方法原理

    标签: 电磁兼容

    上传时间: 2021-10-18

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  • 欧母龙PLC例程PLC控制器源码255个合集

    欧母龙PLC例程PLC控制器源码255个合集:1600T俄罗斯压力机.rar200吨压机程序 omron 的机子C系列的.rar3MK136旧磨床现程序.rar3电机延时控制启停.rar5V编码器信号如何接入CP1H高数计数案例.rar6路抢答器源码.rar902002 OMRON.rarASCII Generic Protocol Macro Object Code.zipASCII Generic Protocol Macro.zipC3电枢异物吸引.rarCalendar Calculation.zipcarbon.rarCompact Flash Memory Write.zipCounter Multiplex.zipcp1h 高速计数触发中断注意点.rarcp1h-x40用在非标饮料线上的程序,有注解.rarCP1H与爱默生温控模块的通讯程序.rarCP1L and CP1H EasyModbus FB.zipCPM1A编写的赞扬15T立式注塑机.rarCPM2A Interupt High Speed Counting Sample.zipCPM2A自身时钟六个时间段触发程序.rarCQM1 Host Link Master.zipCQM1H 21的例子程序,有温度压力等PID控制。.rarCQMaster.swp.zipCS CJ CP NSJ password set.zipCS1 C Mode Hostlink.zipCS1-CJ1 Floating Point to Fixed Point Conversion for HMI.zipcub.rarCX-Programmer Ver.5 Introduction Guide R120-E1-01..zipCX-Programmer Ver.5 Introduction to Function Blocks Guide R121-E1-01.zipC_Mode_Hostlink.zipDeviceNet Explicit Message Example.zipdieban.rarEasy to use Modbus RTU Master for CP1L CP1H CJ1 CJ2 CS1.zipExample of Using Daylight Saving FB's.zipExample Scale Meter Protocol.zipFB Calculate Day Of Week.zipFB Day light savings function block.zipFB Extract Time Date into SecMin Hr Day Mth Yr.zipFB Scale with parameters.zipGKF1250离心机CXP.rargkf1250离心机cxpgkf离心机omron.rarJH21-200程序.rarLED液压机.rarlogging+ filewrite.ziplpr-des.rarModbus Protocol Macro Object Code.zipModbus Protocol Macro.zipModbus RTU Sample Code CJ1-SCB.rarModbus TCP Client using FB's.zipOmron CS1 Sequencer.zipOMRON E6CP绝对值编码器使用实例。编码器为8位格雷码输出.rarOmron Modbus Slave Ladder.zipOmron Plc 变频一带三例程.rarOMRON PLC编程示范.raromron--MOV傳送指令.raromron-cs1g-h-cpu42日本机的程序.rarOmron_CJ2_to_AB_EIP_Tag_Datalink_Example.rarOMRON接驳台.rarOMRON控制2伺服.rarOMRON温度,压力模拟量输入程序.rarOMRON照明设备程序.raromron的PLC案例程序.rarOMRON程序举例.rarOMRON程序举例2.rarOMRON纸病分析系统-PLC程序(CJ1G).zipomron脉冲输出到驱动器的程序.rarPCB 沉铜线程序.rarPID温度控制的PLC程序设计实例.rarPinstamp.zipPLC Clock adjustment with screen.zipPLC锰钢程序cpm2a.zipPolls and Writes setpoints to E5CK Process Controller - E5CK.swp.zipPRO9连拉.rarProcess states sequence logics.zipQuadrature Input for Standard CPM1A DC Inputs.zipRandom Number Generator.zipScaling in CJ1 CS1 PLC's.zipSMS - GSM PLC Communications.zipsony 公司 某机台控制程序.rarStepNext.cpt.zipSTUP Example.zipTemplate for Step-Step Next Sequence.zipToggle Button.zipTracking product on conveyor.zipTXD-RXD Quickstart Programs.zipTXD-RXD Serial Port Handling.zipUseable timer.zipV600-E5CK.zipV700-V720 RFID Protocol Macro.zipVB与OMRON PLC通讯源码.rarWoodwood Controler Example Protocol Program.zipYH32-315油压机程序.rar一个CJ1M的程序.rar一个OMRON程序,带位置控制模块.rar一个生产线上润滑控制的小程序.rar一些简单的cpm1a程序.rar一控三恒压供水程序.rar三层提升机欧姆龙CQM1H程序.rar三菱400吨和200号冲床程序.rar上海产自动模切机飞达部程序.zip上海狮印全自动啤机程序.rar东芝压铸机梯形图.rar两步法吹瓶机.rar乡林剪台.rar买书的随书样例.rar井研磨边机.rar交通灯注释全.rar今机立式注塑机程序.rar伺服电机正反转控制.rar位置控制(旋转编码器与PLC).rar充磁机程序.rar先启后停 后启先停 事例.rar冲床程序.rar分拣线主机一个CJ1M的分拣线程序下挂CP1H.rar利慧利乐灌装机程序.rar刮水器停止位置检查程序.rar力泰翻胚机程序.rar北人04印刷机程序.rar北人LQD10骑马装订程序.rar半自动吹瓶机的程.rar南京印刷机.zip卡板程式.rar压制机程序(带解释,注释).rar压力机控制程序.rar原创液压机程序带注释欧姆龙PLC加信捷文本.rar原点搜索程序.rar双翻分拣机.rar双边机.rar反渗透整套PLC控制.rar台湾产染色机欧姆龙PLC带3只IO扩展控制程序.rar台湾大拉无板.rar啤酒厂酒瓶美容机.rar四川绵阳建丰热磨工段.rar在用设备程序.rar垂直涂布.rar外端子设计数值.rar大型热电厂 PLC程序(带注解).rar大摇动超声波清洗机.rar大连75密练注释程序.rar安呼12级.rar富佳扶梯程序.rar对齐度编程!!.rar小车控制程序.rar小车送料”例程.rar广东锻压气压冲床程序(80T)有详细注解.rar广告牌灯箱.rar微电机刷簧自动组装程序.rar微粉砖自动送料带OMRON CQM2A+扩展程序带注释.rar意大利进口皮革压花.rar扎钢机程序.rar打包机.rar拔盖机.rar拨码控制.rar挡砖磨边机(新1).rar捷豹空压机控制程序.rar接木机.rar控制程序例子.rar推挂.rar攻丝机2(新).rar料位显示.rar旋转门控制程序1.rar无协议.rar无心磨床(OMRON系统,带机械手有详细注解).rar无线胶装机欧姆龙程序.zip日本人编的程序 抛光研磨.rar日本成型磨床控制程序(附注释)欧姆龙CPM1A.rar板坯定厚.rar样例,有注释.rar模拟量试验.rar欧姆龙CJ1M铬化机程序带注释.rar欧姆龙CP1H例程.rar欧姆龙CPM1A的PLC.rar欧姆龙CPM2AH  PLC和欧姆龙NTZ触摸屏编写的超声波清洗机程序..rar欧姆龙CPM2AH Host Link通讯程序(发布源码).rar

    标签: plc 控制器

    上传时间: 2021-10-22

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  • FPGA读写SD卡读取BMP图片通过LCD显示例程实验 Verilog逻辑源码Quartus工程文件

    FPGA读写SD卡读取BMP图片通过LCD显示例程实验 Verilog逻辑源码Quartus工程文件+文档说明,FPGA型号Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。1 实验简介在前面的实验中我们练习了 SD 卡读写,VGA 视频显示等例程,本实验将 SD 卡里的 BMP 图片读出,写入到外部存储器,再通过 VGA、LCD 等显示。本实验如果通过液晶屏显示,需要有液晶屏模块。2 实验原理在前面的实验中我们在 VGA、LCD 上显示的是彩条,是 FPGA 内部产生的数据,本实验将彩条替换为 SD 内的 BMP 图片数据,但是 SD 卡读取速度远远不能满足显示速度的要求,只能先写入外部高速 RAM,再读出后给视频时序模块显示module top( input                       clk, input                       rst_n, input                       key1, output [5:0]                seg_sel, output [7:0]                seg_data, output                      vga_out_hs,        //vga horizontal synchronization output                      vga_out_vs,        //vga vertical synchronization output[4:0]                 vga_out_r,         //vga red output[5:0]                 vga_out_g,         //vga green output[4:0]                 vga_out_b,         //vga blue output                      sd_ncs,            //SD card chip select (SPI mode) output                      sd_dclk,           //SD card clock output                      sd_mosi,           //SD card controller data output input                       sd_miso,           //SD card controller data input output                      sdram_clk,         //sdram clock output                      sdram_cke,         //sdram clock enable output                      sdram_cs_n,        //sdram chip select output                      sdram_we_n,        //sdram write enable output                      sdram_cas_n,       //sdram column address strobe output                      sdram_ras_n,       //sdram row address strobe output[1:0]                 sdram_dqm,         //sdram data enable output[1:0]                 sdram_ba,          //sdram bank address output[12:0]                sdram_addr,        //sdram address inout[15:0]                 sdram_dq           //sdram data);parameter MEM_DATA_BITS         = 16  ;            //external memory user interface data widthparameter ADDR_BITS             = 24  

    标签: fpga

    上传时间: 2021-10-27

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  • Multisim官方示例Multisim仿真例程基础电路范例135例合集

    Multisim官方示例Multisim仿真例程基础电路范例135例合集:Chapter 1 - RLC CircuitsChapter 2 - DiodesChapter 3 - TransistorsChapter 4 - AmplifiersChapter 5 - OpampsChapter 6 - FiltersChapter 7 - Miscellaneous CircuitsFundamental Circuits.pdf004 Parallel DC Circuits.ms10005 Series-Parrallel DC Circuit.ms10006 Current Analysis.ms10007 Millmans Theorem 1.ms10008 Millmans Theorem 2.ms10009 Kirchhoff's Current Law.ms10010 Thevenin's Theorem.ms10011 Superposition Principle.ms10012 Nortons Theorem and Source Conversion.ms10013 AC Voltage Measurement.ms10014 Frequency Response of the Series RL Network.ms10015 RL High and Low Pass Filter.ms10016 Frequency Response of the Series RC Network.ms10017 RC High and Low Pass Filter.ms10019 Center-Tapped Full-Wave Rectifier.ms10020 Bridge Rectifier.ms10021 Capacitor-Input Rectifier Filter.ms10022 Diode Clipper (Limiter).ms10023 Diode Clipper.ms10024 Diode Clamper (DC Restorer).ms10025 Diode Voltage Doubler.ms10026 Zener Diode and Voltage Regulation 1.ms10027 Zener Diode and Voltage Regulation 2.ms10028 Zener Diode and Voltage Regulation 3.ms10105 TTL Inverter.ms10107 TTL Gate.ms10109 OR Gate Circuit.ms10111 Over-Damp Circuit.ms10113 Critical-Damp Circuit.ms10115 Series RLC Circuit 1.ms10117 Clapp Oscillator.ms10119 Differential Amplifier 1.ms10121 Differential Amplifier in Common Mode.ms10123 LC Oscillator with Unity Gain Buffer.ms10125 Notch Filter.ms10127 PNP Differential Pair.ms10129 Crossover Network.ms10131 Second-Order High-Pass Chebyshev Filter.ms10133 Third-Order High-Pass Chebyshev Filter.ms10135 Fifth-Order High-Pass Filter.ms10

    标签: multisim

    上传时间: 2021-10-27

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  • 300个C51单片机设计proteus仿真源码软件源码: 100000秒以内的计时程序 10秒的秒表

    300个C51单片机设计proteus仿真源码软件源码:100000秒以内的计时程序10秒的秒表12864LCD图形滚动演示128X64LED160128LCD图文演示1602字符液晶滚动演示程序1602液晶显示的DS1302实时时钟16×16点阵(滚动显示)16×16点阵2(滚动显示)2io5键盘模拟音量数码管显示2×20串行字符液晶演示32x16汉字44行列键盘485全双工通信4×4键盘矩阵控制条形LED显示4个独立式按键控制LED开关4个独立式按键控制LED移位4只数码管滚动显示0~3555可调PWM发生器555的应用6264扩展内存6个16×16点阵74HC154译码器应用74HC59574HC595串入并出芯片应用74LS138译码器应用74LS148扩展中断8051双机通信简例8255并行口扩展实例89C51PWM8x8LED汉字显示8x8点阵做的贪吃蛇游戏8×8LED点阵屏显示数字8只数码管同时显示不同字符8只数码管显示多个不同字符8只数码管滚动显示8~F8只数码管滚动显示单个数字8只数码管滚动显示数字串8只数码管闪烁显示8通道自动温度检测系统仿真(含原程序)ADC0808 PWM实验ADC0809模数转换与显示ADC0832模数转换与显示AT89C51对直流电动机的驱动AVR_UartBCD译码数码管显示数字c51 可预设电压的数控电源(功能强大)clockConterCPU控制的独立式键盘扫描实验da、ad。液晶,传递函数模型综合应用的实例DIY51式数控电源DS1621温度传感器实验ds18b20DS18B20温度传感器实验DS18B20温度检测及其液晶显示HorseLightI2CIIC-24C04与数码管IIC-24C04与蜂鸣器INT0与INT1中断计数INT0中断3位计数INT0及INT1中断计数INT0和INT1控制条形LEDINT1中断5位计数IO并行口直接驱动单个数码管K1-K4 分组控制LEDK1-K4 控制LED移位K1-K4 控制数码管加减演示K1-K4 控制数码管移位显示K1-K4 键状态显示key_lcdks0108 液晶12864LCD频率计仿真LED代码查询V1[1].1LED模拟交通灯LED闪烁M16_AN_CompareM16_EEPROMM16_HorseMAX7221控制数码管动态显示my16key_cNT0中断控制LEDNT0中断计数NumberDisplayP3口流水灯PCF8574PCF8583+LCD1602PCF8591模数与数模转换实验proteus ADDC的练习程序PWMPWMLEDPWM控制LED的亮度仿真程序PWM控制马达的方法PWM波输出(可调)PWM电机正反转pwm程序实例PWM调温RAM扩展练习sscom32串口调试TIMER0与TIMER1控制条形LEDTIMER0控制LED二进制计数TIMER0控制单只LED闪烁TIMER0控制四只LED滚动闪烁TIMER0控制流水灯ULN2803usart_t《lcd1602仿真实例》一个数控直流稳压电源一个步进电机的仿真一步一步教你51_PC串口通信万能逻辑电路实验三机通讯串口仿真mcu_pc串口方式1串行数据转换为并行数据交通灯从左到右的流水灯光藕隔离驱动电机内部函数intrins.h应用举例净水控制器仿真电路刚做好的十个字的led屏模拟有程序包含单片机寄存器的头文件单只按键控制单只数码管滚动显示单只数码管循环显示0-9单只数码管循环显示0~F单片机与PC机串口通讯仿真单片机之间双向通信单片机向PC发送数据单片机向主机发送字符串单片机接收PC发出的数据单片机控制的电动自行车驱动系统单片机数据发送程序发一个用定时器做的PWM基于1602+ds12b80+ds1302+音乐+电子书+流水灯的多功能电子表基于ADC0832的数字电压表基于AT24C02的多机通信基于AT89C51+MAX7219的频率计 附带proteus仿真电路图 实际硬件电路测试通过基于DS1302的日历时钟基于yjwpm测试过的DS18B20仿真实例多功能电子钟多点温度测量多路开关状态指示大屏幕仿真子电路做的一个H型电机驱动电路字符串函数string.h应用举例字符函数ctype.h应用举例宏定义应用举例定时器中断控制的独立式键盘扫描实验定时器控制交通指示灯定时器控制数码动态显示定时器控制数码管动管显示对I2C总线上挂接多个AT24C0

    标签: c51 单片机 proteus 仿真

    上传时间: 2021-10-27

    上传用户:wangshoupeng199

  • 74HC595 A4950 MAX3232 ULN2003AD STM32F207VCT6 AD集成封装库

    74HC595 A4950 MAX3232 ULN2003AD  STM32F207VCT6 AD集成封装库,原理图库器件型号列表:Library Component Count : 53Name                Description----------------------------------------------------------------------------------------------------1N4148              High Conductance Fast Diode1N4448              High Conductance Fast Diode1N914               High Conductance Fast Diode1N914A              High Conductance Fast Diode1N914B              High Conductance Fast Diode1N916               High Conductance Fast Diode1N916A              High Conductance Fast Diode1N916B              High Conductance Fast Diode2N3904              NPN General Purpose Amplifier74ALS86             74HC595             8M贴片晶振          A4950               直流电机驱动AO4805CAP                 CapacitorCAP SMD             CapacitorCON2                ConnectorCON2*10             ConnectorCON2*12P            ConnectorCON2*7              ConnectorCON2*9              ConnectorCON3                ConnectorCON4                ConnectorCON5                ConnectorCON7                ConnectorCap Pol             极性电解电容DIODE               DiodeFUSE1               FuseFUSE2               FuseINDUCTOR2           IRF7351PbF          N-MOSJS1-12V-FLED                 MAX487              MAX809RD            R0.125              Less than 1/4 Watt Power Resistor.RES2                RGRPI*4               Res1                ResistorSGM8955XN5G/TR      测量放大器SM712               SN74LV4052AD        SP3232ESST25VF016B-50-4I-S2AFI2C Real-Time Clock.STM32F107VTC6       STM32F107VTC6SW DIP-4            编码开关SW-PB               SwitchTPS54302            45UA静态电流 3ATVS                 SMBJ30CAULN2003             XC6214XTAL                Crystal OscillatorPCB封装库列表:Component Count : 40Component Name-----------------------------------------------4G模块-外置7D181K0603-LED0603C0603R0805C12061210181232255569-2*1P直针5569-2*2P直针AT-26CAP-D8DO-214AANHSOP-8J-SPDT-5JTAGL

    标签: 74hc595 a4950 stm32

    上传时间: 2021-11-15

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  • FPGA读取OV5640摄像头数据并通过VGA或LCD屏显示输出的Verilog逻辑源码Quartu

    FPGA读取OV5640摄像头数据并通过VGA或LCD屏显示输出的Verilog逻辑源码Quartus工程文件+文档说明,FPGA型号Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。module top( input                       clk, input                       rst_n, output                      cmos_scl,          //cmos i2c clock inout                       cmos_sda,          //cmos i2c data input                       cmos_vsync,        //cmos vsync input                       cmos_href,         //cmos hsync refrence,data valid input                       cmos_pclk,         //cmos pxiel clock output                      cmos_xclk,         //cmos externl clock input   [7:0]               cmos_db,           //cmos data output                      cmos_rst_n,        //cmos reset output                      cmos_pwdn,         //cmos power down output                      vga_out_hs,        //vga horizontal synchronization output                      vga_out_vs,        //vga vertical synchronization output[4:0]                 vga_out_r,         //vga red output[5:0]                 vga_out_g,         //vga green output[4:0]                 vga_out_b,         //vga blue output                      sdram_clk,         //sdram clock output                      sdram_cke,         //sdram clock enable output                      sdram_cs_n,        //sdram chip select output                      sdram_we_n,        //sdram write enable output                      sdram_cas_n,       //sdram column address strobe output                      sdram_ras_n,       //sdram row address strobe output[1:0]                 sdram_dqm,         //sdram data enable output[1:0]                 sdram_ba,          //sdram bank address output[12:0]                sdram_addr,        //sdram address inout[15:0]                 sdram_dq           //sdram data);

    标签: fpga ov5640 摄像头

    上传时间: 2021-12-18

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  • 基于FPGA设计的字符VGA LCD显示实验Verilog逻辑源码Quartus工程文件+文档说明

    基于FPGA设计的字符VGA  LCD显示实验Verilog逻辑源码Quartus工程文件+文档说明,通过字符转换工具将字符转换为 8 进制 mif 文件存放到单端口的 ROM IP 核中,再从ROM 中把转换后的数据读取出来显示到 VGA 上,FPGA型号Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。module top( input                       clk, input                       rst_n, //vga output         output                      vga_out_hs, //vga horizontal synchronization          output                      vga_out_vs, //vga vertical synchronization                   output[4:0]                 vga_out_r,  //vga red output[5:0]                 vga_out_g,  //vga green output[4:0]                 vga_out_b   //vga blue );wire                            video_clk;wire                            video_hs;wire                            video_vs;wire                            video_de;wire[7:0]                       video_r;wire[7:0]                       video_g;wire[7:0]                       video_b;wire                            osd_hs;wire                            osd_vs;wire                            osd_de;wire[7:0]                       osd_r;wire[7:0]                       osd_g;wire[7:0]                       osd_b;assign vga_out_hs = osd_hs;assign vga_out_vs = osd_vs;assign vga_out_r  = osd_r[7:3]; //discard low bit dataassign vga_out_g  = osd_g[7:2]; //discard low bit dataassign vga_out_b  = osd_b[7:3]; //discard low bit data//generate video pixel clockvideo_pll video_pll_m0( .inclk0                (clk                        ), .c0                    (video_clk                  ));color_bar color_bar_m0( .clk                   (video_clk                  ), .rst                   (~rst_n                     ), .hs                    (video_hs                   ), .vs                    (video_vs                   ), .de                    (video_de                   ), .rgb_r                 (video_r                    ), .rgb_g                 (video_g                    ), .rgb_b                 (video_b                    ));osd_display  osd_display_m0( .rst_n                 (rst_n                      ), .pclk                  (video_clk                  ), .i_hs                  (video_hs                   ), .i_vs                  (video_vs                   ), .i_de                  (video_de                   ), .i_data                ({video_r,video_g,video_b}  ), .o_hs                  (osd_hs                     ), .o_vs                  (osd_vs                     ), .o_de                  (osd_de                     ), .o_data                ({osd_r,osd_g,osd_b}        ));endmodule

    标签: fpga vga lcd

    上传时间: 2021-12-18

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  • 基于FPGA设计的sdram读写测试实验Verilog逻辑源码Quartus工程文件+文档说明 DR

    基于FPGA设计的sdram读写测试实验Verilog逻辑源码Quartus工程文件+文档说明,DRAM选用海力士公司的 HY57V2562 型号,容量为的 256Mbit,采用了 54 引脚的TSOP 封装, 数据宽度都为 16 位, 工作电压为 3.3V,并丏采用同步接口方式所有的信号都是时钟信号。FPGA型号Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。timescale 1ps/1psmodule top(input                        clk,input                        rst_n,output[1:0]                  led,output                       sdram_clk,     //sdram clockoutput                       sdram_cke,     //sdram clock enableoutput                       sdram_cs_n,    //sdram chip selectoutput                       sdram_we_n,    //sdram write enableoutput                       sdram_cas_n,   //sdram column address strobeoutput                       sdram_ras_n,   //sdram row address strobeoutput[1:0]                  sdram_dqm,     //sdram data enable output[1:0]                  sdram_ba,      //sdram bank addressoutput[12:0]                 sdram_addr,    //sdram addressinout[15:0]                  sdram_dq       //sdram data);parameter MEM_DATA_BITS          = 16  ;        //external memory user interface data widthparameter ADDR_BITS              = 24  ;        //external memory user interface address widthparameter BUSRT_BITS             = 10  ;        //external memory user interface burst widthparameter BURST_SIZE             = 128 ;        //burst sizewire                             wr_burst_data_req;       // from external memory controller,write data request ,before data 1 clockwire                             wr_burst_finish;         // from external memory controller,burst write finish

    标签: fpga sdram verilog quartus

    上传时间: 2021-12-18

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  • 基于FPGA设计的vga显示测试实验Verilog逻辑源码Quartus工程文件+文档说明 FPGA

    基于FPGA设计的vga显示测试实验Verilog逻辑源码Quartus工程文件+文档说明,FPGA型号Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。module top( input                       clk, input                       rst_n, //vga output         output                      vga_out_hs, //vga horizontal synchronization          output                      vga_out_vs, //vga vertical synchronization                   output[4:0]                 vga_out_r,  //vga red output[5:0]                 vga_out_g,  //vga green output[4:0]                 vga_out_b   //vga blue );wire                            video_clk;wire                            video_hs;wire                            video_vs;wire                            video_de;wire[7:0]                       video_r;wire[7:0]                       video_g;wire[7:0]                       video_b;assign vga_out_hs = video_hs;assign vga_out_vs = video_vs;assign vga_out_r  = video_r[7:3]; //discard low bit dataassign vga_out_g  = video_g[7:2]; //discard low bit dataassign vga_out_b  = video_b[7:3]; //discard low bit data//generate video pixel clockvideo_pll video_pll_m0( .inclk0(clk), .c0(video_clk));color_bar color_bar_m0( .clk(video_clk), .rst(~rst_n), .hs(video_hs), .vs(video_vs), .de(video_de), .rgb_r(video_r), .rgb_g(video_g), .rgb_b(video_b));endmodule

    标签: fpga vga显示 verilog quartus

    上传时间: 2021-12-19

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