混合蛙跳算法解决多背包问题,此算法是在vs2005下编写,语法为基本的c语言(可以直接复制源码到vc中运行)
上传时间: 2013-07-19
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Max+plusⅡ是Altera公司提供的FPGA/CPLD开发集成环境,Altera是世界上最大可编程逻辑器件的供应商之一。Max+plusⅡ界面友好,使用便捷,被誉为业界最易用易学的EDA软件。在Max+plusⅡ上可以完成设计输入、元件适配、时序仿真和功能仿真、编程下载整个流程,它提供了一种与结构无关的设计环境,是设计者能方便地进行设计输入、快速处理和器件编程。
标签: 计算机组成原理
上传时间: 2013-05-22
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Quartus Ⅱ”菜单:可以完成新建文件、工程、编译、仿真、下载等操作
上传时间: 2013-06-30
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SoPC Builder在一个工具中实现了嵌入式系统各个方面的开发,包括软件的设计和验证,为充分利用SoPC技术提高电子系统的性能和降低成本提供了强有力的支持。
上传时间: 2013-04-15
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对于CPLD、FPGA和HardCopy? ASIC设计,Quartus? II软件10.1是业界性能和效能首屈一指的软件,现在可以下载。这一最新版软件引入了Qsys,它是功能强大的系统集成新工具。在Quartus II订购版软件10.1中以beta版的形式提供Qsys,它提高了系统开发速度,支持设计重用,从而缩短了FPGA设计过程,减轻了工作量。
上传时间: 2013-07-24
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ISE® 12 软件设计套件,实现了具有更高设计生产力的功耗和成本的突破性优化。ISE 设计套件首次利用“智能”时钟门控技术,将动态功耗降低多达 30%。此外,该新型套件还提供了基于时序的高级设计保存功能、为即插即用设计提供符合 AMBA 4 AXI4 规范的 IP 支持,同时具备第四代部分重配置功能的直观设计流程,可降低多种高性能应用的系统成本。
上传时间: 2013-05-15
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在为所有 Xilinx® Virtex®-6 和 Spartan®-6 FPGA 产品系列提供全面生产支持的同时,ISE 12 版本作为业界唯一一款领域专用设计套件,不断发展和演进,可以为逻辑、数字信号处理(DSP)、嵌入式处理以及系统级设计提供互操作性设计流程和工具配置。此外,赛灵思还在 ISE 12 套件中采用了大量软件基础架构,并改进了设计方法,从而不仅可缩短运行时间,提高系统集成度,而且还能在最新一代器件产品系列和目标设计平台上扩展 IP 互操作性
上传时间: 2013-04-15
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ispLEVER2.0是一套完整的EDA软件。设计输入可采用原理图、硬件描述语言、混合输入三种方式。能对所设计的数字电子系统进行功能仿真和时序仿真。编译器是此软件的核心,能进行逻辑优化,将逻辑映射到器件中去,自动完成布局与布线并生成编程所需要的熔丝图件。软件支持原有Lattice公司的GAL、ispLSI、MACH、ispGDX、ORCA2、ORCA3、ORCA4和最新的ispMACH器件。Xilinx.ISE.Design.Suite(北京市电子设计竞赛指定软件)
上传时间: 2013-05-20
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简单的高速接口,FPGA和高速AD的接口编程-Simple high-speed
上传时间: 2013-07-21
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"该软件提供了用户谁想要换行文本(插入一个回车)由单词数字符数,或通过与字检测的字符数,一个解决方案。只需添加拖放"
上传时间: 2013-05-17
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