Max+plusⅡ是Altera公司提供的FPGA/CPLD开发集成环境,Altera是世界上最大可编程逻辑器件的供应商之一。Max+plusⅡ界面友好,使用便捷,被誉为业界最易用易学的EDA软件。在Max+plusⅡ上可以完成设计输入、元件适配、时序仿真和功能仿真、编程下载整个流程,它提供了一种与结构无关的设计环境,是设计者能方便地进行设计输入、快速处理和器件编程。
标签: 计算机组成原理
上传时间: 2013-05-22
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MAX+PLUS II Advanced Synthsis ALtera的一个免费HDL综合工具,安装后可以直接使用,是MaxplusII的一个插件,用这个插件进行语言综合,比直接使用MaxplusII综合的效果好
上传时间: 2013-07-15
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频率是电子技术领域内的一个基本参数,同时也是一个非常重要的参数。稳定的时钟在高性能电子系统中有着举足轻重的作用,直接决定系统性能的优劣。随着电子技术的发展,测频系统使用时钟的提高,测频技术有了相当大的发展,但不管是何种测频方法,±1个计数误差始终是限制测频精度进一步提高的一个重要因素。 本设计阐述了各种数字测频方法的优缺点。通过分析±1个计数误差的来源得出了一种新的测频方法:检测被测信号,时基信号的相位,当相位同步时开始计数,相位再次同步时停止计数,通过相位同步来消除计数误差,然后再通过运算得到实际频率的大小。根据M/T法的测频原理,已经出现了等精度的测频方法,但是还存在±1的计数误差。因此,本文根据等精度测频原理中闸门时间只与被测信号同步,而不与标准信号同步的缺点,通过分析已有等精度澳孽频方法所存在±1个计数误差的来源,采用了全同步的测频原理在FPGA器件上实现了全同步数字频率计。根据全同步数字频率计的测频原理方框图,采用VHDL语言,成功的编写出了设计程序,并在MAX+PLUS Ⅱ软件环境中,对编写的VHDL程序进行了仿真,得到了很好的效果。最后,又讨论了全同步频率计的硬件设计并给出了电路原理图和PCB图。对构成全同步数字频率计的每一个模块,给出了较详细的设计方法和完整的程序设计以及仿真结果。
上传时间: 2013-06-05
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本文对基于FPGA的液晶显示控制系统的设计与实现进行了研究。设计中从LCD技术参数着手,通过对显示驱动系统结构与工作原理的研究,设计出显示控制系统的框图及各功能模块的VHDL程序,通过单片机系统配置FPGA芯片,控制LCD显示相应的汉字和图形。LCD显示控制系统由显示控制电路、显示驱动电路和相关外围辅助电路组成。显示控制电路从电路中各个功能模块所需要的控制时序信号出发,通过对其工作过程的研究,设计出控制器、RAM控制器等各功能模块。显示驱动电路从LCD工作所需要的扫描时序信号出发,设计出时序发生电路等各功能模块。所有的VHDL程序通过了MAX+PLUS—II软件实现编译及仿真后,在实际的硬件中调试通过。
上传时间: 2013-04-24
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EDA卷积码编解码器实现技术针对某扩频通信系统数据纠错编码的需要, 构造并分析了(2 , 1 , 6) 卷积码编解码器的基本工作原理, 提出了基于MAX +
上传时间: 2013-07-18
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伴随高速DSP技术的广泛应用,实时快速可靠地进行数字信号处理成为用户追求的目标。同时,由于可编程器件在速度和集成度方面的飞速提高,使得利用硬件实现数字信号实时快速可靠处理有了新的途径。 FIR滤波器是数字信号处理中常用部件,它的最大优点在于:设计任何幅频特性时,可以具有严格的线性相位,这一点对数字信号的实时处理非常关键。 FPGA是常用的可编程器件,它所具有的查找表结构非常适用于实现实时快速可靠的FIR滤波器,在加上VHDL语言灵活的描述方法以及与硬件无关的特点,使得使用VHDL语言基于FPGA芯片实现FIR滤波器成为研究的方向。 本文对基于FPGA的FIR数字滤波器实现进行了研究,并设计了一个16阶的FIR低通滤波器。所做的主要工作为: 1.以FIR数字滤波器的基本理论为依据,使用分布式算法作为滤波器的硬件实现算法,并对其进行了详细的讨论。针对分布式算法中查找表规模过大的缺点,采用多块查找表的方式减小硬件规模。 2.在设计中采用了自顶向下的层次化、模块化的设计思想,将整个滤波器划分为多个模块,利用VHDL语言的描述方法进行了各个功能模块的设计,最终完成了FIR数字滤波器的系统设计。 3.采用FLEX10K系列器件实现一个16阶的FIR低通滤波器的设计实例,用MAX+PLUSII软件进行了仿真,并用MATLAB对仿真结果进行了分析,证明所设计的FIR数字滤波器功能正确。 仿真结果表明,本论文所设计的FIR滤波器硬件规模较小,采样率达到了17.73MHz。同时只要将查找表进行相应的改动,就能分别实现低通、高通、带通FIR滤波器,体现了设计的灵活性。
上传时间: 2013-04-24
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频率合成技术广泛应用于通信、航空航天、仪器仪表等领域。目前,常用的频率合成技术有直接式频率合成,锁相频率合成和直接数字频率合成(DDS)。本次设计是利用FPGA完成一个DDS系统并利用该系统实现模拟信号的数字化调频。 DDS是把一系列数字量形式的信号通过D/A转换形成模拟量形式的信号的合成技术。主要是利用高速存储器作查寻表,然后通过高速D/A转换器产生已经用数字形式存入的正弦波(或其他任意波形)。一个典型的DDS系统应包括:相位累加器,可在时钟的控制下完成相位的累加;相位码—幅度码转换电路,一般由ROM实现;DA转换电路,将数字形式的幅度码转换成模拟信号。DDS系统可以很方便地获得频率分辨率很精细且相位连续的信号,也可以通过改变相位字改变信号的相位,因此也广泛用于数字调频和调相。本次数字化调频的基本思想是利用AD转换电路将模拟信号转换成数字信号,同时用该数字信号与一个固定的频率字累加,形成一个受模拟信号幅度控制的频率字,从而获得一个频率受模拟信号的幅度控制的正弦波,即实现了调频。该DDS数字化调频方案的硬件系统是以FPGA为核心实现的。使用Altera公司的ACEX1K系列FPGA,整个系统由VHDL语言编程,开发软件为MAX+PLUSⅡ。经过实际测试,该系统在频率较低时与理论值完全符合,但在高频时,受器件速度的限制,波形有较大的失真。
上传时间: 2013-06-14
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对于内燃机控制应用而言,AUDO MAX系列可以为每个缸单独计算最理想的空燃比和确定最佳燃油喷射量和点火时间。AUDO MAX系列的全面安全特性支持动力总成和底盘应用实现更高安全水平,例如连续减震控制系统。此外,AUDO MAX还十分适用于采用线控技术的车辆的自动变速箱控制。
标签: Infineon
上传时间: 2013-04-24
上传用户:asasasas
英飞凌科技股份公司近日推出适用于汽车动力总成和底盘应用的全新AUDO MAX系列32位微控制器。AUDO MAX系列可为发动机管理系统满足欧5和欧6排放标准提供支持,使电动汽车的动力总成功能实现电气化。AUDO MAX系列的主要特性包括:高达300MHz的最大时钟频率、SENT和FlexRay™等高速接口以及利用PRO-SIL™特性为先进安全设计提供全面支持。此外,这种全新的微控制器适用于在高达170°C*的温度条件下使用。AUDO MAX系列以TriCore™处理器架构为基础,采用90纳米工艺制造。
标签: Fairchild
上传时间: 2013-05-24
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在电力现代化建设中,提高发电机发电效率是其中重要的一环,氢气作为导热性冷却介质广泛的应用于发电设备,作为冷却剂,它可以有效地提高其发电效率,但它又是一种易燃易爆气体,所以使氢气参数处于正常范围,保证发电机高效、安全正常工作就变得至关重要,因此对氢气参数进行实时监测有着重要的意义。 本论文研究和开发了基于ARM和CPLD的氢气参数监测系统,首先简要的分析了氢冷发电机系统对氢气参数进行监测的必要性以及当前电力系统氢气参数监控系统的发展情况。然后提出了一种利用无线通信手机短消息业务SMS、工控总线Modbus通信协议和RR485总线、SD卡海量存储等技术实现发电机系统多氢气参数的现场实时监测系统的设计方案。该方案以功能强大的ARM处理器作为系统的核心。采用高精度的16位AD转换芯片,并使用两种滤波算法的结合对信号进行数字滤波,满足系统对氢气参数采集精度的要求。同时系统结合CPLD技术,用于解决系统内微控器I/O口不足以及SD卡驱动的问题,本论文采用一片CPLD扩展I/O口,每一个扩展的I/O口都分配固定的地址,ARM微控器可以通过外部总线控制扩展I/O口的输出电平。SD卡(Secure Digital Memory Card)中文翻译为安全数码卡,是一种基于半导体快闪记忆器的新一代记忆设备,具有低成本,大容量的特点,系统的历史数据存储使用了SD卡作为存储介质,系统并没有直接使用ARM处理器读写SD卡,而是使用了拥有1270个逻辑单元的MAXⅡ1270 CPLD来驱动SD卡,在CPLD中使用VHDL语言设计了SD卡的总线协议,外部总线接口,SRAM的读写时序等,这样既可以提高微处理器SD卡的读写速度,增强微处理器程序的移植性,又可以简化微处理器读写SD卡的步骤并减少微处理器的负担。 本论文的无线数据传输采用GSM无线通信技术的SMS业务远传现场数据,设计了GSM模块的软件硬件,实现了报警等数据的无线传输,系统的有线传输采用了基于Modbus通信协议的RS485总线通信方式,采用这两种通信方式使系统的通信更加灵活、可靠。本论文最后分析了系统的不足并且提出了具体的改进方向。
上传时间: 2013-05-26
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