The ElectricTM VLSI Design System is an open-source Electronic Design Automation (EDA) system that can handle many forms of circuit design, including: * Custom IC layout * Schematic Capture (digital and analog) * Textual Languages such as VHDL and Verilog
标签： Design open-source ElectricTM Automation
上传时间： 2013-12-18
上传用户：daguda
verilog语言实现的数字钟，各种定时闹钟功能类似真实的表~利用EDA实验平台实现~~
上传时间： 2014-06-21
上传用户：plsee
8051内核的verilog描述，对学习EDA和处理器设计很有用的资料。
上传时间： 2017-04-02
上传用户：Yukiseop
EDA 工具的使用，及Verilog和VHDL语句讲解！有实际例子即仿真过程！
标签： EDA
上传时间： 2013-12-12
上传用户：日光微澜
青岛科技大学eda实验用书，提供学生实验参考和使用，进行对应的Verilog语言编写野仿真实现等
上传时间： 2016-10-31
上传用户：17864212147
在掌握常用数字电路功能和原理的基础上，根据EDA技术课程所学知识，利用硬件描述语言Verilog HDL、EDA软件Quartus II和硬件平台Cyclone/Cyclone II FPGA进行电路系统的设计。本次实验我完成的内容是简单计算器的设计
上传时间： 2016-12-04
上传用户：925912853
Verilog HDl语言实现CPLD-EPC240与电脑的串口通讯QUARTUS逻辑工程源码 //本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在//PC机上安装一个串口调试工具来验证程序的功能。//程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控//制器，10个bit是1位起始位，8个数据位，1个结束//位。串口的波特律由程序中定义的div_par参数决定，更改该参数可以实//现相应的波特率。程序当前设定的div_par 的值是0x145，对应的波特率是//9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间//划分为8个时隙以使通信同步.//程序的工作过程是：串口处于全双工工作状态，按动key1，FPGA/CPLD向PC发送“21 EDA"//字符串（串口调试工具设成按ASCII码接受方式）；PC可随时向FPGA/CPLD发送0-F的十六进制
标签： verilog hdl cpld 串口通讯 quartus
上传时间： 2022-02-18
上传用户：nicholas28
《集成电路设计制造中EDA工具实用教程》共17章，分为三个部分。第一部分介绍半导体工艺和半导体器件仿真工具，分别介绍了Synopsys公司的TSUPREM4/MEDICI，ISE TCAD和Silvaco公司的Athena/Atlas等TCAD工具及其使用，并以ESD静电放电防护器件的设计及验证为实例介绍这些软件工具的应用。第二部分介绍了模拟集成电路设计工具的应用，辅以典型模拟IC电路的设计实例，以Cadence设计流程中的工具为主，同时也介绍了业界常用的Synopsys的Hspice电路仿真工具和Mentor Graphics的Calibre版图验证工具。第三部分为数字集成电路的设计工具使用教程，分别介绍了用Matlab进行系统级验证、用ModelSim和NC-Verilog进行HDL描述和仿真、用Xilinx ISE进行EPGA验证设计、用Synopsys的Design Compiler工具进行逻辑综合以及使用Cadence的SE和SOC Encounter进行IC后端设计等。最后介绍了可测性设计的基本概念和流程。
上传时间： 2022-07-16
上传用户：zhaiyawei
《数字系统EDA设计基础》
上传时间： 2013-07-27
上传用户：eeworm
Electronics Workbench使用指南与电子电工技术EDA实验
标签： Electronics Workbench EDA 使用指南
上传时间： 2013-06-15
上传用户：eeworm
