文章分析了雷达高速宽带数字接收与恢复的现状,以及制约其发展的关键因素,提出基于高速串行器/解串器、FPGA和正交数字上变频器的高速宽带数字接收与恢复系统方案。系统以光纤为传输媒介,以FPGA为控制核心,正交调试器为信号调制平台,完成高速数字接收、基带信号预处理与基带信号的上变频等功能。该系统具有误码率低、可靠性高的优点。
上传时间: 2014-12-28
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针对实时型相机对系统小型化、通用化及数据高速率可靠传输的需求,文中在研究高速串行器/解串器(SerDes)器件TLK2711工作原理的基础上,提出了高速串行全双工通信协议总体设计方案。文章以TLK2711为物理层、FPGA为链路层设计了高速串行全双工通信协议,对协议的实现进行了详细的描述。协议的在定制中力求做到了最简化,为上层用户提供简单的数据接口。试验中通过两块电路板的联调,完成了数据率为2.5Gbps的点对点高速传输,采用发送伪随机码测试,系统工作2小时,所测误码率小于10-12。
上传时间: 2014-12-28
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OFDM是无人机高速遥测信道中的主要传输技术之一,但是OFDM系统的主要缺陷之一是具有较高的峰均比。文中研究了一种信道纠错编码与迭代限幅滤波算法(Repeated Clipping and Filtering,RCF)相结合的峰均比抑制方案。仿真结果表明,RCF算法能够实现峰均比的有效抑制,卷积编码和Turbo编码能够有效抑制RCF算法产生的限幅噪声,降低系统误码率。
上传时间: 2013-10-09
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为了提高CPU模块之间的点对点通信速率,通过对以太网控制器MAC的研究,设计出一种点对点高速通信控制器。该控制器是基于媒体无关接口MII和以太网收发器的点对点高速通信控制器。利用VHDL语言编写该控制器的相关代码,使用MAXPLUSⅡ对该控制器的数据发送和数据接收进行仿真,并在实验室样机上进行实现。仿真结果和实验结果表明这种点对点高速通信控制器的设计方法是可行的。
上传时间: 2013-11-09
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本书既可供学生使用也可供专业人员使用。对于高速联网领域感兴趣的专业人员可将本书作为基础参考书用于自修。作为教材,本书适于高年级本科生和研究生使用。书中讨论了许多高深的论题,同时也对需要涉及的基本论题进行了简要讨论。在第1部分、第2部分之后的各部分是相互独立的。如果将本书作为一门较简短课程的教材,可以少选几个部分。而各部分之间的教学次序则可以随意安排。
上传时间: 2013-11-23
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美信公司的高速互连 (第9版本) 资料,主要内容有: 3mm x 3mm串行器支持微型安全摄像机设计 .2吉比特、多端口、LVDS交叉点开关,有效降低系统成本 ...318位、智能型双向LVDS SerDes,无需CAN或LIN接口 .....4带有LVDS系统接口的GMSL SerDes,电路板尺寸缩减50% ....5GMSL SerDes提供完备的数字视频、音频和控制数据支持 6利用HDCP GMSL SerDes实现安全的数据传输 ....7降低汽车导航系统的EMI和成本 ....821位、直流平衡LVDS解串器,可编程扩频 .....9选型指南 ....10
上传时间: 2014-12-05
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采用Xilinx 公司Virtex- II Pro 系列FPGA 内嵌得SERDES 模块———RocketIO 作为高速串行协议的物理层, 利用其8B/10B的编解码和串化、解串功能, 实现了两板间基于数据帧的简单高速串行传输, 并在ISE 环境中对整个协议进行了仿真, 当系统频率为100MHz, 串行速率在2Gbps 时, 在验证板上用chipscope 抓取的数据表明能够实现两板间数据的高速无误串行传输。关键词: RocketIO;高速串行传输;SERDES;协议
上传时间: 2013-10-21
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高速铁路振动荷载的模拟研究
上传时间: 2013-11-21
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介绍了一种基于多DSP的并行处理系统设计与实现,以及其在分布式雷达组网航迹融合中的实际应用。重点介绍了该系统由1块系统主板和4块TS201处理板卡组成的原理和结构,即系统内主板与处理板卡的板级并行设计、单块板卡多DSP并行结构的设计、板级间,单块板卡内传输通道的设计。通过具体应用说明,该多DSP并行处理系统充分体现了航迹融合的实时、高速特性,作为硬件处理平台具备高速、通用的特点。
上传时间: 2014-09-01
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为满足能谱分析中多道脉冲幅度分析器A/D转换的要求,设计了一种高速脉冲峰值保持电路。以高速电压比较器LM311、采样/保持芯片LF398作为主要器件,具有幅度判别、波形采样、峰值保持、电荷泄放等功能,结构简单,易于调试。实验表明:对于高速脉冲信号,该电路可以较好地甄别峰值并保持,性能可靠,响应速度快,误差小于1%。
上传时间: 2013-11-17
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