赛灵思推出业界首款自动化精细粒度时钟门控解决方案，该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计，既无需在设计流程中添加更多新的工具或步骤，又不会改变现有逻辑或时钟，从而避免设计修改。此外，在大多数情况下，该解决方案都能保留时序结果。
上传时间： 2013-11-16
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提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。
上传时间： 2014-12-28
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目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构，从而使全局时钟到达芯片内部的所有可配置单元(CLB)、I/O单元 (IOB)和选择性块RAM(Block Select RAM)的时延和抖动都为最小。为了适应复杂设计的需要，Xilinx的FPGA中集成的专用时钟资源与数字延迟锁相环(DLL)的数目不断增加，最新的 Virtex II器件最多可以提供16个全局时钟输入端口和8个数字时钟管理模块(DCM)。与全局时钟资源相关的原语常用的与全局时钟资源相关的Xilinx器件原语包括：IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等，如图1所示。
上传时间： 2014-01-01
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给出了一个基于TMS320DM6437 DSP的嵌入式网络实现方案，对该DSP的网络控制模块和NDK进行了深入的研究与分析，实现了NDK在不同外设的移植，并以SEED-DEC6437与PC之间网络通信为例，介绍了PC端Winsock与DSP的NDK开发流程。实验结果表明，使用移植过的NDK进行开发，可以有效地提高开发速度，减少开发时间。
上传时间： 2013-11-11
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针对TI的TMS320C6000系列DSP芯片网络系统进行设计，对比OSI模型阐述了NDK的TCP/IP模型，并给出了网络硬件接口设计。根据NDK结构模型，设计网络软件编程。对从事DSP网络设计的人员有一定指导作用。
上传时间： 2014-01-13
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介绍了基于以太网的加载方法, 包括网络接口控制HPI接口控制,该技术灵活方便，可脱离仿真器实现远程，大容量的程序代码加载，快速完成DSP系统的软件更新
上传时间： 2013-11-20
上传用户：taiyang250072
介绍了网络控制系统的基本概念，利用Matlab建立了一个网络控制系统仿真平台，实现了对网络控制系统的实时仿真，并重点对控制器的算法进行了研究，给出了模糊PID控制器与PID控制器的仿真结果对比。结果证明，模糊PID可以很好地应用于网络控制。
上传时间： 2013-10-20
上传用户：langliuer
设计了一种基于网络接口技术的风光互补控制器系统 通过网络接口协议转换器实现转换为进而实现接入
上传时间： 2014-12-28
上传用户：zaocan888
针对目前现有的无线通信铁鞋系统在使用过程中出现的问题，提出一种新型的智能铁鞋设计方案。该系统的拓扑结构由协调器和采集器节点构成，利用ZigBee无线传感器网络实现节点间的互联组网，采用CC2531作为协调器节点的核心控制芯片，CC2530作为采集器的核心控制芯片。此外，采用CC2591作为末端放大器，以提高发射功率，进一步增大传输距离(由传统的75 m提高到1 km以上)。最后，利用VC++和SQL Server 2005实现了控制室铁鞋检测控制系统上位机的设计。实践表明，该系统可靠性高、传输距离远，能满足现场需求。
上传时间： 2013-10-14
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针对目标识别问题，采取了基于协同学的模式识别理论，引入了协同神经网络并对其稳定性进行了分析，提出了基于协同神经网络对军事目标进行识别的方法，并通过仿真验证了该方法的有效性。
上传时间： 2013-11-02
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