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有源<b>晶振</b>

  • 文件是I2C总线读写测试程序;将跳线器JP6短接

    文件是I2C总线读写测试程序;将跳线器JP6短接,使用外部22.1184MHz晶振. * 功能:定义 0 ~ 9 键为数字键, A ~ F 为功能键。按 A 键后,可按0 ~ 9 数字键, * 从零地址开始存储该键值,并送LED数码管上显示该键值。按 B 键后,从零地 * 址开始读取数据值,并送LED数码管上显示。读取速度每秒一次。按 C 键后, * 停止任何操作。

    标签: I2C JP6 总线 读写

    上传时间: 2016-06-13

    上传用户:tedo811

  • 本文件是LCD测试程序

    本文件是LCD测试程序,功能:开机显示"铭朗科技,WWW.MLARM.COM"信息,为待机界面。 * 定义 A ~ F 为功能键。按"A"显示画点图形,按"B"显示画直线图形,按"C"显示画矩型图形, * 按"D"显示画矩型图形,按"E"显示画圆形图形, "F"显示待机界面.将跳线器JP8短接,R44闲置。 * 使用外部22.1184MHz晶振.

    标签: LCD 测试程序

    上传时间: 2016-06-13

    上传用户:nanxia

  • EDA实验--UART串口实验:UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位

    EDA实验--UART串口实验:UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位,次序遵循1位起始位、8位数据位(假定数据位为8位)、1位校验位(可选)、1位停止位。 UART 接收器 --- 串行数据帧和接收时钟是异步的,发送来的数据由逻辑1 变为逻辑0 可以视为一个数据帧的开始。接收器先要捕捉起始位,确定rxd 输入由1 到0,逻辑0 要8 个CLK16 时钟周期,才是正常的起始位,然后在每隔16 个CLK16 时钟周期采样接收数据,移位输入接收移位寄存器rsr,最后输出数据dout。还要输出一个数据接收标志信号标志数据接收完。 波特率发生器 --- UART 的接收和发送是按照相同的波特率进行收发的。波特率发生器产生的时钟频率不是波特率时钟频率,而是波特率时钟频率的16 倍,目的是为在接收时进行精确地采样,以提出异步的串行数据。 --- 根据给定的晶振时钟和要求的波特率算出波特率分频数。

    标签: UART EDA CLK 实验

    上传时间: 2014-01-25

    上传用户:xsnjzljj

  • 这是msp430f449单片机系统时钟源控制和选择的控制方式源代码

    这是msp430f449单片机系统时钟源控制和选择的控制方式源代码,可以选择片外高速晶振,片外标准时钟晶振,片内RC振荡器三个时钟源

    标签: 430f f449 msp 430

    上传时间: 2016-08-09

    上传用户:lht618

  • 1

    1,原创 cyclone 2开发板,希望能对FPGA电子爱好者有一点设计帮助。 2,本PCB可以与开发者自己的PCB实现扩展。 3,注意接口已经提供5v,-5v,+3.3v,+1.2v输出。 4,带一个LED显示器,多路拨动开关,一个复位健。 5,晶振源兼容5种封装,其中一种是支持9v、5W高精度恒温晶振。 6,fpga内部2个PLL相互连接可以实现0-200MHz内任意频率输出。

    标签:

    上传时间: 2013-11-27

    上传用户:wang0123456789

  • 数字音乐盒 (1) 硬件电路中用P1.0~P1.7控制按键

    数字音乐盒 (1) 硬件电路中用P1.0~P1.7控制按键,其中P1.0~P1.3扫描行,P1.4~P1.7扫描列。 (2) 用P0.0~P0.7,P2.0~P2.7控制LED,其中P0.0~P0.7控制七段码a,b,c,d,e,f,g,用P2.0~P2.7为数码管位选信号。 (3) 用,P2.0~P2.2作为LCD的RS,R/W,E的控制信号。用P0.0~P0.7作为LCD的D0~D7的控制信号。 (4) 用P3.7口控制蜂鸣器(J2,J4断开,J3短接)。 (5) 电路为12MHZ晶振频率工作,起振电路中C1,C2均为30pf。

    标签: 1.0 1.7 数字 控制

    上传时间: 2016-12-03

    上传用户:ruixue198909

  • 项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号

    项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号,因此硅微谐振式加速度计数据采集电路完成的主要任务是测出两路频率信号的差值。测量要求是:实现10ms内对中心谐振频率为20kHz、标度因数为100Hz/g、量程为±50g、分辨率为1mg的硅微谐振式加速度计输出的频率信号的测量,等效测量误差为±1mg。电路的控制核心为单片机,具有串行接口以便将测量结果传送给PC机从而分析、保存测量结果。 按研究内容设计了软硬件。软件采用多周期同步法实现高精度,快速度的频率测量方案,并使用CPLD编程实现,这也是最难的地方。硬件采用现在流行的3.3V供电系统,选用EPM240T100C5N和较为实用的AVR单片机芯片Atmega64L,对应3.3V供电系统,串行接口使用MAX3232。 最后完成了PCB板的制作,经反复调试后得到了非常好的效果。采集的数据满足项目研究内容中的要求,当提高有源晶振的频率时,精度有大大提高了,此时已远远满足了项目中高精度,快速度测量的要求。另外,采用MFC编程编写了上位机的数据接收和数据处理专用软件,集数据采集,运算,作图,保存功能于一体。 此为CPLD语言部分

    标签: 硅微 加速度计 谐振式 项目

    上传时间: 2013-12-09

    上传用户:奇奇奔奔

  • 项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号

    项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号,因此硅微谐振式加速度计数据采集电路完成的主要任务是测出两路频率信号的差值。测量要求是:实现10ms内对中心谐振频率为20kHz、标度因数为100Hz/g、量程为±50g、分辨率为1mg的硅微谐振式加速度计输出的频率信号的测量,等效测量误差为±1mg。电路的控制核心为单片机,具有串行接口以便将测量结果传送给PC机从而分析、保存测量结果。 按研究内容设计了软硬件。软件采用多周期同步法实现高精度,快速度的频率测量方案,并使用CPLD编程实现,这也是最难的地方。硬件采用现在流行的3.3V供电系统,选用EPM240T100C5N和较为实用的AVR单片机芯片Atmega64L,对应3.3V供电系统,串行接口使用MAX3232。 最后完成了PCB板的制作,经反复调试后得到了非常好的效果。采集的数据满足项目研究内容中的要求,当提高有源晶振的频率时,精度有大大提高了,此时已远远满足了项目中高精度,快速度测量的要求。另外,采用MFC编程编写了上位机的数据接收和数据处理专用软件,集数据采集,运算,作图,保存功能于一体。 此为上位机程序部分

    标签: 硅微 加速度计 谐振式 项目

    上传时间: 2017-02-13

    上传用户:大三三

  • 给定两个集合A、B

    给定两个集合A、B,集合内的任一元素x满足1 ≤ x ≤ 109,并且每个集合的元素个数不大于105。我们希望求出A、B之间的关系。 任 务 :给定两个集合的描述,判断它们满足下列关系的哪一种: A是B的一个真子集,输出“A is a proper subset of B” B是A的一个真子集,输出“B is a proper subset of A” A和B是同一个集合,输出“A equals B” A和B的交集为空,输出“A and B are disjoint” 上述情况都不是,输出“I m confused!”

    标签:

    上传时间: 2017-03-15

    上传用户:yulg

  • dsp anc fxlms

    介绍了基于 0# 公司提供的 1)’ 芯片 0")/-.2$34.- 的自适应有源噪声控制(56789: ;<8=: 6<;7><?,,@$)系统,给出了系统的工作原理及其硬件结构,并详细说明了基于平均的 *+,*, (*8?7:>:A B C ,A5D789: *8?7:>8;E F87G ,9:>5E8;E)算法,给出了程序流程图和实验结果。通过实验证 明,该系统有较好的降噪效果

    标签: fxlms dsp anc

    上传时间: 2017-12-05

    上传用户:xiaoding