接地技术220问 回答了各方面的问题 等等 （我发了好几遍，但愿这遍能发上去，你们这个系统也太复杂了吧）
上传时间： 2013-06-19
上传用户：sardinescn
宽带无线通信的持续高速的需求增长刺激了新的通信技术的不断产生，而这些技术的发展，很大程度上都来自于不同技术的互相补充与融合，这也成为新标准的源泉。正交频分复用(OFDM)技术在提供高效的频谱利用率以及良好的抗多径性能的同时，通过多输入输出(MIMO)技术来进一步增加信道容量，在不增加信号带宽的基础上取得更高的传输速率和更好的传输质量。因此MIMO-OFDM技术近年来在成为研究热点的同时，已被认为是下一带移动通信和网络接入标准中的核心技术。 本文主要对MIMO-OFDM系统物理层的关键技术进行了研究，并主要对系统的同步和信道估计算法进行了深入的分析，并提出了一些改进。最后进行了MIMO-OFDM基带系统基于FPGA的物理层设计，对其中一些关键模块的设计，比如信道估计和空时译码模块进行了详细的讨论。 第一章绪论部分首先结合宽带无线通信技术发展的历史就MIMO-OFDM技术产生发展的背景进行了分析，指出了MIMO-OFDM研究与发展方向，最后总结了本文的工作目标和基本要求。 第二章主要是推导分析了MIMO-OFDM系统的基本原理，先分别从OFDM技术和MIMO技术两方面概括性的介绍了其理论以及技术特点，最后对MIMO与OFDM结合的关键技术进行了讨论。 第三章是对MIMO-OFDM同步算法的研究，主要针对基于训练序列的同步算法进行了深入讨论，关注点是训练序列的设计。针对原有的一些算法进行了总结与比较，并主要对基于频域设计的训练序列符号同步算法做出了改进。 第四章首先从基于导频的信道估计算法推导开始，关注点放在MIMO-OFDM系统下的自适应信道估计算法研究。文章将原有的一些OFDM自适应信道估计算法扩展到MIMO领域，结合基于共轭梯度的自适应算法并做出了一些改进。 第五章节是本文的硬件设计部分，文章基于一个2发2收MIMO-OFDM系统进行了基带数字处理部分的FPGA设计工作，根据设计要求实现了发送端和接收端数据处理的基本功能，为完善的和更高性能的MIMO-OFDM系统实现奠定了基础。
上传时间： 2013-06-26
上传用户：wl9454
按照公安部规定，我国从 2004 年开始换发第二代居民身份证，预计到 2008 年基本完成第二代居民身份证的换发工作。第二代身份证与第一代身份证最大的区别在于：它的内部嵌入了一枚指甲盖大小的非接触式 IC 芯片，该芯片内存储有姓名、性别等9项信息。本课题设计出一款基于 ARM 和 GPRS 技术的第二代身份证无线手持阅读器，该阅读器能读出第二代身份证内 IC 卡信息，并可通过 GPRS 网络将信息进行无线传输。 本文以该阅读器的设计为主线，论述的主要内容如下： 1．介绍了课题背景及意义。全国 9 亿第二代身份证的换发，必然带来各行业对阅读器的大量需求，而现有阅读器的弊端促使了对阅读器做更深入的研究。 2．介绍了相关概念及技术，包括：无线射频识别技术、ISO/IEC14443 协议、嵌入式系统、ARM、GPRS技术等。 3．详细介绍了该阅读器的硬件设计方法，并给出主要硬件模块电路原理图及其 PCB 板设计方法，同时也简单介绍了硬件的焊接和调试过程。 4．详细介绍了该阅读器的软件设计方法，包括：读卡模块驱动程序、GPRS 模块驱动程序、人机对话模块驱动程序、I/O 口驱动程序的流程图和部分代码。 5．为使该阅读器安全可靠地运行，对阅读器进行了各种功能测试，包括：读卡功能、GPRS 数据传输功能、人机接口功能。 通过功能测试，该阅读器能准确读取第二代身份证内信息并通过GPRS 网络成功将信息发送出去。该阅读器与市面上现有的阅读器相比，具有可脱机操作、无线传输、小巧灵便的优点。由于该阅读器软件采用模块化的设计方法，可以方便移植到其他非接触卡阅读器中，因此本阅读器具有非常广泛的应用前景。
上传时间： 2013-06-10
上传用户：爺的气质
摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。 关键词: 时钟分相技术; 应用 中图分类号: TN 79 文献标识码:A 文章编号: 025820934 (2000) 0620437203 时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的 性能。尤其现代电子系统对性能的越来越高的要求, 迫使我们集中更多的注意力在更高频率、 更高精度的时钟设计上面。但随着系统时钟频率的升高。我们的系统设计将面临一系列的问 题。 1) 时钟的快速电平切换将给电路带来的串扰(Crosstalk) 和其他的噪声。 2) 高速的时钟对电路板的设计提出了更高的要求: 我们应引入传输线(T ransm ission L ine) 模型, 并在信号的匹配上有更多的考虑。 3) 在系统时钟高于100MHz 的情况下, 应使用高速芯片来达到所需的速度, 如ECL 芯 片, 但这种芯片一般功耗很大, 再加上匹配电阻增加的功耗, 使整个系统所需要的电流增大, 发 热量增多, 对系统的稳定性和集成度有不利的影响。 4) 高频时钟相应的电磁辐射(EM I) 比较严重。 所以在高速数字系统设计中对高频时钟信号的处理应格外慎重, 尽量减少电路中高频信 号的成分, 这里介绍一种很好的解决方法, 即利用时钟分相技术, 以低频的时钟实现高频的处 理。 1 时钟分相技术 我们知道, 时钟信号的一个周期按相位来分, 可以分为360°。所谓时钟分相技术, 就是把 时钟周期的多个相位都加以利用, 以达到更高的时间分辨。在通常的设计中, 我们只用到时钟 的上升沿(0 相位) , 如果把时钟的下降沿(180°相位) 也加以利用, 系统的时间分辨能力就可以 提高一倍(如图1a 所示)。同理, 将时钟分为4 个相位(0°、90°、180°和270°) , 系统的时间分辨就 可以提高为原来的4 倍(如图1b 所示)。 以前也有人尝试过用专门的延迟线或逻辑门延时来达到时钟分相的目的。用这种方法产生的相位差不够准确, 而且引起的时间偏移(Skew ) 和抖动 (J itters) 比较大, 无法实现高精度的时间分辨。 近年来半导体技术的发展, 使高质量的分相功能在一 片芯片内实现成为可能, 如AMCC 公司的S4405, CY2 PRESS 公司的CY9901 和CY9911, 都是性能优异的时钟 芯片。这些芯片的出现, 大大促进了时钟分相技术在实际电 路中的应用。我们在这方面作了一些尝试性的工作: 要获得 良好的时间性能, 必须确保分相时钟的Skew 和J itters 都 比较小。因此在我们的设计中, 通常用一个低频、高精度的 晶体作为时钟源, 将这个低频时钟通过一个锁相环(PLL ) , 获得一个较高频率的、比较纯净的时钟, 对这个时钟进行分相, 就可获得高稳定、低抖动的分 相时钟。 这部分电路在实际运用中获得了很好的效果。下面以应用的实例加以说明。2 应用实例 2. 1 应用在接入网中 在通讯系统中, 由于要减少传输 上的硬件开销, 一般以串行模式传输 图3 时钟分为4 个相位 数据, 与其同步的时钟信号并不传输。 但本地接收到数据时, 为了准确地获取 数据, 必须得到数据时钟, 即要获取与数 据同步的时钟信号。在接入网中, 数据传 输的结构如图2 所示。 数据以68MBös 的速率传输, 即每 个bit 占有14. 7ns 的宽度, 在每个数据 帧的开头有一个用于同步检测的头部信息。我们要找到与它同步性好的时钟信号, 一般时间 分辨应该达到1ö4 的时钟周期。即14. 7ö 4≈ 3. 7ns, 这就是说, 系统时钟频率应在300MHz 以 上, 在这种频率下, 我们必须使用ECL inp s 芯片(ECL inp s 是ECL 芯片系列中速度最快的, 其 典型门延迟为340p s) , 如前所述, 这样对整个系统设计带来很多的困扰。 我们在这里使用锁相环和时钟分相技术, 将一个16MHz 晶振作为时钟源, 经过锁相环 89429 升频得到68MHz 的时钟, 再经过分相芯片AMCCS4405 分成4 个相位, 如图3 所示。 我们只要从4 个相位的68MHz 时钟中选择出与数据同步性最好的一个。选择的依据是: 在每个数据帧的头部(HEAD) 都有一个8bit 的KWD (KeyWord) (如图1 所示) , 我们分别用 这4 个相位的时钟去锁存数据, 如果经某个时钟锁存后的数据在这个指定位置最先检测出这 个KWD, 就认为下一相位的时钟与数据的同步性最好(相关)。 根据这个判别原理, 我们设计了图4 所示的时钟分相选择电路。 在板上通过锁相环89429 和分相芯片S4405 获得我们所要的68MHz 4 相时钟: 用这4 个 时钟分别将输入数据进行移位, 将移位的数据与KWD 作比较, 若至少有7bit 符合, 则认为检 出了KWD。将4 路相关器的结果经过优先判选控制逻辑, 即可输出同步性最好的时钟。这里, 我们运用AMCC 公司生产的 S4405 芯片, 对68MHz 的时钟进行了4 分 相, 成功地实现了同步时钟的获取, 这部分 电路目前已实际地应用在某通讯系统的接 入网中。 2. 2 高速数据采集系统中的应用 高速、高精度的模拟- 数字变换 (ADC) 一直是高速数据采集系统的关键部 分。高速的ADC 价格昂贵, 而且系统设计 难度很高。以前就有人考虑使用多个低速 图5 分相技术应用于采集系统 ADC 和时钟分相, 用以替代高速的ADC, 但由 于时钟分相电路产生的相位不准确, 时钟的 J itters 和Skew 比较大(如前述) , 容易产生较 大的孔径晃动(Aperture J itters) , 无法达到很 好的时间分辨。 现在使用时钟分相芯片, 我们可以把分相 技术应用在高速数据采集系统中: 以4 分相后 图6 分相技术提高系统的数据采集率 的80MHz 采样时钟分别作为ADC 的 转换时钟, 对模拟信号进行采样, 如图5 所示。 在每一采集通道中, 输入信号经过 缓冲、调理, 送入ADC 进行模数转换, 采集到的数据写入存储器(M EM )。各个 采集通道采集的是同一信号, 不过采样 点依次相差90°相位。通过存储器中的数 据重组, 可以使系统时钟为80MHz 的采 集系统达到320MHz 数据采集率(如图6 所示)。 3 总结 灵活地运用时钟分相技术, 可以有效地用低频时钟实现相当于高频时钟的时间性能, 并 避免了高速数字电路设计中一些问题, 降低了系统设计的难度。
上传时间： 2013-12-17
上传用户：xg262122
微机接口技术试题：《微机接口技术》模拟试题 一、 选择题：（每空1分，共20分）1． CPU与外设之间交换数据常采用 、 、 和 四种方式，PC机键盘接口采用 传送方式。 ⒉ 当进行DMA方式下的写操作时，数据是从 传送到 __中。 ⒊ PC总线、ISA总线和EISA总线的地址线分别为： 、 和 根。 ⒋ 8254定时/计数器内部有 个端口、共有 种工作方式。 ⒌8255的A1和A0引脚分别连接在地址总线的A1和A0，当命令端口的口地址为317H时，则A口、B口、C口的口地址分别为 、 、 。 ⒍ PC微机中最大的中断号是 、最小的中断号是 。 ⒎PC微机中键盘是从8255的 口得到按键数据。 ⒏ 串行通信中传输线上即传输_________，又传输_________。 二、选择题：（每题2分，共10分）⒈ 设串行异步通信每帧数据格式有8个数据位、无校验、一个停止位，若波特率为9600B/S，该方式每秒最多能传送（ ）个字符。 ① 1200 ② 150 ③ 960 ④ 120 2．输出指令在I/O接口总线上产生正确的命令顺序是（ ）。① 先发地址码，再发读命令，最后读数据。② 先发读命令、再发地址码，最后读数据。③ 先送地址码，再送数据，最后发写命令。④ 先送地址码，再发写命令、最后送数据。3 使用8254设计定时器，当输入频率为1MHZ并输出频率为100HZ时，该定时器的计数初值为（ ）。 ① 100 ② 1000 ③ 10000 ④ 其它 4 在PC机中5号中断，它的中断向地址是（ ）。 ① 0000H：0005H ② 0000H：0010H ③ 0000H：0014H ④ 0000H：0020H 5． 四片8259级联时可提供的中断请求总数为（ ）。 ① 29个 ② 30个 ③ 31个 ④ 32个 6． 下述总线中，组内都是外设串行总线为（ ）组。① RS-485、IDE、ISA。② RS-485、IEEE1394、USB。③ RS-485、PCI、IEEE1394。④ USB、SCSI、RS-232。 7. DMA在（ ）接管总线的控制权。① 申请阶段 ② 响应阶段 ③ 数据传送阶段 ④ 结束阶段 8. 中断服务程序入口地址是（ ）。 ① 中断向量表的指针 ② 中断向量 ③ 中断向量表 ④ 中断号
上传时间： 2013-11-16
上传用户：xiaoxiang
提供一个快递行业在线发件系统，带后台数据库，有技术问题请加QQ821964
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上传时间： 2013-12-23
上传用户：qw12
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上传时间： 2013-12-10
上传用户：lanhuaying
本文给出了对蜜罐及蜜网技术的综述报告，包括蜜罐和蜜网的基本概念、发 展历程、核心功能，并介绍了目前最为成熟的“蜜网项目组”推出的第二代蜜网 架构。此外本文还给出了蜜罐及蜜网技术的进一步研究方向。
上传时间： 2015-08-26
上传用户：thesk123
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标签： CppBuilder Delphi Java 书籍
上传时间： 2013-12-10
上传用户：ecooo
依靠强大的专业开发团队、PHILIPS 半导体的领先技术与国际 CiA 协会、ODVA 协会的支持，我们致力于发展 中国的 CAN 产品与应用事业。至现在，我们已成功开发出一系列 CAN-bus 教学、接口、工具、应用产品，能够为客 户提供从“芯片”、“工具”、“模块”、“方案”等各个方面的服务，涉及 CAN-bus 多个行业与应用领域。我们自主开 发的数个型号产品已经领先于国外技术水平，并已投入广泛的实际应用。 CAN-bus 专 用 芯 片
上传时间： 2015-12-16
上传用户：ainimao
