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卷积定理

  • 数字信号处理dsp的一些c语言源代码

    数字信号处理dsp的一些c语言源代码,实现卷积,傅里叶变换,傅里叶反变换等功能,并且能够通过图形界面显示出来

    标签: dsp 数字信号处理 c语言 源代码

    上传时间: 2013-12-25

    上传用户:xwd2010

  • 使用matlab编程

    使用matlab编程,实现FFT卷积算法,经过样机的实验,得到正确的结果,而且代码简单易懂。

    标签: matlab 编程

    上传时间: 2017-08-10

    上传用户:koulian

  • 本程序正在完善中

    本程序正在完善中,目前仅适用于(4,3,3)卷积码,请见谅

    标签: 程序

    上传时间: 2013-12-28

    上传用户:阿四AIR

  • 该工程下实现了图像的载入

    该工程下实现了图像的载入,复制粘结功能,同时还实现了图像的卷积和傅立叶变换。

    标签: 工程 图像

    上传时间: 2014-12-04

    上传用户:czl10052678

  • 编写一个MATLAB函数

    编写一个MATLAB函数,实现快速卷积算法,给出一个实例。用一个N点离散傅立叶变换同时计算两个N点实序列的离散傅立叶变换。

    标签: MATLAB 编写 函数

    上传时间: 2013-12-26

    上传用户:q123321

  • matlab-均值滤波.中值滤波

    I=imread('fig1.jpg');%从D盘名为myimages的文件夹中读取。格式为jpg的图像文件chost J=imnoise(I,'salt & pepper',0.02);%给图像加入均值为0,方差为0.02的淑盐噪声 subplot(2,4,1); imshow(I); title('原始图像'); subplot(2,4,2); imshow(J); title('加入椒盐噪声之后的图像'); %h=ones(3,3)/9; %产生3 × 3的全1数组 %B=conv2(J,h); %卷积运算 %采用MATLAB中的函数对噪声干扰的图像进行滤波 Q=wiener2(J,[3 3]); %对加噪图像进行二维自适应维纳滤波 P=filter2(fspecial('average',3),J)/255; %均值滤波模板尺寸为3 K1=medfilt2(J,[3 3]); %进行3 × 3模板的中值滤波 K2= medfilt2(J,[5 5]); %进行5 × 5模板的中值滤波 K3= medfilt2(J,[7 7]); %进行7 × 7模板的中值滤波 K4= medfilt2(J,[9 9]); %进行9 × 9模板的中值滤波 %显示滤波后的图像及标题 subplot(2,4,3); imshow(Q); title('3 × 3模板维纳滤波后的图像'); subplot(2,4,4); imshow(P); title('3 × 3模板均值滤波后的图像'); subplot(2,4,5); imshow(K1); title('3 × 3模板的中值滤波的图像'); subplot(2,4,6); imshow(K2); title('5 × 5模板的中值滤波的图像'); subplot(2,4, 7); imshow(K3); title('7 × 7模板的中值滤波的图像'); subplot(2,4,8); imshow(K4); title('9 × 9模板的中值滤波的图像');

    标签: matlab 均值滤波 中值滤波

    上传时间: 2016-06-02

    上传用户:wxcr_1

  • 基于FPGA的viterbi设计及Verilog代码

    viterbi译码算法是一种卷积码的解码算法。优点不说了。缺点就是随着约束长度的增加算法的复杂度增加很快。约束长度N为7时要比较的路径就有64条,为8时路径变为128条。 (2<<(N-1))。所以viterbi译码一般应用在约束长度小于10的场合中。 先说编码(举例约束长度为7):编码器7个延迟器的状态(0,1)组成了整个编码器的64个状态。每个状态在编码器输入0或1时,会跳转到另一个之中。比如110100输入1时,变成101001(其实就是移位寄存器)。并且输出也是随之而改变的。 这样解码的过程就是逆过程。算法规定t时刻收到的数据都要进行64次比较,就是64个状态每条路有两条分支(因为输入0或1),同时,跳传到不同的两个状态中去,将两条相应的输出和实际接收到的输出比较,量度值大的抛弃(也就是比较结果相差大的),留下来的就叫做幸存路径,将幸存路径加上上一时刻幸存路径的量度然后保存,这样64条幸存路径就增加了一步。在译码结束的时候,从64条幸存路径中选出一条量度最小的,反推出这条幸存路径(叫做回溯),得出相应的译码输出。

    标签: viterbi Verilog FPGA 代码

    上传时间: 2016-08-08

    上传用户:June

  • Verilog源代码关于viterbi设计

     (n, k, N)卷积码的状态数为2k (N−1) ,对每一时刻要 做2k (N−1) 次“加-比-存”操作,每一操作包括2k 次加法和2k −1 次比较,同时要保留2k (N−1) 条幸存路径。由此可见,Viterbi 算法的复杂度与信道质量无关,其计算量和存储量都随约束 长度N 和信息元分组k 呈指数增长。因此,在约束长度和信息元分组较大时并不适用。 为了充分利用信道信息,提高卷积码译码的可靠性,可以采用软判决Viterbi 译码算法。 此时解调器不进行判决而是直接输出模拟量,或是将解调器输出波形进行多电平量化,而不 是简单的 0、1 两电平量化,然后送往译码器。即编码信道的输出是没有经过判决的“软信 息”。

    标签: Verilog viterbi 源代码

    上传时间: 2016-08-08

    上传用户:June

  • IS-95前向链路通信系统仿真

    IS-95前向链路MATLAB仿真,具体内容有:卷积编码、信号加扰、块交织、正交复用、正交扩频、基带滤波、信道设计、接收发射机的设计。最后通过误码率来说明这个系统的好坏

    标签: IS 95 链路 通信系统 仿真

    上传时间: 2017-05-22

    上传用户:天晴没有眼泪

  • cnn的matlab实现

    卷积神经网络(cnn)的matlab实现

    标签: matlab cnn

    上传时间: 2019-04-28

    上传用户:与可12138