Quartus II 软件5.0在高密度FPGA设计上具有性能和效率领先优势。此版本首次展示了业内编译增强技术以及多种新的高密度设计高效特性。 Quartus II软件5.0的新特性和增强功能包括： 编译和时序逼近的增强特性 编译增强特性缩短近70％编译时间 编译增强特性使设计人员能够根据综合和适配的需要，将设计划分为物理和逻辑分区，在特定设计分区上实施物理综合等高级优化技术，保持其他模块性能不变，从而提高时序逼近效率。SignalTap? II 嵌入式逻辑分析仪也可以采用该技术加速实现验证迭代。 时
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上传时间： 2013-06-06
上传用户：dapangxie
随着微电子技术的高速发展，实时图像处理在多媒体、图像通信等领域有着越来越广泛的应用。FPGA就是硬件处理实时图像数据的理想选择，基于FPGA的图像处理专用系统的研究将成为信息产业的新热点。 本文详细介绍了一种实时监控图像处理系统的设计方案，实现了具有前端视频采集系统、图像预处理功能系统、图像显示系统。该系统采用Altera公司的FPGA芯片作为中央处理器，由视频采集模块、异步FIFO模块、视频解码模块、I
上传时间： 2013-06-20
上传用户：wc412467303
近年来，计算机图形学应用越来越广泛，尤其是三维(3D)绘图。3D绘图使用3D模型和各种影像处理产生具有三维空间真实感的影像，应用于虚拟真实情况以及多媒体的产品上，且多半是使用低成本的实时3D计算机绘图技术为基础。在初期3D图形学刚起步时，由于图形简单，因此可以利用CPU来运算，但随着图形学技术的发展，所要绘制的图形越来越复杂，这时如果单纯依赖CPU来处理，不能达到实时的要求，因此需要专门的硬件来加速图形处理，GPU(图形处理单元)因此出现了。不过由于3D图形加速硬件的复杂性和短寿命，这极大地提高了对硬件开发环境的需要。为了更好的对设计进行更改和测试，不能仅仅用专门定制的方法来设计，需要其他的方：硬件描述语言(HDL)和FPGA。 随着计算机绘图规模的需要，借助辅助硬件资源，来提高图形处理单元(GPU)处理速度的需求越来越普遍。自从15年前现场可编程门阵列(FPGA)开始出现以来，其在可编程硬件领域所起的作用越来越大。它们在速度、体积和速度方面都有了很大的提高。这意味着FPGA在以前只能使用专用硬件的场合越来越重要。其中一个应用领域就是3D图形渲染，在这个研究领域里人们正在利用具有可编程性能的FPGA来帮助改进图形处理单元(GPU)的性能。 能够在廉价、可动态重新配置的FPGA上实现复杂算法来辅助硬件设计。本文的设计就是通过在FPGA上实现3维图形几何处理管线部分功能来提高图形处理速度。具体实现中使用硬件描述语言(Verilog HDL)进行逻辑设计，并发现问题解决问题。 本文主要特色如下： 1.针对几何变换换子系统，提出一种硬件实现方案，该方案能对基本的几何变换如：平移、缩放、旋转和投影进行操作。首先构造出总体变换矩阵，随后进行矩阵乘法运算，再进行投影变换，最后输出变换座标。提出一种脉动阵列结构，用于两个矩阵的乘法运算。找到一种快捷的方法来实现矩阵相乘，将能大大提高系统的效率。 2.对于3D图形裁剪，文中描述了一种裁剪引擎，它能够处理3D图形中的裁剪、透视除法以及视口映射的功能。硬件实现的难度取决于裁剪算法的复杂程度。我们在Sutherland-Hodgman裁剪算法的基础上提出一种新的裁剪算法，该算法通过去除冗余顶点以提高处理速度，同时利用编码来判断线段可见性的方法使得硬件实现变得很容易。 3.最后，我们在FPGA上实现了几何变换以及三维裁剪，并与C语言的模拟结果对比发现结果正确，且三维裁剪能够以3M个三角形/s的速度运行，满足了图形流水中的实时性要求。
上传时间： 2013-04-24
上传用户：yerik
纹理映射在计算机图形计算中属于光栅化阶段，处理的是像素，主要的特点是数据的吞吐量大，对实时系统来说转换的速度是一个关键的因素，人们寻求各种加速算法来提高运算速度。传统的方法是用更快的处理器，并行算法或专用硬件。随着数字技术的发展，尤其是可编程逻辑门阵列(FPGAs)的发展，提供了一种新的加速方法。FPGAs在密度和性能上都有突破性的发展，当前的FPGA芯片已经能够运算各种图形算法，而在速度上与专用的图形卡硬件相同。因此，FPGA芯片非常适合这项工作。 本文主要工作包括以下几个方面： 1、本文提出了一种MIPmapping纹理映射优化方法，改进了MIPmapping映射细化层次算法及纹理图像的存储方式，减少纹理寻址的计算量，提高纹理存储的相关性。详细内容请阅读第三章。 2、提出了一种MIPmapping纹理映射优化方法的硬件实现方案，该方案针对移动设备对功耗和面积的要求，以及分辨率不高的特点，在参数空间到纹理地址的计算中用定点数来实现。详细内容请阅读第四章。 3、实现了纹理映射流水线单元纹理地址产生电路，及纹理滤波电路的FPGA设计，并给出设计的综合和仿真结果。详细内容请阅读第五章4、实现了符合IEEE 754单精度标准的乘法、乘累加及除法运算器电路。乘法器采用改进型Booth编码电路以减少部分积数量，用Wallace对部分积进行压缩；乘累加器采用multiply-add fused算法，对关键路径进行了优化；除法器为基于改进型泰勒级数展开的查找表结构实现，查找表尺寸只有208字节，电路为固定时延，在电路尺寸、延时及复杂度方面进行了较好的平衡。
上传时间： 2013-04-24
上传用户：yxvideo
Design Compiler 2007。新版本扩展了拓扑技术，以加速采用先进低功耗和测试技术的设计收敛，帮助设计人员提高生产效率和 IC 性能。
上传时间： 2013-05-29
上传用户：yanqie
Virtuoso定制设计平台是一个全面的系统，能够加速差异化定制芯片的精确设计
上传时间： 2013-06-15
上传用户：天涯
·摘 要:本文采用Ｈ－桥驱动器，用８０３１单片机来实现步进电机的加速、减速、正反转、启动、停止及细分控制，使步进电机获得更高的性能。
上传时间： 2013-04-24
上传用户：fling_up
这本内容全面的参考指南面向需要从Protel升级到Altium新一代设计解决方案的用户，详细介绍了如何充分利用其特性开发创新的电子产品。 该书得到了 IT界的广泛支持，并有中国软件行业协会秘书长陈冲先生为其作序。 本书是Altium计划与大学及教育机构开展的一系列合作中的首个项目。Altium大学计划是Altium与中国几所顶尖大学的合资项目，出版本书则是该计划的目标之一。Altium大学计划旨在为学生提供最先进的电子设计工具和解决方案，推动一体化电子产品设计的教学，加速用户向Altium最新的电子产品设计解决方案的升级。
上传时间： 2013-10-20
上传用户：liaocs77
Altium Designer 6 三维元件库建模教程 文档名称：AD系列软件三维元件库建模教程 文档描述：介绍在 AltiumDesigner集成开发平台下三维模型建立和使用方法 文档版本：V1.0 作 者：林加添（lineay） 编写时间：2009 年1 月 QQ:181346072 第一章：介绍 在传统的电子整机设计过程中，电路设计部门和结构设计部门（或者由外部设计工作室设计）往往是被分为 两个完全独立的部门，因此在新产品开发过程中，都是结构设计好了，然后出内部 PCB 位置图给 PCB 工程师， 而结构工程师并不了解电路设计过程中一些要点。对 PCB布局一些高度较高元器件位置很多并不符合 PCB 工程 师电路设计的要求。以至 PCB 工程师不得不将就结构工程师所设计的元件布局。最后产品出来时，因为 PCB 布 局不合理等各种因素，问题百出。这不仅影响产品开发速度。也会导致企业两部门之间发生冲突。 然而目前国内大多的电子企业都是停留于这种状态，关键原因目前电路部门和结构部门没有一个有效、快捷 的软件协作接口来帮助两个部分之间更好协调工作、来有效提高工作效率。而面对竞争日益激烈的市场。时间就 是金钱，产品开发周期加长而导致开发成本加剧，也延误了产品上市的时间。这不仅降低了企业在市场的竞争力 也加速了企业倒退的步伐。对于企业来说，都希望有一个有效的协调接口来加速整机的开发速度，从而提高产品
上传时间： 2013-10-22
上传用户：moerwang
假设环形激光器的工作寿命分布规律,在大电流应力下仍符合威布尔分布。采用恒定应力加速寿命试验方法,在最短的试验时间得到一批寿命试验数据,并利用拟最优线性无偏估计方法对数据进行处理,得到环形激光器的寿命参数。
上传时间： 2013-10-24
上传用户：duoshen1989
