本实验是基于EasyFPGA030的I2C总线接口模块设计，用EasyFPGA030开发套件通过I2C协议实现对二线制I2C串行EEPROM的读写操作，先把数据写入EEPROM，然后再读取出来显示在数码管上
上传时间： 2013-10-21
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基于M CORE微控制器的嵌入式系统从应用的角度出发，全面介绍了构成嵌人式系统的微控制器的结构和常用支撑硬件的原理以及设计开发方法。本书共 24章，分为3大部分。第 1部分（第 1～14章）介绍具有 32位 RISC CPU核的M·CORE微控制器的结构及原理，按模块分章，对各功能模块的原理及使用方法都有详尽的讲解。众所周知，微控制器种类繁多，虽然不同种类微控制器的CPU及内部功能模块有所不同，但基本原理（尤其是一些通用的功能）是一致的。第2部分（第15—19章）介绍嵌入式系统常用外围电路的原理及设计和使用方法，包括有：异步串行接口的互连及应用举例、同步串行总线及应用举例、液晶显示模块、液晶控制器、触摸屏及触摸屏控制器和各类存储器的应用举例。第3部分（第20—24章）介绍嵌人式系统的开发环境与软件开发，在讨论嵌人式系统软件开发的一般过程和开发工具需求的基础上，介绍M·CORE软件开发支持工具集、MMC2107微控制器评估板、M·CORE常用工具软件、QodeWarrior集成开发环境IDE及M·CORE的基本程序设计技术。 第1部分 M·COREM控制器的结构及原理 第1章 微控制器及其应用技术概述 1．1 微控制器的特点 1．2 微控制器技术的发展 1．3 M·CORE系列微控制器 l．3．1 MMC2107的特点及组成 1．3．2 MMC2107的引脚描述 1．3．3 MMC2107的系统存储器地址映射 第2章 M·CORE M210中央处理单元（CPU） 2．1 M·CORE处理器综述 2．1．1 M·CORE处理器的微结构 2．1．2 M·CORE处理器的编程模型 2．1．3 M·CORE的数据格式 2．1．4 M·CORE处理器的寄存器 2．2 M·CORE处理器指令系统简述 2. 2．l 指令类型和寻址方式
上传时间： 2013-10-28
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MCS-51单片机的系统扩展技术:在MCS-51单片机的的内部虽已集成了很多资源，但这类单片机属于一种“通用”的单片机，单片机内部的各种资源都是折衷配置的，如片内程序存储器、数据存储器的容量都不大，并行I/O端口的数量也不很多，此外，在有些应用中，片内定时器、中断、串行口等也显得不足，还有一些功能是基本型MCS-51单片机所没有的，比如A/D转换，D/A转换等等。实际应用中的要求是各种各样的，如果用到了MCS-51单片机内部所没有资源（如A/D，D/A等），或者单片机内部虽有，但却不够使用的资源，就要根据需要，对单片机进行扩展，以增加所需要的功能。MCS-51单片机所可能需要扩展的芯片种类非常多，但这里并不面面俱到，主要是通过对外扩程序存储器、数据存储器、I/O接口、A/D和D/A的介绍，使读者熟悉单片机接口的一般方法。实际上，如果对于这些常规的扩展芯片能够熟练地掌握和应用，并能理解其扩展的原理，拿到任何一块需要扩展的芯片，只要有这块芯片的数据手册或接口时序之类的资料，就能自行设计芯片的接口电路部份。1． MCS-51单片机扩展的原理MCS-51单片机被设计成具有通用计算机那样的外部总线结构，所以用MCS-51单片机进行扩展很方便，下面首先了解片外总线的工作原理。
上传时间： 2014-04-28
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采用UART做LIN总线的从节点应用:本应用例使用SPMC75F2313A和通用LIN Bus收发器TJA1020（或ATA6661）实现LIN（Local Interconnect Network）是低成本的汽车网络的传输。1.2 LIN Bus规范LIN 是低成本网络中的汽车通讯协议标准，LIN（Local Interconnect Network）是低成本的汽车网络，它是现有多种汽车网络在功能上的补充由于能够提高质量、降低成本，LIN 将是在汽车中使用汽车分级网络的启动因素。LIN 的标准化将简化多种现存的多点解决方案且将降低在汽车电子领域中的开发生产服务和后勤成本。LIN 标准包括传输协议规范、传输媒体规范、开发工具接口规范和用于软件编程的接口LIN在硬件和软件上保证了网络节点的互操作性并有可预测EMC的功能。
上传时间： 2013-11-19
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采用UART做LIN总线的主节点应用:本应用例使用SPMC75F2313A和通用LIN Bus收发器TJA1020（或ATA6661）实现LIN（Local Interconnect Network）是低成本的汽车网络的传输。1.2 LIN Bus规范LIN 是低成本网络中的汽车通讯协议标准，LIN（Local Interconnect Network）是低成本的汽车网络，它是现有多种汽车网络在功能上的补充由于能够提高质量、降低成本，LIN 将是在汽车中使用汽车分级网络的启动因素。LIN 的标准化将简化多种现存的多点解决方案且将降低在汽车电子领域中的开发生产服务和后勤成本。LIN 标准包括传输协议规范、传输媒体规范、开发工具接口规范和用于软件编程的接口LIN在硬件和软件上保证了网络节点的互操作性并有可预测EMC的功能。
上传时间： 2013-10-15
上传用户：AISINI005
SPCE061A单片机硬件结构 从第一章中SPCE061A的结构图可以看出SPCE061A的结构比较简单，在芯片内部集成了ICE仿真电路接口、FLASH程序存储器、SRAM数据存储器、通用IO端口、定时器计数器、中断控制、CPU时钟、模-数转换器AD、DAC输出、通用异步串行输入输出接口、串行输入输出接口、低电压监测低电压复位等若干部分。各个部分之间存在着直接或间接的联系，在本章中我们将详细的介绍每个部分结构及应用。2.1 μ’nSP™的内核结构μ’nSP™的内核如0所示其结构。它由总线、算术逻辑运算单元、寄存器组、中断系统及堆栈等部分组成，右边文字为各部分简要说明。算术逻辑运算单元ALUμ’nSP™的ALU在运算能力上很有特色，它不仅能做16位基本的算术逻辑运算，也能做带移位操作的16位算术逻辑运算，同时还能做用于数字信号处理的16位×16位的乘法运算和内积运算。1． 16位算术逻辑运算不失一般性，μ’nSP™与大多数CPU类似，提供了基本的算术运算与逻辑操作指令，加、减、比较、取补、异或、或、与、测试、写入、读出等16位算术逻辑运算及数据传送操作。2． 带移位操作的16位算逻运算对图2.1稍加留意，就会发现μ’nSP™的ALU前面串接有一个移位器SHIFTER，也就是说，操作数在经过ALU的算逻操作前可先进行移位处理，然后再经ALU完成算逻运算操作。移位包括：算术右移、逻辑左移、逻辑右移、循环左移以及循环右移。所以，μ’nSP™的指令系统里专有一组复合式的‘移位算逻操作’指令；此一条指令完成移位和算术逻辑操作两项功能。程序设计者可利用这些复合式的指令，撰写更精简的程序代码，进而增加程序代码密集度 (Code Density)。在微控制器应用中，如何增加程序代码密集度是非常重要的议题；提高程序代码密集度意味着：减少程序代码的大小，进而减少ROM或FLASH的需求，以此降低系统成本与增加执行效能。
上传时间： 2013-10-10
上传用户：星仔
PIC16F84 单片机的内部硬件资源：学些PIC 单片机，在Microchip 尚未推出其他Flash 系列的情况下，很多菜鸟都是从PIC16F84 开始的，我们把它整理了一份中文资料供大家学习。首先介绍PIC16F84 单片机的内部结构，如图1 所示的框图。由图1 看出，其基本组成可分为四个主要部分，即运算器ALU 和工作寄存器W；程序存储器；数据存储器和输入/输出(I/O)口；堆栈存储器和定时器等。现分别介绍如下。
上传时间： 2013-12-26
上传用户：zgu489
介绍用PIC16F84单片机制作的电子密码锁。PIC16F84单片机共18个引脚，13个可用I/O接口。芯片内有1K×14的FLASHROM程序存储器，36×8的静态RAM的通用寄存器，64×8的EEPROM的数据存储器，8级深度的硬堆栈。 用PIC单片机设计的电子密码锁微芯公司生产的PIC8位COMS单片机，采用类RISC指令集和哈弗总线结构，以及先进的流水线时序，与传统51单片机相比其在速度和性能方面更具优越性和先进性。PIC单片机的另一个优点是片上硬件资源丰富，集成常见的EPROM、DAC、PWM以及看门狗电路。这使得硬件电路的设计更加简单，节约设计成本，提高整机性能。因此PIC单片机已成为产品开发，尤其是产品设计和研制阶段的首选控制器。本文介绍用PIC16F84单片机制作的电子密码锁。PIC16F84单片机共18个引脚，13个可用I/O接口。芯片内有1K×14的FLASHROM程序存储器，36×8的静态RAM的通用寄存器，64×8的EEPROM的数据存储器，8级深度的硬堆栈。硬件设计 电路原理见图1。Xx8位数据线接4x4键盘矩阵电路，面板布局见表1，A、B、C、D为备用功能键。RA0、RA7输出4组编码二进制数据，经74LS139译码后输出逐行扫描信号，送RB4-RB7列信号输入端。余下半个139译码器动扬声器。RB2接中功率三极管基极，驱动继电器动作。有效密码长度为4位，根据实际情况，可通过修改源程序增加密码位数。产品初始密码为3345，这是一随机数，无特殊意义，目的是为防止被套解。用户可按*号键修改密码，按#号键结束。输入密码并按#号确认之后，脚输出RB2脚输出高电平，继电器闭合，执行一次开锁动作。 若用户输入的密码正确，扬声器发出一声稍长的“滴”提示声，若输入的密码与上次修改的不符，则发出短促的“滴”声。连续3次输入密码错误之后，程序锁死，扬声器报警。直到CPU被复位或从新上电。软件设计 软件流程图见图3。CPU上电或复位之后将最近一次修改并保存到EEPROM的密码读出，最为参照密匙。然后等待用户输入开锁密码。若5分钟以内没有接受到用户的任何输入，CPU自动转入掉电模式，用户输入任意值可唤醒CPU。每次修改密码之后，CPU将新的密码存入内部4个连续的EEPROM单元，掉电后该数据任有效。每执行一次开锁指令，CPU将当前输入密码与该值比较，看是否真确，并给出相应的提示和控制。布 局 所有元件均使用SMD表贴封装，缩小体积，便于产品安装，60X60双面PCB板，顶层是一体化输入键盘，底层是元件层。成型后的产品体积小巧，能很方便的嵌入防盗铁门、保险箱柜。
上传时间： 2013-10-31
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多功能高集成外围器件6. 1 多功能高集成外围器件82371PCI的英文名称：Peripheral Component Interconnect （外围部件互联PCI总线）；82371是PCI总线组件。ISA是：Industry Standard Architecture（工业标准体系结构）IDE是 （Integrated Device Electronics）集成电路设备简称PIIX4PIIX4器件（芯片）的特点1、是一种支持Pentium和PentiumII微处理器的部件。2、82371对ISA桥来说，是一种多功能PCI总线。3、对可移动性和桌面深绿色环境均提供支持。4、电源管理逻辑。5、被集成化的IDE控制器。6、增强了性能的DMA控制器。 （7）基于两个82C59的中断控制器。（8）基于82C54芯片的定时器。（9）USB（Universal Serial Bus）通用串行总线。（10）SMBus系统管理总线。（11）实时时钟（12）顺应Microsoft Win95所需的功能其芯片的逻辑框图如图6-1所示。 PIIX4芯片逻辑框图6.1.1 概述PIIX4芯片是一个多功能的PCI器件，图6-2 是82371在系统中扮演的角色。（续上图）1. PCI与EIO之间的桥（PIIX4芯片）桥是不对程的，是各类不同标准总线与PCI总线连接，82371AB桥也可理解为一种总线转换译码器和控制器，桥内包含复杂的协议总线信号和缓冲器。(1).在PCI系统内，当PIIX4操作时，它总是作为系统内各种模块的主控设备，如USB和DMA控制器、IDE总线和分布式DMA的主控设备等，而且总是以ISA主控设备的名义出现。(2). 在向ISA总线或IDE总线进行传送操作的传送周期期间作为从属设备使用，并对内部寄存器译码。PIIX4芯片（桥）的配置(1).可以把PIIX4芯片配置成整个ISA总线，或ISA总线的子集，也可扩展成EIO总线。在使用EIO总线时，可以把未使用的信号配置成通用的输入和输出。(2).PIIX4可直接驱动5个ISA插槽；(3).能提供字节-交换逻辑、I/O的恢复支持、等待状态的生成以及SYSCLK的生成。(4).提供X-BUS键盘控制器芯片、BIOS芯片、实时时钟芯片、二级微程序器等的选择。2. IDE接口（总线主控设备的权利和同步DMA方式）IDE接口为4个IDE的设备提供支持，比如IDE接口的硬盘和CD-ROM等。注意：目前硬盘接口有5类：IDE、SCSI、Fibre Channel、IEEE1394和USB等。IDE口几乎在PC机最多，因为便宜。SCSI多用于服务器和集群机。IDE的PIO IDE速率：14MB/s；而总线主控设备IDE的速率：33MB/s在PIIX4芯片的IDE系统内，配有两个各次独立的IDE信号通道。3. 具有兼容性的模块—DMA、定时器/计数器、中断控制器等（1）在PIIX4内的两各82C37 DMA控制器经逻辑的组合，产生7个独立的可编程通道。通道[0：3]是通过与8个二进位的硬件连线实现的。通过以字节为单位的计数进行传送。而通道[5：7]是通过16个二进位的连线实现的，以字为单位的计数进行传送。（2）DMA控制器还能通过PCI总线，处理旧的DMA的两个不同的方法提供支持。（3）计数/定时器模块在功能上与82C54等价。（4）中断控制器与ISA兼容，其功能是两个82C59的功能之和。
上传时间： 2013-11-19
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PC机之间串口通信的实现一、实验目的 １．熟悉微机接口实验装置的结构和使用方法。 ２．掌握通信接口芯片8251和8250的功能和使用方法。 ３．学会串行通信程序的编制方法。 二、实验内容与要求 １．基本要求主机接收开关量输入的数据（二进制或十六进制），从键盘上按“传输”键（可自行定义），就将该数据通过8251A传输出去。终端接收后在显示器上显示数据。具体操作说明如下：（１）出现提示信息“start with R in the board!”，通过调整乒乓开关的状态，设置8位数据；（２）在小键盘上按“R”键，系统将此时乒乓开关的状态读入计算机I中，并显示出来，同时显示经串行通讯后，计算机II接收到的数据；（３）完成后，系统提示“do you want to send another data? Y/N”，根据用户需要，在键盘按下“Y”键，则重复步骤（1），进行另一数据的通讯；在键盘按除“Y”键外的任意键，将退出本程序。２．提高要求 能够进行出错处理，例如采用奇偶校验，出错重传或者采用接收方回传和发送方确认来保证发送和接收正确。 三、设计报告要求 １．设计目的和内容 ２．总体设计 ３．硬件设计：原理图（接线图）及简要说明 ４．软件设计框图及程序清单５．设计结果和体会（包括遇到的问题及解决的方法） 四、8251A通用串行输入/输出接口芯片由于CPU与接口之间按并行方式传输，接口与外设之间按串行方式传输，因此，在串行接口中，必须要有“接收移位寄存器”（串→并）和“发送移位寄存器”（并→串）。能够完成上述“串←→并”转换功能的电路，通常称为“通用异步收发器”（UART：Universal Asynchronous Receiver and Transmitter）,典型的芯片有：Intel 8250/8251。8251A异步工作方式：如果8251A编程为异步方式，在需要发送字符时，必须首先设置TXEN和CTS#为有效状态，TXEN(Transmitter Enable)是允许发送信号，是命令寄存器中的一位；CTS#(Clear To Send)是由外设发来的对CPU请求发送信号的响应信号。然后就开始发送过程。在发送时，每当CPU送往发送缓冲器一个字符，发送器自动为这个字符加上1个起始位，并且按照编程要求加上奇／偶校验位以及1个、1.5个或者2个停止位。串行数据以起始位开始，接着是最低有效数据位，最高有效位的后面是奇／偶校验位，然后是停止位。按位发送的数据是以发送时钟TXC的下降沿同步的，也就是说这些数据总是在发送时钟TXC的下降沿从8251A发出。数据传输的波特率取决于编程时指定的波特率因子，为发送器时钟频率的1、1/16或1/64。当波特率指定为16时，数据传输的波特率就是发送器时钟频率的1/16。CPU通过数据总线将数据送到8251A的数据输出缓冲寄存器以后，再传输到发送缓冲器，经移位寄存器移位，将并行数据变为串行数据，从TxD端送往外部设备。在8251A接收字符时，命令寄存器的接收允许位RxE(Receiver Enable)必须为1。8251A通过检测RxD引脚上的低电平来准备接收字符，在没有字符传送时RxD端为高电平。8251A不断地检测RxD引脚，从RxD端上检测到低电平以后，便认为是串行数据的起始位，并且启动接收控制电路中的一个计数器来进行计数，计数器的频率等于接收器时钟频率。计数器是作为接收器采样定时，当计数到相当于半个数位的传输时间时再次对RxD端进行采样，如果仍为低电平，则确认该数位是一个有效的起始位。若传输一个字符需要16个时钟，那么就是要在计数8个时钟后采样到低电平。之后，8251A每隔一个数位的传输时间对RxD端采样一次，依次确定串行数据位的值。串行数据位顺序进入接收移位寄存器，通过校验并除去停止位，变成并行数据以后通过内部数据总线送入接收缓冲器，此时发出有效状态的RxRDY信号通知CPU，通知CPU8251A已经收到一个有效的数据。一个字符对应的数据可以是5～8位。如果一个字符对应的数据不到8位，8251A会在移位转换成并行数据的时候，自动把他们的高位补成0。 五、系统总体设计方案根据系统设计的要求，对系统设计的总体方案进行论证分析如下：1．获取8位开关量可使用实验台上的8255A可编程并行接口芯片，因为只要获取8位数据量，只需使用基本输入和8位数据线，所以将8255A工作在方式0，PA0-PA7接实验台上的8位开关量。2．当使用串口进行数据传送时，虽然同步通信速度远远高于异步通信，可达500kbit/s，但由于其需要有一个时钟来实现发送端和接收端之间的同步，硬件电路复杂，通常计算机之间的通信只采用异步通信。3．由于8251A本身没有时钟，需要外部提供，所以本设计中使用实验台上的8253芯片的计数器2来实现。4：显示和键盘输入均使用DOS功能调用来实现。设计思路框图，如下图所示： 六、硬件设计硬件电路主要分为8位开关量数据获取电路，串行通信数据发送电路，串行通信数据接收电路三个部分。1．8位开关量数据获取电路该电路主要是利用8255并行接口读取8位乒乓开关的数据。此次设计在获取8位开关数据量时采用8255令其工作在方式0，A口输入8位数据，CS#接实验台上CS1口，对应端口为280H-283H，PA0-PA7接8个开关。2．串行通信电路串行通信电路本设计中8253主要为8251充当频率发生器，接线如下图所示。
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