verilog实现序列10010检测..........
资源简介:verilog实现序列10010检测..........
上传时间: 2013-12-13
上传用户:xiaoxiang
资源简介:用verilog实现的序列检测器,可以检测出任意规定序列
上传时间: 2014-02-21
上传用户:lxm
资源简介:功能是检测一个5位二进制序列“10010”。考虑到序列重叠的可能,有限状态机共提供8个状态(包括初始状态IDLE)。
上传时间: 2016-07-03
上传用户:龙飞艇
资源简介:状态机实现序列检测verilogHDL及其仿真
上传时间: 2014-01-08
上传用户:jqy_china
资源简介:使用Matlab和verilog实现fibonacci序列,包括源代码和testbench,适合感兴趣的学习者学习,可以提高自己的能力,大家可以多交流哈
上传时间: 2022-05-16
上传用户:qingfengchizhu
资源简介:使用verilog实现QPSK信号的匹配滤波,对符号过采样率为4,在程序中设定相关峰的检测门限为3
上传时间: 2014-01-12
上传用户:xuan‘nian
资源简介:用verilog实现的以太网接口!!!!!!!!!!!!!!!!!!
上传时间: 2013-07-13
上传用户:LSPSL
资源简介:verilog实现一个AGC模块,信号输入位宽16位,通过统计64个输入完成其功率的统计,然后根据功率大小对信号进行缩放。
上传时间: 2013-06-09
上传用户:sc965382896
资源简介:使用verilog实现基于FPGA的SDRAM控制器
上传时间: 2013-08-08
上传用户:litianchu
资源简介:用verilog实现的串口收发数据程序,已经调试通过
上传时间: 2013-08-21
上传用户:lixinxiang
资源简介:verilog实现的DDS正弦信号发生器和测频测相模块,DDS模块可产生两路频率和相位差均可预置调整的值正弦波,频率范围为20Hz-5MHz,相位范围为0°-359°,测量的数据通过引脚传输给单片机,单片机进行计算和显示。
上传时间: 2013-08-28
上传用户:asdfasdfd
资源简介:用verilog实现基于FPGA的通用分频器
上传时间: 2013-08-30
上传用户:xingyuewubian
资源简介:用verilog实现8255芯片功能
上传时间: 2013-10-31
上传用户:sunjet
资源简介:verilog实现ALU的源代码,并提供了一个详细的测试平台!
上传时间: 2015-03-23
上传用户:aysyzxzm
资源简介:MD5算法的verilog实现,同时包含有testbench。
上传时间: 2014-01-09
上传用户:1159797854
资源简介:verilog 实现的jtag ip模块 包括了测试程序
上传时间: 2014-12-08
上传用户:叶山豪
资源简介:用verilog实现滤波器的功能,通过软件综合仿真,在利用FPGA实现
上传时间: 2013-12-14
上传用户:lanhuaying
资源简介:计算器芯片的verilog实现代码! 时序仿真成功
上传时间: 2015-05-10
上传用户:三人用菜
资源简介:用verilog实现的四乘四键盘程序,在Quartus II上编译通过并成功
上传时间: 2015-05-13
上传用户:ruan2570406
资源简介:Arbiter.v verilog实现 三路请求,使用循环策略的仲裁器 含有看门狗电路
上传时间: 2013-12-10
上传用户:qlpqlq
资源简介:verilog 实现 优化的16位比较器 可以输出大于,小于,等于。模块化设计,可扩展为32位
上传时间: 2015-05-16
上传用户:dongbaobao
资源简介:该源码是用C语言编写的,实现网络入侵检测系统的功能
上传时间: 2013-12-17
上传用户:dongqiangqiang
资源简介:FIR滤波器的verilog实现,实现6级流水线的程序设计。
上传时间: 2015-06-02
上传用户:sjyy1001
资源简介:此代码是用verilog实现的以太网接口,在此基础上做修改,可以作为一般的以太网接口程序开发.
上传时间: 2014-01-20
上传用户:zhichenglu
资源简介:光发射机源码单片机程序,实现光功率检测,光块温度检测,超限关断报警功能
上传时间: 2015-06-19
上传用户:黄华强
资源简介:本源码用来对dsp编程实现电机速度检测,
上传时间: 2015-06-29
上传用户:ippler8
资源简介:用verilog实现单片机计数器 用verilog实现单片机计数器
上传时间: 2013-12-21
上传用户:h886166
资源简介:一个32位微处理器的verilog实现源代脉,采用5级流水线和cache技术.
上传时间: 2014-12-21
上传用户:yimoney
资源简介:verilog实现电子时钟模块,输入60Hz时钟信号和复位,输出时分秒,共6位,每位7段输出用于驱动
上传时间: 2015-08-13
上传用户:王楚楚
资源简介:verilog实现,UDP描述带有异步复位的正边沿触发D触发器,test测试通过
上传时间: 2013-12-27
上传用户:yulg