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用verilog HDL编写的并串转换模块

  • 资源大小：781 K
  • 上传时间： 2014-10-10
  • 上传用户：a520
  • 资源积分：2 下载积分
  • 标      签： verilog HDL 编写 转换模块

资 源 简 介

用verilog HDL编写的并串转换模块，在ISE软件仿真过，也可综合

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