数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比,DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。
资源简介:数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比,DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。
上传时间: 2013-12-18
上传用户:libenshu01
资源简介:数字锁相环DPLL源程序,用cpld编写,展开后文件比较多,大家请耐心使用。谢谢,多多支持
上传时间: 2013-12-20
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资源简介:数字锁相环DPLL实例程序,帮助理解PLL的结构和详细原理
上传时间: 2014-08-14
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资源简介:数字锁相环程序,适合于FM、AM开发 数字锁相环程序,适合于FM、AM开发
上传时间: 2015-06-20
上传用户:363186
资源简介:PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛,本例用VHDL描述了一个锁相环作为参考,源码已经调试过。编译器synplicty.Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致,...
上传时间: 2013-12-31
上传用户:hphh
资源简介:PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上;顶层文件是PLL.GDF
上传时间: 2014-06-09
上传用户:daguda
资源简介:比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。
上传时间: 2013-12-24
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资源简介:技术文章《自采样比例积分控制全数字锁相环的性能分析和实现》有一定参考价值
上传时间: 2015-08-21
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资源简介:智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信
上传时间: 2014-01-08
上传用户:weiwolkt
资源简介:本文在说明全数字锁相环的基础上,提出了一种利用FPGA设计一阶全数字锁相环的方法,并 给出了关键部件的RTL可综合代码,并结合本设计的一些仿真波形详细描述了数字锁相环的工作过程,最后对一些有关的问题进行了讨论。
上传时间: 2014-01-10
上传用户:asddsd
资源简介:数字锁相环路原理与应用:全数字锁相环。根据本资料可以自己编写代码在计算机上模拟实现。
上传时间: 2016-11-01
上传用户:edisonfather
资源简介:使用VHDL语言进行设计DPLL(数字锁相环)的相关文件
上传时间: 2013-12-25
上传用户:Miyuki
资源简介:基于锁相环Top-down的建模方法在MATLAB环境下建立数字锁相环完整的仿真模型,并用SIMULINK对数字锁相环的仿真模型进行仿真。
上传时间: 2014-01-15
上传用户:大三三
资源简介:数字式调频收音机设计 介绍利用数字锁相频率合成技术构成收音机的电调谐部分并阐述了收音机的调台、选台、搜索与存储等功能的电路设计原理,着重介绍了用收音机集成芯片CXA1019S构成的FM电路、频率合成器芯片BU2614构成的锁相环电路。
上传时间: 2013-12-16
上传用户:ouyangtongze
资源简介:一个实现简单的数字锁相环Verilog代码,本人借鉴网上现有的代码后经修改在Cyclone II上调通实现,里面有ModelSim仿真成功的波形图
上传时间: 2014-01-22
上传用户:003030
资源简介:PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上; 顶层文件是PLL.GDF
上传时间: 2017-07-24
上传用户:璇珠官人
资源简介:锁相技术相关专辑 38册 209M数字锁相环原理与应用.pdf
上传时间: 2014-05-05
上传用户:时代将军
资源简介:锁相技术相关专辑 38册 209M用数字锁相环电路实现高精度宽范围频率控制.pdf
上传时间: 2014-05-05
上传用户:时代将军
资源简介:用一片CPLD实现数字锁相环,用VHDL或V语言
上传时间: 2013-05-27
上传用户:hewenzhi
资源简介:基于FPGA实现的一种新型数字锁相环
上传时间: 2013-08-07
上传用户:2467478207
资源简介:基于FPGA的全数字锁相环设计,内有设计过程和设计思想
上传时间: 2013-08-13
上传用户:fqscfqj
资源简介:基于FPGA设计数字锁相环,提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案
上传时间: 2013-08-19
上传用户:Huge_Brother
资源简介:关于数字锁相环的一点东西,可以下来看看\r\n
上传时间: 2013-08-26
上传用户:7891
资源简介:用VHDL写的数字锁相环程序 PLL.vhd为源文件 PLLTB.vhd为testbench
上传时间: 2014-01-20
上传用户:zwei41
资源简介:数字琐相环DPLL的VERLOG代码,MODELSIM下的工程,有测试文件
上传时间: 2014-01-13
上传用户:Thuan
资源简介:用verilog语言编写的全数字锁相环的源代码,基于fpga平台
上传时间: 2015-06-13
上传用户:wanqunsheng
资源简介:关于数字锁相环的使用,结合FM,AM的使用来说明
上传时间: 2013-12-29
上传用户:虫虫虫虫虫虫
资源简介:全数字锁相环VHDL描述并实现功能仿真,另附有图形说明
上传时间: 2014-01-13
上传用户:shawvi
资源简介:直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.
上传时间: 2015-07-18
上传用户:妄想演绎师
资源简介:一种改进的全数字锁相环设计 一种改进的全数字锁相环设计
上传时间: 2013-12-24
上传用户:stampede