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VHDL/FPGA/Verilog
> 存储器模块生成
存储器模块生成
资源大小:
3 K
上传时间:
2014-01-12
上传用户:
wentianliang
资源积分:
2 下载积分
标 签:
存储器
模块
资 源 简 介
存储器模块生成,采用16位数据总线,5位读写地址总线,异步清零!
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