加法器 用VerilogHDL实现加罗华域加法器
资源简介:加法器 用VerilogHDL实现加罗华域加法器
上传时间: 2016-08-22
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资源简介:精通verilog HDL语言编程源码之3--伽罗华域乘法器设计
上传时间: 2013-12-18
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上传时间: 2017-01-24
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上传时间: 2016-07-12
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资源简介:用matlab实现带有动画演示的加尔顿顶板演示,第一次matlab实验。
上传时间: 2017-06-24
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资源简介:伽勒华域乘法器用于RS编码中,用VerilogHDL语言实现
上传时间: 2013-12-25
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资源简介:用VerilogHDL实现基于FPGA的通用分频器的设计
上传时间: 2013-10-28
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资源简介:用VerilogHDL实现基于FPGA的通用分频器的设计
上传时间: 2015-01-02
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资源简介:一个用VerilogHDL语言编写的8X8的乘法器
上传时间: 2015-07-22
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资源简介:在AlTEA的DE2平台上用VerilogHDL实现的VGA控制模块
上传时间: 2015-10-01
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资源简介:用VerilogHDL实现的产生Sine波形全部程序 个人验证后收藏的。
上传时间: 2014-11-18
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资源简介:用vc实现德罗斯放块游戏 用vc实现德罗斯放块游戏
上传时间: 2014-11-05
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资源简介:Verilog hdl语言 伽罗华域GF(q)乘法器设计,可使用modelsim进行仿真
上传时间: 2013-12-27
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资源简介:用 VerilogHDL实现SPI总线的程序
上传时间: 2013-12-10
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上传时间: 2013-12-29
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资源简介:伽罗华域GF(q)乘法器verilog设计.rar
上传时间: 2017-09-20
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资源简介:Quartus2实现的四位进制并行加法器 用VHDL语言实现
上传时间: 2016-05-30
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资源简介:这是用VHDL实现的8位加法器,对新手有点帮助。
上传时间: 2014-01-05
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资源简介:用JAVA实现的DES加解密算法代码
上传时间: 2014-11-26
上传用户:kytqcool
资源简介:用java实现浮点数加减乘除四则混合运算,矩阵加法,减法,与数乘,与数除,两个矩阵相乘,转置,逆阵,产生单位阵,操作数与变量的转换,操作数取反,栈的一些基本操作。
上传时间: 2013-12-12
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资源简介:VHDL实现的超前进位加法器
上传时间: 2015-03-04
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资源简介:用C++实现的 用链表实现无限大整数的加减运算,
上传时间: 2014-11-27
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资源简介:一个很不错的例子,实现的是4bit的加减乘除,用modelsim做的仿真.
上传时间: 2015-04-08
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资源简介:RSA MD5加解密算法,用c++实现,核心部分是c的代码,完全跨平台
上传时间: 2014-01-03
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资源简介:该程序用C语言实现了大整数的加减乘除运算
上传时间: 2015-05-28
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资源简介:有关于des的加解密算法的实现..是用java语言来编写的。.
上传时间: 2013-12-27
上传用户:jichenxi0730
资源简介:JAVA写计算器 用堆栈实现 实现了小数的加减乘除,乘方,取模,括号
上传时间: 2013-12-22
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上传时间: 2013-12-30
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资源简介:一个用VC++实现的恺撒算法。可以实现加解密的功能。
上传时间: 2015-11-02
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资源简介:sysbase 12 用程序实现加卸载数据。
上传时间: 2013-12-19
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