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VHDL分频器

  • 资源大小:2 K
  • 上传时间: 2013-11-29
  • 上传用户:pipiooxx
  • 资源积分:2 下载积分
  • 标      签: VHDL 分频器

资 源 简 介

VHDL分频器,利用分频比较错法,要实现K=324/28=8.3571428571...的分频周期为28,18个8分频和10个9分频循环,所以设一个0到27的循环计数器,每当1、4、7、10、13、16、19、22、27时进行9分频,其他时为8分频;为使占空比尽量接近50%,需要在每一个8或9分频中设定一下输出几个时钟的0和1。

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