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用verilog hdl编写的一些例程

  • 资源大小：5 K
  • 上传时间： 2013-12-20
  • 上传用户：xiao11tian
  • 资源积分：2 下载积分
  • 标      签： verilog hdl 编写

资 源 简 介

用verilog hdl编写的一些例程，包括加法器/减法器等等，例子较多就不一一列举了

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