基本运算逻辑和它们的Verilog HDL模型
资源简介:基本运算逻辑和它们的Verilog HDL模型
上传时间: 2015-09-17
上传用户:qw12
资源简介:第一章 数字信号处理、计算、程序、算法和硬线逻辑的基本概念 第二章 Verilog HDL设计方法概述 第三章 Verilog HDL的基本语法 第四章 不同抽象级别的Verilog HDL模型 第五章 基本运算逻辑和它们的Verilog HDL模型 第六章 运算和数据流动控制逻辑 第七章...
上传时间: 2016-02-08
上传用户:ardager
资源简介:第一章 数字信号处理、计算、程序、 算法和硬线逻辑的基本概念 第二章 Verilog HDL设计方法概述 第三章 Verilog HDL的基本语法 第四章 不同抽象级别的Verilog HDL模型 第五章 基本运算逻辑和它们的Verilog HDL模型 第六章 运算和数据流动控制逻辑
上传时间: 2014-01-27
上传用户:sclyutian
资源简介:这个文件中使用Verilog HDL简单的利用基本运算实现了微型的cpu设计开发过程
上传时间: 2016-08-24
上传用户:hgy9473
资源简介:从算法设计到硬线逻辑的实现:复杂数字逻辑系统的Verilog HDL设计技术和方法,结合DSP算法介绍Verilog HDL 设计。
上传时间: 2016-12-16
上传用户:xiaohuanhuan
资源简介:是关于dct的Verilog HDL源代码和测试程序
上传时间: 2014-06-15
上传用户:四只眼
资源简介:设计一个可进行复数运算的演示程序。要求实现下列六种基本运算:1)由输入的实部和虚部生成一个复数;2)两个复数求和;3)两个复数求差;4)两个复数求积,5)从已知复数中分离出实部;6)从已知复数中分离出虚部。运算结果以相应的复数或实数的表示形式显示。
上传时间: 2013-12-24
上传用户:zhangyi99104144
资源简介:包含了四位计数器等基本数字模块的的Verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合
上传时间: 2013-12-19
上传用户:hopy
资源简介:本程序包含:EEPROM的功能模型(eeprom.v)、读/写EEPROM的Verilog HDL 行为模块(eeprom_wr.v)、信号产生模块(signal.v)和顶层模块(top.v) ,这样可以有一个完整的EEPROM的控制模块和测试文件,本文件通过测试。
上传时间: 2017-01-22
上传用户:lanjisu111
资源简介:4 digital LED dynamic display的Verilog HDL源代码,它能动态的显示4位数,为FPGA 的DEBUG 提供便利,非常经典,简单易懂,并且经过了Modelsim/ISE/FPGA(XC3S250ETQ144)验证和实现,好的行为模型就应该大家分享。
上传时间: 2016-04-12
上传用户:坏天使kk
资源简介:SDRAM的Verilog HDL程序,适合DE2开发板,和TRDB-LCM显示器,很好哦
上传时间: 2014-01-03
上传用户:skfreeman
资源简介:4bit ALU(运算逻辑单元)的设计 给出了此次设计alu的输入输出结构及相应的位数。其中C0是一位的进位输入,A和B分别是4位的数据输入,S0、S1、M分别为一位的功能选择输入信号;Cout是一位的进位输出,F是4为的运算结果输出。
上传时间: 2013-12-09
上传用户:sevenbestfei
资源简介:基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码,其功能主要有:时间设置,时间显示,跑表,分频,日期设置,日期显示等
上传时间: 2013-08-18
上传用户:问题问题
资源简介:用于计算CRC的Verilog HDL源码
上传时间: 2015-02-07
上传用户:569342831
资源简介:JSP的强大优势在于把一种应用的商务逻辑和它的介绍分离开来。用 Smalltalk的面向对象的术语来说, JSP鼓励MVC(model-view-controller)的web应用。JSP的classes 或 beans 是模型, JSP 是这个视图, 而Servlet是控制器。这个例子是一个简单的留言板
上传时间: 2013-12-20
上传用户:003030
资源简介:我用过的Verilog HDL写的SDRAM core源程序,经过测试应用
上传时间: 2015-03-31
上传用户:15071087253
资源简介:USB主机和设备的Verilog代码,实现了USB1.1协议规范的要求
上传时间: 2015-04-09
上传用户:标点符号
资源简介:11,13,16位超前进位加法器的Verilog HDL源代码。
上传时间: 2013-12-28
上传用户:ouyangtongze
资源简介:FPGA/CPLD应用,uart的Verilog HDL原码
上传时间: 2013-12-28
上传用户:lizhizheng88
资源简介:王金明的Verilog HDL程序集合,包含各个常用的程序
上传时间: 2013-11-26
上传用户:星仔
资源简介:aes算法的Verilog HDL实现,供给大家作为参考 。
上传时间: 2013-12-18
上传用户:gundan
资源简介:8251和8055的Verilog源码,可进行综合和仿真,是学习SOC的好资料!
上传时间: 2014-08-24
上传用户:lhc9102
资源简介:通用串行异步收发器8251的Verilog HDL源代码,经过仿真验证。
上传时间: 2015-11-21
上传用户:lizhizheng88
资源简介:文中给出了在数字系统设计时常用的器件,和它们的参数希望对大家有所帮助
上传时间: 2014-01-20
上传用户:jkhjkh1982
资源简介:算术处理器的Verilog HDL的源代码
上传时间: 2016-01-07
上传用户:bjgaofei
资源简介:ps2接口的Verilog HDL源代码
上传时间: 2016-01-07
上传用户:杜莹12345
资源简介:用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序
上传时间: 2016-01-15
上传用户:王楚楚
资源简介:用于生成GF(2^m)有限域中常数乘法器的Verilog HDL源文件的C程序
上传时间: 2016-01-15
上传用户:chenbhdt
资源简介:用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序
上传时间: 2014-01-13
上传用户:gyq
资源简介:占用资源少的Verilog HDL uart接口;采用固定波特率115200,可以修改程序中的分频来修改波特率,模式为1个启始位,8位数据位,1个停止位;带1字节缓存;当缓存空时输出空信号
上传时间: 2013-12-28
上传用户:kikye