一个在FPGA芯片上实现UART功能的vhdl源代码

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  上传时间： 2015-07-05

  上传用户：杜莹12345

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  上传用户：牧羊人8920

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  资源简介：提出了一个采用(2,1,7)卷积码+QPSK的中频调制解调方案,并在Xilinx公司的100万 门FPGA芯片上实现了该系统。该系统在信噪比SNR为6dB左右时可实现速率超过1Mbit/s、误码率 小于10-5的数据传输。

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  上传用户：exxxds

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  资源简介：提出了欧氏算法和IDFT相结合的RS码流式解码方案,并在FPGA芯片上予以实现。计算机仿真和实测表明,该方案在GF(28)的符号速率可达50MHz以上,最大延时为640ns,满足了高速宽带无线接入网中抗干扰编译码的需求。

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  上传时间： 2013-12-08

  上传用户：yulg

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