基于ti公司6713dsp的数字锁相环

相 关 资 源

• 基于ti公司6713dsp的数字锁相环免费下载

  资源简介：基于ti公司6713dsp的数字锁相环，运行环境为ccs3.1。希望有所帮助。

  标签： 6713 dsp 数字锁相环

  上传时间： 2015-10-04

  上传用户：ma1301115706

• 介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。免费下载

  资源简介：介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。

  标签： FPGA 数字锁相环 分 基本结构

  上传时间： 2016-08-12

  上传用户：xiaoyunyun

• 基于FPGA的数字锁相环的研究与实现免费下载

  资源简介：该文档为基于FPGA的数字锁相环的研究与实现总结文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………

  标签： fpga

  上传时间： 2022-04-27

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• 用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench免费下载

  资源简介：用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench

  标签： vhd testbench pllTB VHDL

  上传时间： 2014-01-20

  上传用户：zwei41

• 介绍了一宽带的数字锁相环的实现方法免费下载

  资源简介：介绍了一宽带的数字锁相环的实现方法，欢迎大家踊跃下载

  标签： 宽带 实现方法 数字锁相环

  上传时间： 2015-11-25

  上传用户：咔乐坞

• 一个实现简单的数字锁相环Verilog代码免费下载

  资源简介：一个实现简单的数字锁相环Verilog代码，本人借鉴网上现有的代码后经修改在Cyclone II上调通实现，里面有ModelSim仿真成功的波形图

  标签： Verilog 数字锁相环 代码

  上传时间： 2014-01-22

  上传用户：003030

• 针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电免费下载

  资源简介：针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利 用仿真波形验证该设计的合理性和有效性。整...

  标签： FPGA 297 HCT 高频感应

  上传时间： 2014-01-11

  上传用户：AbuGe

• 一个初步的数字锁相环程序免费下载

  资源简介：一个初步的数字锁相环程序，没有测试文件，应该可以运行。

  标签： 数字锁相环 程序

  上传时间： 2014-11-18

  上传用户：zwei41

• 国外一篇很好的数字锁相环（PLL）设计文档（解压后PLL.pdf）免费下载

  资源简介：国外一篇很好的数字锁相环（PLL）设计文档（解压后PLL.pdf），不可不看呦！

  标签： PLL 数字锁相环 文档

  上传时间： 2016-08-10

  上传用户：dengzb84

• 本人写的数字锁相环免费下载

  资源简介：本人写的数字锁相环，有模拟数据，学习锁相环很好的材料。参考书“数字锁相环路原理与应用”编写。

  标签： 数字锁相环

  上传时间： 2014-01-18

  上传用户：xsnjzljj

• 收集的数字锁相环设计相关文章多篇.主要采用VHDL语言进行设计.免费下载

  资源简介：收集的数字锁相环设计相关文章多篇.主要采用VHDL语言进行设计.

  标签： VHDL 数字锁相环 语言

  上传时间： 2014-12-07

  上传用户：kytqcool

• 使用VHDL语言进行的数字锁相环的设计免费下载

  资源简介：使用VHDL语言进行的数字锁相环的设计，里面有相关的文件，可以使用MUX+PLUS打开

  标签： VHDL 语言 数字锁相环

  上传时间： 2014-06-29

  上传用户：lanhuaying

• 高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题免费下载

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  标签： 高频感应 加热电源 模拟锁相环 频率

  上传时间： 2013-08-22

  上传用户：nairui21

• 基于FPGA实现的一种新型数字锁相环免费下载

  资源简介：基于FPGA实现的一种新型数字锁相环

  标签： FPGA 新型数字 锁相环

  上传时间： 2013-08-07

  上传用户：2467478207

• 基于FPGA的全数字锁相环设计免费下载

  资源简介：基于FPGA的全数字锁相环设计,内有设计过程和设计思想

  标签： FPGA 全数字 锁相环

  上传时间： 2013-08-13

  上传用户：fqscfqj

• 用verilog语言编写的全数字锁相环的源代码,基于fpga平台免费下载

  资源简介：用verilog语言编写的全数字锁相环的源代码,基于fpga平台

  标签： verilog fpga 语言 编写

  上传时间： 2015-06-13

  上传用户：wanqunsheng

• 比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。免费下载

  资源简介：比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。

  标签： VHDL 比较 全数字 分

  上传时间： 2013-12-24

  上传用户：362279997

• 基于VHDL的全数字锁相环的设计 有关键部分的源代码 hehe !免费下载

  资源简介：基于VHDL的全数字锁相环的设计 有关键部分的源代码 hehe !

  标签： VHDL hehe 全数字 锁相环

  上传时间： 2015-12-18

  上传用户：hgy9473

• 基于FPGA实现的一种新型数字锁相环免费下载

  资源简介：基于FPGA实现的一种新型数字锁相环

  标签： FPGA 新型数字 锁相环

  上传时间： 2014-01-12

  上传用户：13160677563

• 基于FPGA实现的一种新型数字锁相环免费下载

  资源简介：基于FPGA实现的一种新型数字锁相环

  标签： FPGA 新型数字 锁相环

  上传时间： 2014-01-02

  上传用户：cylnpy

• 基于FPGA的全数字锁相环设计,内有设计过程和设计思想免费下载

  资源简介：基于FPGA的全数字锁相环设计,内有设计过程和设计思想

  标签： FPGA 全数字 锁相环 过程

  上传时间： 2017-02-11

  上传用户：evil

• 基于锁相环Top-down的建模方法在MATLAB环境下建立数字锁相环完整的仿真模型免费下载

  资源简介：基于锁相环Top-down的建模方法在MATLAB环境下建立数字锁相环完整的仿真模型，并用SIMULINK对数字锁相环的仿真模型进行仿真。　

  标签： Top-down MATLAB 锁相环 建模方法

  上传时间： 2014-01-15

  上传用户：大三三

• 基于dsp Builder的带宽自适应全数字锁相环的设计与实现免费下载

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  标签： dsp

  上传时间： 2022-05-01

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• 基于FPGA设计数字锁相环免费下载

  资源简介：基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案

  标签： FPGA 数字锁相环

  上传时间： 2013-08-19

  上传用户：Huge_Brother

• 基于FPGA设计数字锁相环免费下载

  资源简介：基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案

  标签： FPGA 数字锁相环

  上传时间： 2013-12-25

  上传用户：dyctj

• 应用于十万门FPGA的全数字锁相环设计免费下载

  资源简介：在过去的十几年间，FPGA取得了惊人的发展：集成度已达到1000万等效门、速度可达到400～500MHz。随着FPGA的集成度不断增大，在高密度FPGA中，芯片上时钟的分布质量就变得越来越重要。时钟延时和时钟相位偏移已成为影响系统性能的重要因素。现在，解决时钟延时...

  标签： FPGA 应用于 全数字 锁相环

  上传时间： 2013-07-06

  上传用户：LouieWu

• 关于数字锁相环的一点东西免费下载

  资源简介：关于数字锁相环的一点东西,可以下来看看\r\n

  标签： 数字锁相环

  上传时间： 2013-08-26

  上传用户：7891

• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF

  标签： 数据 Q5 PLL 输入

  上传时间： 2014-06-09

  上传用户：daguda

• 基于TI 公司 TMS320C6713的源代码免费下载

  资源简介：基于TI 公司 TMS320C6713的源代码，对进行dsp 开发非常有借鉴意义。

  标签： C6713 320C 6713 TMS

  上传时间： 2015-05-24

  上传用户：佳期如梦

• 关于数字锁相环的使用免费下载

  资源简介：关于数字锁相环的使用，结合FM,AM的使用来说明

  标签： 数字锁相环

  上传时间： 2013-12-29

  上传用户：虫虫虫虫虫虫