Computer Architecture Handbook on verilog HDL
标签: Architecture Computer Handbook Verilog
上传时间: 2015-03-15
上传用户:www240697738
verilog HDL教程135例:verilog HDL语言类似于C语言,便于学习。本文档带有源代码,3-6章
上传时间: 2013-12-12
上传用户:rocketrevenge
verilog HDL教程135例:verilog HDL语言类似于C语言,便于学习。本文档带有源代码,7-8章
上传时间: 2013-12-09
上传用户:cuiyashuo
verilog HDL教程135例:verilog HDL语言类似于C语言,便于学习。本文档带有源代码,9-10章
上传时间: 2013-12-26
上传用户:qb1993225
verilog HDL教程135例:verilog HDL语言类似于C语言,便于学习。本文档带有源代码,11-12章
上传时间: 2015-03-24
上传用户:zhaoq123
这是一个verilog HDL编写的RISC cpu的程序,该程序共10个子程序,实现了简单的RISC cpu,可供初学者参考,学习硬件描述语言,及设计方法。该程序通过了modelsim仿真验证。
上传时间: 2015-03-26
上传用户:qiao8960
减1计数器 一、设计要求 用verilog HDL语言设计一个计数器。 要求计数器具有异步置位/复位功能,可以进行自增和自减计数,其计数周期为2^N(N为二进制位数)。 二、设计原理 输入/输出说明: d:异步置数数据输入; q:当前计数器数据输出; clock:时钟脉冲; count_en:计数器计数使能控制(1:计数/0:停止计数); updown:计数器进行自加/自减运算控制(1:自加/0:自减); load_d
上传时间: 2015-03-28
上传用户:zycidjl
我用过的verilog HDL写的SDRAM core源程序,经过测试应用
上传时间: 2015-03-31
上传用户:15071087253
verilog HDL硬件描述语言的教程
上传时间: 2015-04-04
上传用户:lnnn30
verilog HDL. for igginner. tutorial in word file1 KAMPATE
标签: igginner tutorial verilog KAMPATE
上传时间: 2015-04-07
上传用户:chenxichenyue