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Xilinx isE&EDK 8.2平台的嵌入式MiNiVOS服务器

Xilinx isE&EDK 8.2平台的嵌入式MiNiVOS服务器

标签： MiNiVOS Xilinx isE EDK

上传时间： 2017-02-21

上传用户：cjf0304
Xilinx isE&EDK 8.2平台的人脸检测系统设计

Xilinx isE&EDK 8.2平台的人脸检测系统设计

标签： Xilinx isE EDK 8.2

上传时间： 2017-02-21

上传用户：410805624
it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix isE 8

it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix isE 8.2i.i have tested it om my kit.[i mae my own kit for spartan2 device].you can use this code in any DSP project in which data entry is required.

标签： synthesize simulator modelsim verilog

上传时间： 2014-06-26

上传用户：zhuyibin
it is a verilog code written for traffic light controller will synthesize in xinlix isE 8.2i.i have

it is a verilog code written for traffic light controller will synthesize in xinlix isE 8.2i.i have tested it om my kit.[i mae my own kit for spartan2 device].it is a state machine based code.

标签： controller synthesize verilog traffic

上传时间： 2017-03-22

上传用户：xymbian
如何使用isE和FPGA使用指南里面附带许多实验

如何使用isE和FPGA使用指南里面附带许多实验

标签： FPGA isE 如何使用使用指南

上传时间： 2013-12-25

上传用户：极客
This is vga controller write in vhdl xilinx isE Connect your vga monitor and view many color in mon

This is vga controller write in vhdl xilinx isE Connect your vga monitor and view many color in moniotr

标签： controller vga Connect monitor

上传时间： 2017-03-28

上传用户：363186
软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 梁祝乐曲演奏电路

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 梁祝乐曲演奏电路

标签： ModelSim isE 7.1 6.0

上传时间： 2014-01-27

上传用户：comua
软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 多功能数字钟

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 多功能数字钟

标签： ModelSim isE 7.1 6.0

上传时间： 2014-01-03

上传用户：youlongjian0
软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 自动售饮机电话计费器程序

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 自动售饮机电话计费器程序

标签： ModelSim isE 7.1 6.0

上传时间： 2017-05-04

上传用户：trepb001
软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 闹钟设计

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 闹钟设计

标签： ModelSim isE 7.1 6.0

上传时间： 2017-05-04

上传用户：小码农lz

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Xilinx isE&EDK 8.2平台的嵌入式MiNiVOS服务器

Xilinx isE&EDK 8.2平台的人脸检测系统设计

it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix isE 8

it is a verilog code written for traffic light controller will synthesize in xinlix isE 8.2i.i have

如何使用isE和FPGA使用指南里面附带许多实验

This is vga controller write in vhdl xilinx isE Connect your vga monitor and view many color in mon

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 梁祝乐曲演奏电路

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 多功能数字钟

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 自动售饮机电话计费器程序

软件开发环境：isE 7.1i 仿真环境：ModelSim SE 6.0 1. 闹钟设计