XAPP520将符合2.5V和3.3V I/O标准的7系列FPGA高性能I/O Bank进行连接 The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems
上传时间： 2013-11-06
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针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置到Altera公司Stratix III系列的EP3SL150F1152C2N中。测试结果表明，系统运行稳健可靠，并具有良好的移植性；集成化一体设计，为LTE标准下Turbo码 ASIC的开发提供了参考。
上传时间： 2013-10-08
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最新的HDMI I.3（高清晰度多媒体接口1.3）标准把以前的HDMI 1.0 - 1.2标准所规定的数据传送速度提高了一倍，每对差动信号线的速度达到3.4 Gbps。由于数据传送速度这么高，要求电路板的电容小，确保信号的素质很好，这给电路板的设计带来了新的挑战。在解决这个问题，实现可靠的静电放电（ESD）保护时，这点尤其重要。在HDMI系统设计中增加ESD保护时，如果选用合适的办法，就可以把问题简化。泰科电子的ESD和过电流保护参考设计，符合3.4 GHz的HDMI 1.3规范，达到IEC 61000-4-2关于ESD保护的要求，并且可以优化电路板的空间，所有这些可以帮助设计人员减少风险。本文探讨在HDMI 1.3系统中设计ESD保护的要求和容易犯的错误。 概述 在高清晰度视频系统中增加ESD保护，提出了许多复杂而且令人为难的问题，这会增加成本，会延长产品上市的时间。人们在选择ESD保护方案时，往往是根据解决这个问题的办法实现起来是否容易。不过，最简单的办法也许不可能提供充分的ESD保护，或者在电路板上占用的空间不能让人最满意。有些时候，在开始时看上去是解决ESD保护问题的最好办法，到了后来，会发现需要使用多种电路板材来保证时基信号达到要求。在实现一个充分的静电放电保护时，往往需要在尺寸、静电放电保护的性能以及实现起来是否容易这几方面进行折衷。一直到现在仍然是这样。
上传时间： 2015-01-02
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pcb检查标准，即 pcb check list . 步骤非常之详细，按着步骤一步一步的检查就可以达到标准的。
上传时间： 2013-11-12
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标准双向可控硅
上传时间： 2013-11-03
上传用户：fqscfqj
网络化智能接口标准对于海洋观测系统的集成、海洋信息的实时获取和共享等具有非常重要的作用。介绍了IEEE 1451、OGC SWE和PUCK协议等三种国际海洋组织正在推广的接口标准，概括了它们的体系结构、重要内容及其发展状况，并对这三种标准协议进行分析和比较，最后提出了它们应用在海洋观测系统中的各自优势和侧重点，以及这三种标准存在的问题。
上传时间： 2013-12-01
上传用户：zwei41
利用AM461或AM462的单端接地电压放大电路中OP1和输出电压可调的恒压源OP2可使输入信号为非标准的对地电压信号转换为标准的4-20mA（二线或三线制）输出或0-10V电输出。
上传时间： 2013-10-08
上传用户：inwins
CCITT的传真G3标准
上传时间： 2014-01-21
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包含标准证书编/解码、哈希、MD5、SHA1等算法的实现源码
上传时间： 2015-01-04
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含有常用的一些加密标准算法实现
上传时间： 2014-01-23
上传用户：xlcky
