ic设计流程

ISE13设计流程详解

ISE13[1].1_设计流程详解

标签： ISE 13 设计流程

上传时间： 2013-10-14

上传用户：hebmuljb
Alter FPGA的设计流程以及DSP设计

Alter FPGA的设计流程以及DSP设计.

标签： Alter FPGA DSP 设计流程

上传时间： 2013-11-13

上传用户：caixiaoxu26
华为FPGA设计流程指南

本部门所承担的FPGA设计任务主要是两方面的作用：系统的原型实现和ASIC的原型验证。编写本流程的目的是： l 在于规范整个设计流程，实现开发的合理性、一致性、高效性。 l 形成风格良好和完整的文档。 l 实现在FPGA不同厂家之间以及从FPGA到ASIC的顺利移植。 l 便于新员工快速掌握本部门FPGA的设计流程。

标签： FPGA 华为设计流程

上传时间： 2013-11-24

上传用户：xmsmh
1.3.5 嵌入微处理器的FPGA设计流程

1.3.5 嵌入微处理器的FPGA设计流程。

标签： FPGA 嵌入微处理器设计流程

上传时间： 2015-01-01

上传用户：ghostparker
1.3 FPGA的设计流程

1.3 FPGA的设计流程。

标签： FPGA 1.3 设计流程

上传时间： 2013-11-03

上传用户：xiehao13
对Altera 28nm FPGA浮点DSP设计流程和性能的独立分析

　　电子发烧友网核心提示：Altera公司昨日宣布，在业界率先在28 nm FPGA器件上成功测试了复数高性能浮点数字信号处理（DSP）设计。独立技术分析公司Berkeley设计技术有限公司（BDTI）验证了能够在 Altera Stratix V和Arria V 28 nm FPGA开发套件上简单方便的高效实现Altera浮点DSP设计流程，同时验证了要求较高的浮点DSP应用的性能。本文是BDTI完整的FPGA浮点DSP分析报告。　　 Altera的浮点DSP设计流程经过规划，能够快速适应可参数赋值接口的设计更改，其工作环境包括来自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高级模块库，支持FPGA设计人员比传统HDL设计更迅速的实现并验证复数浮点算法。这一设计流程非常适合设计人员在应用中采用高性能 DSP，这些应用包括，雷达、无线基站、工业自动化、仪表和医疗图像等。

标签： Altera FPGA DSP 28

上传时间： 2015-01-01

上传用户：sunshie
ISE13设计流程详解

ISE13[1].1_设计流程详解

标签： ISE 13 设计流程

上传时间： 2015-01-01

上传用户：kbnswdifs
IC设计cadence教程ppt版

IC设计cadence教程ppt版

标签： cadence IC设计教程

上传时间： 2013-10-15

上传用户：liansi
Alter FPGA的设计流程以及DSP设计

Alter FPGA的设计流程以及DSP设计.

标签： Alter FPGA DSP 设计流程

上传时间： 2013-11-07

上传用户：dudu1210004
华为FPGA设计流程指南

本部门所承担的FPGA设计任务主要是两方面的作用：系统的原型实现和ASIC的原型验证。编写本流程的目的是： l 在于规范整个设计流程，实现开发的合理性、一致性、高效性。 l 形成风格良好和完整的文档。 l 实现在FPGA不同厂家之间以及从FPGA到ASIC的顺利移植。 l 便于新员工快速掌握本部门FPGA的设计流程。

标签： FPGA 华为设计流程

上传时间： 2013-11-09

上传用户：cc1015285075