按照结构清晰、层次分明的原则，本书可分为以下几部分：第一部分为数字电路基础篇。主要包括第一章。重点介绍了数字电路的一些基础知识，如数字电路与模拟电路的比较、数字电路的分类、数制与编码等，它们是分析和理解数字电路的基础。第二部分为逻辑门和组合逻辑电路篇。主要包括第二章、第三章。重点介绍了两个方面的内容：一是基本门电路，如分立元件门电路、集成门电路等，它们是组成组合逻辑电路的基本逻辑单元；二是组合逻辑电路，如编码器、译码器、显示译码器、数据选择器、加法器和数值比较器等，常见的组合电路目前已经制作成集成电路，应用十分广泛。第三部分为双稳态触发器和时序逻辑电路篇。主要包括第四章、第五章。重点介绍了两个方面的内容：一是双稳态触发器电路，如基本RS触发器、同步触发器、主从JK触发器、边沿触发器、T型和T型触发器等；二是时序逻辑电路，简要分析了时序电路的特点及分类，并对几种典型的寄存器和计数器作了介绍。第四部分为脉冲波形的产生与整形电路篇。主要包括第六章。重点讨论了脉冲的产生和整形。在脉冲振荡器中，主要介绍在数字系统中最常使用的多谐振荡器；在整形电路中，主要介绍施密特触发器和单稳态触发器。并对一种在脉冲波形的产生和整形电路中应用十分广泛的多功能集成电路555定时器进行详细分析。第五部分是存储器和微控制器篇。主要包括第七章。重点介绍了只读存储器、随机存储器的结构和原理，并对微处理器的基本结构、工作过程和应用作了简要分析。第六部分为DAC转换器和ADC转换器篇。主要包括第八章。DAC转换器和ADC转换器，也就是通常所说的数/模转换和模/数转换电路，它们是数字系统不可缺少的组成部分，如用微控制器对生产过程进行控制，就必须首先将被控制的模拟量转换为数字量，才能送到微控制器系统中去进行运算和处理，然后又需将运算得到的数字量转换为模拟量，才能实现对被控参数的控制。
标签： 数字电子技术
上传时间： 2022-06-24
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计数器电路触发器编码器译码器逻辑门数电电路Multisim仿真源文件20个合集:100进制电路测试.ms10100进制电路测试.ms10 (Security copy)74LS161测试电路.ms1074LS161测试电路.ms10 (Security copy)74LS192电路.ms1074LS192电路.ms10 (Security copy)D触发器到T'触发器测试.ms10D触发器到T'触发器测试.ms10 (Security copy)D触发器测试电路.ms10D触发器测试电路.ms10 (Security copy)JK触发器变为T触发器测试.ms10JK触发器变为T触发器测试.ms10 (Security copy)JK触发器测试.ms10JK触发器测试.ms10 (Security copy)RS基本触发器测试.ms10RS基本触发器测试.ms10 (Security copy)任意进制电路设计74LS160.ms10任意进制电路设计74LS160.ms10 (Security copy)四人表决器.ms10四人表决器.ms10 (Security copy)奇偶校验电路(Parity.pdf奇偶校验电路.ms10奇偶校验电路.ms10 (Security copy)抢答器.ms10抢答器.ms10 (Security copy)火灾报警.ms10火灾报警.ms10 (Security copy)简易密码锁设计.ms10简易密码锁设计.ms10 (Security copy)简易测频仪.ms10简易测频仪.ms10 (Security copy)简易秒表电路.ms10简易秒表电路.ms10 (Security copy)编码器74LS148D.ms10编码器74LS148D.ms10 (Security copy)译码器电路.ms10译码器电路.ms10 (Security copy)逻辑门.ms10逻辑门.ms10 (Security copy)
上传时间： 2021-10-27
上传用户：canderile
计算机通信与rs-232接口实用指南
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专辑类-数字处理及显示技术专辑-106册-9138M 计算机通信与rs-232接口实用指南-549页-11.2M.pdf
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RS-232／RS-485 无源转换电路设计
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RS-485总线可靠性应用研究 介绍的相当详细
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基于RS-485的多点数据采集与显示系统。
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上传用户：huql11633
Reed-Solomon码(简称RS码)是一种具有很强纠正突发和随机错误能力的信道编码方式，在深空通信、移动通信、磁盘阵列以及数字视频广播(DVB)等系统中具有广泛的应用。 本文简要介绍了有限域基本运算的算法和常用的RS编码算法，分析了改进后的Euclid算法和改进后的BM算法，针对改进后的BM算法提出了一种流水线结构的译码器实现方案并改进了该算法的实现结构，在译码器复杂度和译码延时上作了折衷，降低了译码器的复杂度并提高了译码器的最高工作频率。在Xilinx公司的Virtex-Ⅱ系列FPGA上设计实现了RS(255,239)编译码器，证明了该方案的可行性。
上传时间： 2013-06-11
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本课题首先研究了常规的RS译码器的算法，确定在关键方程的计算中采用一种新改进的BM算法，然后提出了基于复数基的有限域快速并行乘法器和利用幂指数相减进行除法计算的有限域除法器，通过这些优化方法提高了RS译码器的速度，减少了译码延时和硬件资源使用，最后利用VHDL硬件描述语言在FPGA上实现了流水线处理的RS(255,223)译码器。 本课题实现的RS(255,223)硬件译码器的性能在国内具有领先水平，对我国以后航天项目高速数据传输系统的设计有着很大的意义。
上传时间： 2013-06-29
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本论文依据IEEE802.16a物理层对RS-CC码的参数要求，研究了RS-CC码的高速编、译码的VLSI硬件算法，同时对FPGA开发技术进行了研究，以VerilogHDL为描述语言，在Xilinx公司的FPGA上实现了高速的RS-CC编、译码器。RS译码器中，错误位置多项式和错误值多项式的求解采用无求逆单元，并具有规则数据流、易于VLSI实现的改进的欧几里德算法(MEA)；CC译码器由采用模归一化路径度量的全并行的“加比选(ACS)”模块和具有脉动阵列结构的幸存路径回溯模块组成。 在实现RS-CC译码器的过程中，分别从算法上和根据FPGA的结构特点上，对译码器做了一些优化工作，降低了硬件资源占有率和提高了译码速度。 此外，还搭建了以Xilinx公司40万等效门的FPGASpartan-Ⅲ400-4PQ208为主体，以Cypress公司的USB2.0芯片CY7C68013为高速数据接口的硬件试验平台，并在此试验平台上实现了文中的高速RS-CC编译码系统。
上传时间： 2013-06-03
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