专辑类-网络及电脑相关专辑-114册-4.31G TCP-IP详解.CISCO详解-273M.zip
上传时间： 2013-04-24
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专辑类-网络及电脑相关专辑-114册-4.31G ip地址管理与子网划分-5.3M-PDF.zip
上传时间： 2013-07-21
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专辑类-网络及电脑相关专辑-114册-4.31G 高级网络操作系统及其应用——TCP~IP协议与分组无线网-10.1M-PDF.pdf
上传时间： 2013-06-22
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专辑类-网络及电脑相关专辑-114册-4.31G 无线传感器网络路由协议分析-6页-0.2M.pdf
上传时间： 2013-06-30
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专辑类-网络及电脑相关专辑-114册-4.31G 移动IP技术指南-7.7M-PDF.zip
上传时间： 2013-06-17
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专辑类-网络及电脑相关专辑-114册-4.31G CISCO路由详解-95M-pdf版.zip
上传时间： 2013-04-24
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专辑类-网络及电脑相关专辑-114册-4.31G Cisco-TCP_IP路由管理专业参考-第3版-19.7M-PDF.zip
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上传时间： 2013-07-27
上传用户：nbdedu
随着生活水平的提高，人们越来越关注自己的身体健康，血压是反映人体生理状况的最重要指标之一，正常的血压是保证身体健康的重要条件。 另外血压也是重症病人监护的重要指标，准确、及时地监测血压，对于了解病情、诊断疾病和保障危重病人安全都极为重要。因此，研制高性能的血压监控系统具有重要的现实意义。 针对以上所述，本文提出了一种采用远程血压监控系统的解决方案，它融合计算机技术、测控技术和网络通讯技术为一体，使电子血压系统实现网络化。本系统将采集到的血压信息经处理后显示到液晶屏上，同时将此信息以TCP/IP的方式发送到网络上，这就是本设计的目的所在。 本论文在开始介绍了人体生理信号的特点及其测量条件之后，详细研究分析了血压测量原理以及舒张压和收缩压的判别。论文的重点放在系统硬件和软件两个方面的设计。在硬件方面，以ARM Cortex-M3内核的处理器LM3S8962作为控制器（内部集成有A/D转换器和以太网控制器等），使得硬件系统的设计简单化。整个硬件系统电路由六部分构成：处理器LM3S8962最小系统电路；电源模块：JTAG接口电路：血压检测模块；液晶显示模块；网络接口。其中，血压检测模块是整个系统设计的关键部分和难点部分，它主要是将袖压的直流部分和交流部分分离出来送到A/D转换器。软件方面，这个部分是第四章的系统软件的设计，首先把实时操作系统μC/OS-Ⅱ移植到处理器LM3S8962上，然后讲解了应用程序的设计（由三个部分组成），分别是A/D转换处理程序设计、液晶显示程序设计和网络通讯程序设计。论文的最后对系统的软硬件调试做了简单的介绍以及全文的总结。 关键词：TCP/IP 示波法 舒张压 收缩压 μc/OS-Ⅱ
上传时间： 2013-06-17
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随着计算机及其外围设备的发展，传统的并行接口和串行接口在灵活性和接口扩展等方面存在的缺陷愈来愈不可回避，并逐渐成为计算机通信的瓶颈。在这种情况下，通用串行总线(Universal Serial Bus，USB)诞生了。USB由于具有传输速率高、价格便宜、使用方便、灵活性高、支持热插拔、接口标准化和易于扩展等优点，目前已经成为计算机外设接口的主流技术，在计算机外围设备和消费类电子领域正获得越来越多的应用。 @@ 本文基于USB2．0协议规范，设计了一款支持高速和全速传输的USB2．0设备控制器IP核。文中着重介绍了这款设备控制器IP核的设计和FPGA验证工作，详细研究并分析了USB2．0规范，根据规范提出了一种USB2．0设备控制器整体构架方案，描述了各个功能子模块硬件电路的功能及实现。从可重用的角度出发，对设备控制器模块进行优化设计，增加多个灵活的配置选项，根据不同的应用对硬件进行配置，使其在满足要求的情况下去除冗余电路，以减少占用面积和功耗，从而使其灵活地应用于各种USB系统。本文还研究了IP核的验证方法，并对所设计的USB2．0设备控制器建立了功能完备的ModelSim仿真验证环境，搭建了FPGA硬件验证平台，设计了具有AHB接口的设备控制器和带有8051的设备控制器，并分别在FPGA平台上进行了功能验证。 @@ 本文所设计的USB2．0设备控制器IP核可配置性高，使用者可以自由配置所需端点的个数以及每个端点类型等，可以集成于多种USB系统中，适于各类USB设备的开发。本课题所取得的成果为USB2．0设备类的研究和开发积累了经验，并为后来实验室某项目测试芯片的USB数据采集提供了参考方案，也为未来USB3．0接口IP核的开发和应用奠定了基础。 @@关键词USB2．0控制器；IP核；FPGA；验证
上传时间： 2013-06-30
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DDR2 SDRAM是目前内存市场上的主流内存。除了通用计算机系统外，大量的嵌入式系统也纷纷采用DDR2内存，越来越多的SoC系统芯片中会集成有DDR2接口模块。因此，设计一款匹配DDR2的内存控制器将会具有良好的应用前景。 论文在研究了DDR2的JEDEC标准的基础上，设计出DDR2控制器的整体架构，采用自项向下的设计方法和模块化的思想，将DDR2控制器划分为若干模块，并使用Verilog HDL语言完成DDR2控制器IP软核中初始化模块、配置模块、执行模块和数据通道模块的RTL级设计。根据在设计中遇到的问题，对DDR2控制器的整体架构进行改进与完善。在分析了Altera数字PHY的基本性能的基础上，设计DDR2控制器与数字PHY的接口模块。搭建DDR2控制器IP软核的仿真验证平台，针对设计的具体功能进行仿真验证，并实现在Altera Stratix II GX90开发板上对DDR2存储芯片基本读/写操作控制的FPGA功能演示。 论文设计的DDR2控制器的主要特点是： 1.支持数字PHY电路，不需要实际的硬件电路就完成DDR2控制器与DDR2存储芯片之间的物理层接口，节约了设计成本，缩小了硬件电路的体积。 2.将配置口从初始化模块中分离出来，简化了具体操作。 3.支持多个DDR2存储芯片，使得DDR2控制器的应用范围更为广阔。 4.支持DDR2的三项新技术，充分发挥DDR2内存的特性。 5.自动DDR2刷新控制，方便用户对DDR2内存的控制。
上传时间： 2013-06-10
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