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IP规避器件

  • Xilinx可编程逻辑器件的高级应用与设计技巧(孙航)

      Xilinx可编程逻辑器件的高级应用与设计技巧   作者:孙航;出版社:电子工业出版社   内容简介:介绍了Xilinx器件的结构和特性;以及ISE及其辅助设计工具,嵌入式处理器的原理与设计,高速串行接口设计等内容。是一本比较全面介绍最新Xilinx器件和软件发展的书籍。

    标签: Xilinx 可编程逻辑器件 设计技巧

    上传时间: 2013-11-12

    上传用户:笨小孩

  • 使用LabVIEW FPGA模块设计IP核

    对于利用LabVIEW FPGA实现RIO目标平台上的定制硬件的工程师与开发人员,他们可以很容易地利用所推荐的组件设计构建适合其应用的、可复用且可扩展的代码模块。基于已经验证的设计进行代码模块开发,将使现有IP在未来应用中得到更好的复用,也可以使在不同开发人员和内部组织之间进行共享和交换的代码更好服用

    标签: LabVIEW FPGA IP核 模块设计

    上传时间: 2013-10-14

    上传用户:xiaodu1124

  • 深入剖析赛灵思(Xilinx)All Programmable三大创新器件

         深入剖析赛灵思(Xilinx)All Programmable三大创新器件:赛灵思在 28nm 节点上推出的多种新技术为客户带来了重大的超前价值,并使赛灵思领先竞争对手整整一代。赛灵思并不是简单地将现有的 FPGA 架构迁移到新的技术节点上,而是力求引领多种 FPGA 创新,并率先推出了 All Programmable 3D IC 和 SoC。   今天推出的 All Programmable 产品采用了各种形式的可编程技术,包括可编程硬件和软件、数字信号和模拟混合信号(AMS)、单晶片和多片 3D IC 方案(图 1)。有了这些全新的 All Programmable 器件,设计团队就能进一步提升可编程系统的集成度,提高整体系统性能,降低 BOM 成本,并以更快的速度向市场推出更具创新性的智能产品。

    标签: Programmable Xilinx All 赛灵思

    上传时间: 2013-10-29

    上传用户:1427796291

  • 基于Quartus II免费IP核的双端口RAM设计实例

      QuartusII中利用免费IP核的设计   作者:雷达室   以设计双端口RAM为例说明。   Step1:打开QuartusII,选择File—New Project Wizard,创建新工程,出现图示对话框,点击Next;

    标签: Quartus RAM IP核 双端口

    上传时间: 2013-10-18

    上传用户:909000580

  • 基于FPGA的GPIB接口IP核的研究与设计

    基于FPGA的GPIB接口IP核的研究与设计

    标签: FPGA GPIB 接口 IP核

    上传时间: 2013-10-19

    上传用户:wudu0932

  • ISE新建工程及使用IP核步骤详解

    ISE新建工程及使用IP核步骤详解

    标签: ISE IP核 工程

    上传时间: 2015-01-01

    上传用户:liuxinyu2016

  • 连接图器件

    连接图器件

    标签: 连接 器件

    上传时间: 2013-11-11

    上传用户:bioequ

  • 基于FPGA的DDS IP核设计方案

    以Altera公司的Quartus Ⅱ 7.2作为开发工具,研究了基于FPGA的DDS IP核设计,并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件,结合32位嵌入式CPU软核Nios II,构成可编程片上系统(SOPC),利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成,利用 SOPC技术,在一片 FPGA 芯片上实现了整个信号源的硬件开发平台,达到既简化电路设计、又提高系统稳定性和可靠性的目的。

    标签: FPGA DDS IP核 设计方案

    上传时间: 2013-12-22

    上传用户:forzalife

  • 赛灵思ZYNQ-7000EPP系列开辟新型器件先河

    赛灵思ZYNQ-7000EPP系列开辟新型器件先河

    标签: ZYNQ 7000 EPP 赛灵思

    上传时间: 2013-10-17

    上传用户:wangzhen1990

  • wp379 AXI4即插即用IP

    In the past decade, the size and complexity of manyFPGA designs exceeds the time and resourcesavailable to most design teams, making the use andreuse of Intellectual Property (IP) imperative.However, integrating numerous IP blocks acquiredfrom both internal and external sources can be adaunting challenge that often extends, rather thanshortens, design time. As today's designs integrateincreasing amounts of functionality, it is vital thatdesigners have access to proven, up-to-date IP fromreliable sources.

    标签: AXI4 379 wp 即插即用

    上传时间: 2013-11-11

    上传用户:csgcd001