High volume USB 2.0 devices will be designed using ASIC technology with embedded USB 2.0 support. For full-speed USB devices the operating frequency was low enough to allow data recovery to be handled in a vendors VHDL code, with the ASIC vendor providing only a simple level translator to meet the USB signaling requirements. Today s gate arrays operate comfortably between 30 and 60 MHz. With USB 2.0 signaling running at hundreds of MHz, the existing design methodology must change.
标签： technology 2.0 USB designed
上传时间： 2017-07-05
上传用户：zhoujunzhen
ASIC中的异步时序设计文档，提供了ASIC设计中处理异步时序的方法
上传时间： 2017-07-08
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上传时间： 2021-12-28
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上传时间： 2022-01-29
上传用户：xsr1983
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上传时间： 2022-04-12
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