针对输电线路纵联差动保护中常用的常规比率差动保护、复式比率差动保护、故障分量复式比率差动保护的不同特点，采用ATP-EMTP仿真软件模拟的方法，结合这3种判据经高阻发生故障的试验，得出各判据的抗过渡电阻的能力的结论，以便解决差动保护的可靠性和灵敏度问题。
上传时间： 2014-12-24
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PCA9517 是一款基于CMOS 工艺的低电压I2C 中继器，在I2C 总线或SMBus 应用中进行高低电压转换。PCA9517 能够在电平转换期间保持总线所有的操作模式和特性，通过数据线（SDA）和时钟线（SCL）的双向缓存实现I2C 总线扩展，总线最大容性负载为400pF。PCA9517 能够隔离器件总线两端的电压和容性负载。SDA 和SCL 引脚具有过压保护功能，在掉电的情况下为高阻状态。
上传时间： 2013-10-08
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1 概述由于在某些通讯设计应用中，需要扩展更多的串口数量，比如车床监控、纺织仪器检测和网状连接的数据采集等应用。为此成都国腾微电子有限公司推出的GM814x 可以满足多个同类产品的并联扩展，并且能简单的实现电路连接和程序控制，主MCU 可以识别数据的来源和指定和某个GM814x 通信。2 应用说明2.1 CS 与SPI 的数据通信GM814x 的CS（片选）引脚可用于控制SPI 总线时钟有效性，CS 低电平有效，内部下拉。CS 有效时，允许芯片的时钟接收和数据收发；无效时，SCLK、DIN 和DOUT 均为高阻状态，GM814x 不响应SPI 上的数据收发，但能正常收发子串口数据和产生相应中断。2.2 应用建议当使用GM814x 的应用需要扩展4 个以上的串口数量时，就需要使用2 片以上的GM814x。扩展的方式也有多种。方式一：将多个GM814x 的SPI 接口接在主MCU 的SPI 总线上，然后将所有GM814x 的中断进行线与后连接到MCU 的IRQ 上，同时将各GM814x 的IRQ 输出又连接到MCU的IO，以便MCU响应中断后检测是具体哪一个GM814x 输出的中断，然后再拉低对应的CS，拉高其它GM814x的CS，并执行通信操作。方式二：如果扩展的GM814x 数量较多，采用上述扩展方式可能会占用MCU较多的IO 资源，则可以将GM814x 的中断输出连接到具有OC 输出的与门芯片上，再输出到MCU 的中断输入。同时又将所有的GM814x 的中断输出进行编码输入到MCU，以供其判断产生中断的是哪一个GM814x。方式三：将所有GM814x 的中断输出连接到优先编码器进行编码输出，同时编码器也能输出低电平信号给MCU 作为中断响应。MCU 检测编码数据以获知产生中断的GM814x，然后进行数据通信处理。这种方式电路最简单，占用MCU 的IO 资源也最少。 举例：使用MCS51 单片机扩展8 片GM814x。本电路中，采用了上述提到的第三种扩展方式。通过普通的MCS51 单片机扩展最多8 片GM814x，可扩展最多32 个标准串口。为了节省MCU的IO 资源，电路中增加了一片8-3 线优先编码器74LS348 和一片3-8 线译码器74HC138。8 片GM814x 的IRQ 中断通过一片74LS348 输出中断源向量，同时产生GS 低电平信号到MCS51 的外部中断0 上，MCS51 响应中断后，可查询A0~A2 的值确定产生中断的GM814x，然后MCU 使能74HC138，输出对应的ABC 信号选中产生IRQ 信号的GM814x，再进行SPI 总线上的数据通信。 示例程序：本示例程序使用C 语言描述，仅供参考。 由于74LS348 是优先编码器，多个中断同时产生的时候，74LS348 的编码只会指示输入编号上最高的IRQ，MCU 无法直接获知是否其它的GM814x 也产生了中断。同时GM814x 在自己的中断申请后，数据传输到第8bit 时会自动清除，所以数据接收完后如果MCU 的中断引脚仍然为低，则表示还有其它GM814x 的中断申请，故必须在处理完当前中断后继续查询新的中断向量。这就是上述示例程序中while 循环的目的。 以上应用建议仅供设计者参考，不代表最终实现方式，更可靠和实际的实现方式可由设计者根据自己的实际情况确定。l 示例中的数据、参数和标志字命名不代表实际产品的特性，请参考实际产品的数据手册来获取你所需要的数据。
上传时间： 2013-10-26
上传用户：suicoe
第1章 微带扇形偏置电路基本理论之一 1 第2章 扇形微带偏置理论之二 4 第3章 利用ADS仿真设计扇形微带偏置的整个过程 6 3.1 计算10GHz时四分之一波长高阻线（假设设计阻抗为100欧）的长度和宽度。 7 3.2 将高阻线和扇形微带放入电路中，并仿真和优化（注意优化的变量都有哪些） 7 3.3 仿真结果分析（关键） 9 3.4 生成版图 10 3.5 导出到autoCAD中并填充 11 第4章 有助于加深理解扇形微带偏置原理的ADS仿真分析 11 4.1 单根四分之一波长微带线的仿真 11 4.2 四分之一波长微带线+扇形微带线的仿真 12 4.3 我的理解 12
上传时间： 2013-10-15
上传用户：lanhuaying
Hyperlynx仿真应用:阻抗匹配.下面以一个电路设计为例，简单介绍一下PCB仿真软件在设计中的使用。下面是一个DSP硬件电路部分元件位置关系(原理图和PCB使用PROTEL99SE设计)，其中DRAM作为DSP的扩展Memory(64位宽度，低8bit还经过3245接到FLASH和其它芯片)，DRAM时钟频率133M。因为频率较高，设计过程中我们需要考虑DRAM的数据、地址和控制线是否需加串阻。下面，我们以数据线D0仿真为例看是否需要加串阻。模型建立首先需要在元件公司网站下载各器件IBIS模型。然后打开Hyperlynx,新建LineSim File(线路仿真—主要用于PCB前仿真验证)新建好的线路仿真文件里可以看到一些虚线勾出的传输线、芯片脚、始端串阻和上下拉终端匹配电阻等。下面，我们开始导入主芯片DSP的数据线D0脚模型。左键点芯片管脚处的标志，出现未知管脚，然后再按下图的红线所示线路选取芯片IBIS模型中的对应管脚。 3http://bbs.elecfans.com/ 电子技术论坛 http://www.elecfans.com 电子发烧友点OK后退到“ASSIGN Models”界面。选管脚为“Output”类型。这样，一样管脚的配置就完成了。同样将DRAM的数据线对应管脚和3245的对应管脚IBIS模型加上(DSP输出，3245高阻，DRAM输入)。下面我们开始建立传输线模型。左键点DSP芯片脚相连的传输线，增添传输线，然后右键编辑属性。因为我们使用四层板，在表层走线，所以要选用“Microstrip”，然后点“Value”进行属性编辑。这里，我们要编辑一些PCB的属性，布线长度、宽度和层间距等，属性编辑界面如下：再将其它传输线也添加上。这就是没有加阻抗匹配的仿真模型(PCB最远直线间距1.4inch，对线长为1.7inch)。现在模型就建立好了。仿真及分析下面我们就要为各点加示波器探头了，按照下图红线所示路径为各测试点增加探头：为发现更多的信息，我们使用眼图观察。因为时钟是133M，数据单沿采样，数据翻转最高频率为66.7M，对应位宽为7.58ns。所以设置参数如下：之后按照芯片手册制作眼图模板。因为我们最关心的是接收端(DRAM)信号，所以模板也按照DRAM芯片HY57V283220手册的输入需求设计。芯片手册中要求输入高电平VIH高于2.0V，输入低电平VIL低于0.8V。DRAM芯片的一个NOTE里指出，芯片可以承受最高5.6V，最低-2.0V信号(不长于3ns)：按下边红线路径配置眼图模板：低8位数据线没有串阻可以满足设计要求，而其他的56位都是一对一，经过仿真没有串阻也能通过。于是数据线不加串阻可以满足设计要求，但有一点需注意，就是写数据时因为存在回冲，DRAM接收高电平在位中间会回冲到2V。因此会导致电平判决裕量较小，抗干扰能力差一些，如果调试过程中发现写RAM会出错，还需要改版加串阻。
上传时间： 2013-12-17
上传用户：debuchangshi
对电压测量电路的基本要求是其应具有高输入阻抗，文章设计了几种实用的电压测量电路，即场效应管差分式电路、高阻型集成运放构成的电路、高稳定度与高增益集成运放构成的电路。这些电压测量电路具有很高的输入阻抗，因而可有效地减小测量误差，提高准确度。
上传时间： 2014-01-16
上传用户：Andy123456
TLV1544与TMS320VC5402通过串行口连接，此时，A／D转换芯片作为从设备，DSP提供帧同步和输入／输出时钟信号。TLV1544与DSP之间数据交换的时序图如图3所示。 开始时， 为高电平（芯片处于非激活状态），DATA IN和I/OCLK无效，DATAOUT处于高阻状态。当串行接口使CS变低（激活），芯片开始工作，I／OCLK和DATAIN能使DATA OUT不再处于高阻状态。DSP通过I／OCLK引脚提供输入／输出时钟8序列，当由DSP提供的帧同步脉冲到来后，芯片从DATA IN接收4 b通道选择地址，同时从DATAOUT送出的前一次转换的结果，由DSP串行接收。I／OCLK接收DSP送出的输入序列长度为10～16个时钟周期。前4个有效时钟周期，将从DATAIN输入的4 b输入数据装载到输入数据寄存器，选择所需的模拟通道。接下来的6个时钟周期提供模拟输入采样的控制时间。模拟输入的采样在前10个I／O时钟序列后停止。第10个时钟沿（确切的I／O时钟边缘，即上升沿或下降沿，取决于操作的模式选择）将EOC变低，转换开始。
上传时间： 2014-12-05
上传用户：yepeng139
TLC549是一种采用8位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、8位A/D转换器、数据寄存器以及控制逻辑电路。TLC549每25uS重复一次“输入—转换—输出”。器件有两个控制输入：I/O CLOCK和片选（CS）。 内部系统时钟和I/O CLOCK可独立使用。应用电路的设计只需利用I/O时钟启动转换或读出转换结果。当CS为高电平时，DATA OUT处于高阻态且I/O时钟被禁止。
上传时间： 2014-01-17
上传用户：qiaoyue
LTC1446是一种采用12位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、12位A/D转换器、数据寄存器以及控制逻辑电路。LTC1446每25uS重复一次“输入——转换——输出”。器件有两个控制输入：DIN CLK和片选（CS）。 内部系统时钟和DIN CLK可独立使用。应用电路的设计只需利用时钟启动转换或读出转换结果。当CS为高电平时， Dout处于高阻态且DIN时钟被禁止。
上传时间： 2014-01-23
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用单片机的I/O口模拟I2C协议 I2C用IO模拟程序网上范例最多的就是51的程序了,这些范例的正确性无需怀疑.但是如果直接以它为蓝本将它"AVR化",一不留神,就会有点问题了. 这要从I2C的硬件规范和AVR及51单片机的IO口说起.I2C要求SCL,SDA二线都有 线与 功能,即I2C驱动口应该是 漏极开路 电路,其高电平的维持是靠上拉电阻来实现的, 而低电平则需要驱动口的强下拉能力. 51单片机IO口正好完全符合这个特性.写起I2C驱动颇为得心应手.但是AVR的IO口强大了,它输出的高电平是实实在在的高电平,而不是靠什么上拉电阻来提供,只有10mA都不到的电流!于是如果直接使用 PORTB_Bit0 = 1这样的操作,就不能满足I2C的线与功能了,如果此时有别的设备要将SCL或者SDA拉低,那么结果就是二个IO口打架,谁赢谁输不得而知,时间长了,多半是两败俱伤,芯片发热吧. 当然AVR的IO口自然有办法满足I2C的电气特性要求,不就是不能输出1么,那么用它的高阻状态即可(DDRB_Bit0=0,PORTB_Bit0=0即可),要输出0么(DDRB_Bit0=1,PORTB_Bit0=0).
上传时间： 2016-07-19
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