DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低.
标签： signal_out signal_in DPLL 模
上传时间： 2013-12-26
上传用户：希酱大魔王
(1) 315、433、868、915Mh的ISM 和SRD频段 (2) 最高工作速率500kbps，支持2-FSK、GFSK和MSK调制方式 (3) 高灵敏度（1.2kbps下-110dDm，1％数据包误码率） (4) 内置硬件CRC 检错和点对多点通信地址控制 (5) 较低的电流消耗（RX中，15.6mA，2.4kbps,433MHz） (6) 可编程控制的输出功率，对所有的支持频率可达+10dBm (7) 支持低功率电磁波激活功能 (8) 支持传输前自动清理信道访问（CCA），即载波侦听系统 (9) 快速频率变动合成器带来的合适的频率跳跃系统 (10) 模块可软件设地址，软件编程非常方便 (11) 标准DIP间距接口，便于嵌入式应用 (12) 单独的64字节RX和TX数据FIFO
上传时间： 2016-06-21
上传用户：anng
外围组件接口技术（Peripheral Component Interconnect PCI）是一种新型的高带宽、处理器无关的总线系统。它既可以作为中间层的总线也可以作为周边总线系统使用。与其他普通总线规范想对照，PCI 总线为高速I/O设备提供了更好的支持（比如图形适配器、网络接口控制器、磁盘控制器，等等）。现行的标准允许在33Mhz下使用64根数据线，纯传输速率可达2.11Gbps。但是PCI吸引人的地方不在于它的高速度，它适应了现代I/O设备对系统的要求，并且只需要很少的芯片就可以实现并支持其他总线系统。
标签： Interconnect Peripheral Component PCI
上传时间： 2017-01-17
上传用户：qb1993225
AD779x 系列产品常见问题解答AD7798/AD7799均为适合高精度测量应用的低功耗、低噪声、完整模拟前端，内置一个低噪声16位/24位Σ-Δ型ADC，其中含有3个差分模拟输入，还集成了片内低噪声仪表放大器，因而可直接输入小信号。当增益设置为64、更新速率为4.17Hz时，AD7799的均方根（RMS）噪声为27nV，AD7798的均方根（RMS）噪声为40nV.
上传时间： 2017-02-17
上传用户：水口鸿胜电器
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上传时间： 2021-11-16
上传用户：kingwide
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标签： lte
上传时间： 2021-11-19
上传用户：fliang
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标签： lte
上传时间： 2021-11-19
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标签： lte
上传时间： 2021-11-19
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标签： lte
上传时间： 2021-11-25
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标签： mimo
上传时间： 2022-01-26
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