阐述了一种数字接收系统的设计，由ADC器件AD6640和DSP. FPGA组成，具有结构灵活、扩展能力强等特点。本文详细介绍了该系统的结构和接口设计。
上传时间： 2013-06-18
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心血管系统疾病是现今世界上发病率和死亡率最高的疾病之一。T波交替(T-wavealtemans,TWA)作为一种非稳态的心电变异性现象，是指心电T波段振幅、形态甚至极性逐拍交替变化。大量研究表明，TWA与室性心律失常、心脏性猝死等有直接密切的关系，已成为一种无创独立性预测指标。随着数字信号处理技术和计算机技术的迅速发展，微伏级的TWA已经可以被检出，并且精度越来越高。本文以T波交替检测为中心，基于ARM给出了T波交替检测技术原理性样机的硬件及软件，实现实时监护的目的。 在TWA检测研究中，需要对心电信号进行预处理，即信号去噪和特征点检测。小波分析以其多分辨率的特性和表征时频两域信号局部特征的能力成为我们选取的心电信号自动分析手段。文中采用小波变换将原始心电信号分解为不同频段的细节信号，根据三种主要噪声的不同能量分布，采用自适应阈值和软硬阈值折衷处理策略用阈值滤波方法对原始信号进行去噪处理：同时基于心电信号的特征点R峰对应于Mexican-hat小波变换的极值点，因此我们使用Mexican-hat小波检测R峰，通过附加检测方案确保了位置的准确性，并根据需要提出了T波矩阵提取方法。 随后文章介绍了T波交替的产生机理及研究进展，分别从临床应用和检测方法上展现了目前TWA的发展进程，并利用了谱分析法、相关分析法和移动平均修正算法分别从时域和频域对一些样本数据进行T波交替检测。在检测中谱分析法抗噪能力较强，但作为一种频域检测方法，无法检测非稳态TWA信号，而相关分析法受呼吸、噪声影响较大，数据要求较高，因此可以在谱分析检测为阳性TWA基础上，再对信号进行相关分析，从而克服自身算法缺陷，确定交替幅度和时间段。最后对影响检测结果的因素进行讨论研究，从而降低检测误差。 文章还设计了T波交替检测技术原理性样机的关键部分电路和软件框架。硬件部分围绕ARM核的Samsung S3C44BOX为核心，设计了该样机的关键电路，包括采集模块、数据处理模块(外部存储电路、通信接口电路等)。其中在采集模块中针对心电信号是微弱信号并且干扰大的特点，采用了具有高共模抑制比和高输入阻抗的分级放大电路，有效的提取了信号分量：A/D转换电路保证了信号量化的高精度。利用USB接口芯片和删内部异步串行通讯实现系统与外界联系。系统软件中首先介绍了系统的软件开发环境，然后给出了心电信号分析及处理程序设计流程图及实现，使它们共同完成系统的软件监护功能。
上传时间： 2013-07-27
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嵌入式网络视频监控系统是一种以嵌入式技术、视频编码技术和网络传输技术为核心的新型视频监控系统，它在稳定性、实时性、处理速度、功能、价格、扩展性等方面和传统的视频监控系统相比有着突出的优势，同时也代表着目前视频监控系统研究和发展的方向。 本文研究并实现了以微处理器S3C2440和嵌入式Linux操作系统为核心的嵌入式网络视频监控系统。论文首先介绍了嵌入式视频监控技术的发展趋势和研究现状，而后阐述了该系统硬件总体设计方案，讨论了基于嵌入式Linux操作系统的开发平台的构建，详细论述了视频采集、编码、存储、传输等单元的软硬件设计，重点论述了基于AL9V576的视频编码模块和基于TW2835的视频处理模块的设计。 本文研究的主要内容如下： 1、研究视频采集单元的优化方法，设计采用音视频控制器TW2835采集四路模拟视频输入信号并叠加OSD环境信息显示，提高了视频处理的功能和视频质量； 2、研究双核构架，采用混合信号系统级芯片C8051F340控制TW2835、采集环境信息并与S3C2440串口通信，使视频采集单元模块化设计，增加了产品设计的灵活性，减小了主控芯片的负担和软件设计的复杂性，便于产品功能的扩展和二次开发； 3、研究并分析了MPEG-4的硬件实现方式，采用高品质、高性能、低功率视频压缩芯片AL9V576进行MPEG-4编码，大幅提升了压缩效率，另外还设计了SRAM主机接口与主控芯片通信，突破了传统芯片大多采用的PCI接口的限制，方便模块的组合； 4、研究并设计了CF卡存储方案，实现了一种在嵌入式视频服务器上的视频检索和存储方法。
上传时间： 2013-05-16
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随着对高处理能力、网络通信、实时多任务,超低功耗这些需求的增长,传统8位处理器已经不能满足新产品的要求了,高端嵌入式处理器已经得到了普遍的重视和应用.ARM是目前嵌入式领域应用最广泛的RISC微处理器结构,该文研究了基于ARM处理器的嵌入式系统的开发,介绍了利用一款ARM微处理器和FPGA设计的四路E1中继板卡的硬件结构和工作原理,并在这个硬件平台上进行软件开发的过程.该四路E1收发器能够提供四条E1链路,把带宽从2Mbps提高到8Mbps,能够同时负载120个用户的通信,解决了数字环路系统中卡槽数目限制的问题.目前,建立在G. 703基础上的El接口在分组网、帧中继网、GSM移动基站及军事通信中得到广泛的应用,传送语音信号、数据、图像等业务.文中首先分析了当前数字环路系统的发展现状和趋势,随着网络通信的用户数目及信息量的猛增,拓宽数据传输的通道是一项研究热点,这是开发四路E1收发器的一个目的.接着叙述了数字环路系统的结构和工作原理,即四路E1收发器的应用环境,着重介绍了四路E1板卡在整个系统中所扮演的角色和嵌入式处理器ARM的体系结构和特点,鉴于数据传输中对时钟的要求比较严格,该文还介绍了FPGA技术,应用它主要是为系统提供各个精确的时钟.然后,在分析了四路E1收发器的工作原理和比较了各类处理器特点的基础上,提出了四路E1收发器的硬件设计,分别介绍了时钟模块、系统接口电路、存储系统模块、四通道E1合成器模块、CPU模块以及时隙交换模块.接着,在研究分析了G.703和G.704等通信协议后,再根据系统要求提出了四路E1收发器的软件设计.先介绍了实时操作系统RTXC,详细阐述了ARM处理器启动代码程序的设计,然后给出了在此操作系统下软件设计的整体结构,分四个任务分别阐述此软件功能,其中详细介绍了信令处理模块、接口中断处理模块、系统运行监测模块和RC消息LC消息处理模块.最后介绍了软件和硬件的调试方法以及设计过程中的调试开发过程,整个系统设计完成后,经过反复调试、测验已达到了预期的效果,现正投入使用中.
上传时间： 2013-04-24
上传用户：梦雨轩膂
随着社会的发展，网络视频监控系统已经成为日常生产生活中的重要辅助设备，应用十分广泛。当前视频监控系统正逐步由模拟化走向数字化，随着视频压缩技术和网络技术的发展，开发新一代的基于计算机网络和多媒体MPEG-4压缩算法的视频监控系统已成为整个行业技术发展的主要方向之一。人们有时会采用DSP与MPEG-4算法结合的方案来实现，也有的部门采用了片上系统(SOC)，但这些不但编程极度复杂，而且成本也过高。本文提出并研究设计了一种基于ARM微处理器S3C2410、MPEG-4专用压缩芯片MPG440、以嵌入式Linux为操作系统的视频监控系统方案，不仅开发便捷、成本低廉，而且实时性较好，适应范围广。 首先，采用软硬件协同设计的思想提出了系统的总体设计方案，系统的整体架构分为摄像头、云台控制器、网络视频服务器以及客户端PC机等四大部分。 第二，以三星公司的S3C2410芯片和DAVICOM公司的DM9000以太网接口芯片为硬件核心，对整个系统进行了模块化的硬件电路的设计。根据S3C2410的特点及系统整体需求，完成了电源复位模块、晶振模块、存储器接口模块、视频数据处理模块、以太网接口模块、云台控制模块等的硬件选型与电路连接。其中，在云台控制模块等的电路设计中充分体现了优化设计的技巧，并重点对网络接口部分和视频数据处理部分进行了详细的硬件设计与说明。阐述了整个系统的工作流程。 第三，从应用需求出发，选择嵌入式Linux操作系统作为本系统的软件平台，搭建了交叉式的开发环境，对bootloader进行了选择，并给出了加载步骤。完成了对嵌入式Linux内核的选择及移植。 第四，采用基于任务的设计方法对服务器端的软件进行了总体设计，主要包括共用程序库、config配置文件、日志文件以及多个任务等。并对运行于客户端的软件设计进行了简要说明。 第五，由于数字视频传输的实时性能和通过网络传输以后客户端接收的视频图像质量在本系统中至关重要，所以本文对传输信道和网络协议进行了优化选择，并详细阐述了IP组播技术、流媒体传输协议等在图像传输过程中的具体应用。
上传时间： 2013-04-24
上传用户：sc965382896
激光测距技术被广泛应用于现代工业测量、航空与大地的测量、国防及通信等诸多领域。本文从已获得广泛应用的脉冲激光测距技术入手，重点分析了近年提出的自触发脉冲激光测距技术(STPLR)特别是其中的双自触发脉冲激光测距技术(BSTPLR)，通过分析发现其核心部件之一就是用于测量激光脉冲飞行时间(周期)的高精度高速计数器，而目前一般的方式是采用昂贵的进口高速计数器或专用集成电路(ASIC)来完成，这使得激光测距仪在研发、系统的改造升级和自主知识产权保护等诸多方面受到制约，同时在其整体性能上特别是在集成化、小型化和高可靠性方面带来阻碍。为此，本文研究了采用现场可编程门阵列(FPGA)来实现脉冲激光测距中的高精度高速计数及其他相关功能，基本解决了以上存在的问题。 论文通过对双自触发脉冲激光测距的主要技术要求和技术指标进行分析，对其中的信号处理单元采用了FPGA+单片机的设计形式。由FPGA主控芯片(EPF10K20TC144-4)作为周期测量模块，在整个测距系统中是信号处理的核心部件，借助其用户可编程特性及很高的内部时钟频率，设计了专用于BSTPLR的高速高精度计数芯片，负责对测距信号产生电路中的时刻鉴别电路输出信号进行计数。数据处理模块则主要由单片机(AT89C51)来实现。系统可以通过键盘预置门控信号的宽度以均衡测量的精度和速度，测量结果采用7位LED数码管显示。本设计在近距离(大尺寸)范围内实验测试时基本满足设计要求。
上传时间： 2013-04-24
上传用户：dapangxie
该文就多媒体信息的主体之一-图像信号的压缩和解压进行了分析,并结合实际课题所设计的数字图像监控系统对其中的图像解码过程进行了软硬件的实现.首先我们在ANALOG DEVICE公司的ADSP-2189上进行了解码系统的验证,就解码输出的质量进行了主观评价.通过软件仿真,我们还进一步得到了解码过程中,哪些指令占用较多的指令执行时间,哪些指令会成为硬件实现时的瓶颈.它为我们的FPGA优化设计提供了理论上的依据.综合考虑设计方案的复杂程度、系统规模、系统时延、器件成本等各项因素,通过对各种FPGA器件性能与开发工具的选择比较,决定选用Altera公司的FLEX10K器件来做最终的硬件实现.它不仅为图像解码系统的ASIC实现做了一定的理论分析和技术准备,也为FPGA技术在数字信号处理领域的应用开辟了新的研究方向.在硬件设计过程中,根据FPGA技术的优点,采用"自上而下"和"自下而上"相结合的设计方法,将整个系统进行功能模块分割并分别实现.所有处理模块均采用VERILIG语言编写,对其中的主要模块都进行了优化设计.通过这些优化不仅提高了解压性能,还减少了处理时间和所占用的硬件空间.最后通过仿真表明了所实现的图像解码系统具有良好的性能,具有一定的使用价值.
上传时间： 2013-06-26
上传用户：再见大盘鸡
单片微型计算机(单片机)是将微处理器CPU、程序存储器、数据存储器、定时/计数器、输入/输出并行接口等集成在一起。由于单片机具有专门为嵌入式系统设计的体系结构与指令系统，所以它最能满足嵌入式系统的应用要求。Intel公司生产的MCS-51系列单片机是我国目前应用最广的单片机之一。 随着可编程逻辑器件设计技术的发展，每个逻辑器件中门电路的数量越来越多，一个逻辑器件就可以完成本来要由很多分立逻辑器件和存储芯片完成的功能。这样做减少了系统的功耗和成本，提高了性能和可靠性。FPGA就是目前最受欢迎的可编程逻辑器件之一。IP核是将一些在数字电路中常用但比较复杂的功能块，设计成可修改参数的模块，让其他用户可以直接调用这些模块，这样就大大减轻了工程师的负担，避免重复劳动。随着FPGA的规模越来越大，设计越来越复杂，使用IP核是一个发展趋势。 本课题结合FPGA与8051单片机的优点，主要针对以下三个方面研究： (1)FPGA开发平台的硬件实现选用Xilinx公司的XC3S500E-PQ208-4-C作为核心器件，采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作为片内程序存储器，搭建FPGA的硬件开发平台。 (2)用VHDL语言实现8051IP核分析研究8051系列单片机内部各模块结构以及各部分的连接关系，实现了基于FPGA的8051IP核。主要包括如下几个模块：CPU模块、片内数据存储器模块、定时/计数器模块、并行端口模块、串行端口模块、中断处理模块、同步复位模块等。 (3)基于FPGA的8051IP核应用用所设计的8051IP核，实现了对一个4×4键盘的监测扫描、键盘确认、按键识别等应用。
上传时间： 2013-04-24
上传用户：1417818867
随着嵌入式技术的不断发展和现代通讯技术的日臻成熟与完善，手机作为这两种技术紧密结合的典型代表，成为众多开发人员设计与创新的焦点。为了适应社会的需求，目前很多高校都开设了与此相关的课程。本文首次提出一套基于嵌入式系统的手机编程开发平台教学系统。如何合理设计开发平台，为高等院校提供一种功能完备、价格低廉、技术流行、能满足教学和开发双重需求的手机编程开发平台正是本课题研究和解决的重点。 本论文在研究手机硬件体系结构和软件体系结构的基础上，主要研究了已有手机平台的基本结构特点以及所需要的基本核心技术，进而提出了本课题研究的手机平台结构，共分以下三部分： 1．硬件平台：划分为通讯模块单元、基于ARM的应用处理模块单元以及输入输出模块单元，这三部分相互独立设计并能单独完成各自任务，同时设计统一接口规范，使这三大部分能够方便的连接在一起，协同工作，完成手机功能。这种模块化的设计方法，为整体系统的开发、调试与升级提供了便利。 2．软件平台：分为Bootloader、操作系统、驱动程序以及GUI。这四部分彼此独立又相互联系。设计时可以根据实际需要，开发的难易程度，开销与维护成本等多方面考虑，灵活设计。 3．应用软件：这部分主要是基于通讯协议的软件开发与编程实战。 本课题最终完成了硬件的全部设计并调试成功，实现了手机编程开发平台软件平台的设计及应用软件的开发。同时针对各部分内容编写配套的实验指导手册并在教学实践中取得初步成功。
上传时间： 2013-05-17
上传用户：qwe1234
USB2．0接口和基于ARM核的SOC系统的应用已经非常广泛，特别在电子消费类领域。包含USB2,0接口的ARM系统则更是市场的需求。本文介绍一种基于ARM核的USB2,0接口IP(AHB_USB2.0)的设计，主要对其中的串行接口引擎(SIE)的设计进行讨论。 该 AHB_USB2.0 IP核支持USB2.0协议，并兼容USB1.1协议；支持AMBA2.0协议和UTMI 1.05协议。该IP核一侧通过UTMI接口或ULPI接口的PHY与USB2.0主机端进行通信；另一侧则通过AHB总线与ARM相连。 AHB_USB2.0 IP核在硬件上分为三个大模块：ULPI模块(ULPI)、串行接口引擎(SIE)模块和AHB总线接口模块(AHB)。ULPI模块实现了UTMI接口转ULPI接口。串行接口引擎(SIE)模块为USB2.0的数据链路层协议处理模块，为整个IP核的核心部分，进一步分为四个子模块——GLC(全局控制模块)，PIE(PHY接口处理引擎)，SIF(系统接口逻辑)和EPB(端点缓冲模块)。GLC模块负责整个IP的复位控制，IP时钟的开关提示等；PIE模块负责处理USB的事务级传输，包括组包解包等；SIF模块负责协议相关寄存器组和端点缓冲区的读写，跨时钟域信号的处理和PIE所需的控制信号的产生；AHB模块负责IP核与ARM通信和DMA功能的实现。 该IP核的软件设计遵循USB协议，Bulk Only协议和UFI协议，由外挂ARM实现USB设备命令和UFI命令的解析，并执行相应的操作。设计了IP核与ARM之间的多种数据传输方法，通过软件实现常规数据读写访问、内部DMA或外部DMA等多种方式的切换。 本IP已经通过EDA验证和FPGA测试，并且已经在内嵌ARM核的FPGA系统上实现了多个U盘。这个FPGA系统的正确工作，证明了AHB_USB2.01P核设计是正确的。
上传时间： 2013-05-17
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