现场可编程门阵列(FPGA,Field Programmable Gate Array)是可编程逻辑器件的一种,它的出现是随着微电子技术的发展,设计与制造集成电路的任务已不完全由半导体厂商来独立承担。系统设计师们更愿意自己设计专用集成电路(ASIC,Application Specific Integrated Circuit).芯片,而且希望ASIC的设计周期尽可能短,最好是在实验室里就能设计出合适的ASIC芯片,并且立即投入实际应用之中。现在,FPGA已广泛地运用于通信领域、消费类电子和车用电子。 本文中涉及的I/O端口模块是FPGA中最主要的几个大模块之一,它的主要作用是提供封装引脚到CLB之间的接口,将外部信号引入FPGA内部进行逻辑功能的实现并把结果输出给外部电路,并且根据需要可以进行配置来支持多种不同的接口标准。FPGA允许使用者通过不同编程来配置实现各种逻辑功能,在IO端口中它可以通过选择配置方式来兼容不同信号标准的I/O缓冲器电路。总体而言,可选的I/O资源的特性包括:IO标准的选择、输出驱动能力的编程控制、摆率选择、输入延迟和维持时间控制等。 本文是关于FPGA中多标准兼容可编程输入输出电路(Input/Output Block)的设计和实现,该课题是成都华微电子系统有限公司FPGA大项目中的一子项,目的为在更新的工艺水平上设计出能够兼容单端标准的I/O电路模块;同时针对以前设计的I/O模块不支持双端标准的缺点,要求新的电路模块中扩展出双端标准的部分。文中以低压双端差分标准(LVDS)为代表构建双端标准收发转换电路,与单端标准比较,LVDS具有很多优点: (1)LVDS传输的信号摆幅小,从而功耗低,一般差分线上电流不超过4mA,负载阻抗为100Ω。这一特征使它适合做并行数据传输。 (2)LVDS信号摆幅小,从而使得该结构可以在2.5V的低电压下工作。 (3)LVDS输入单端信号电压可以从0V到2.4V变化,单端信号摆幅为400mV,这样允许输入共模电压从0.2V到2.2V范围内变化,也就是说LVDS允许收发两端地电势有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工艺,辅助Xilinx公司FPGA开发软件ISE,设计完成了可以用于Virtex系列各低端型号FPGA的IOB结构,它有灵活的可配置性和出色的适应能力,能支持大量的I/O标准,其中包括单端标准,也包括双端标准如LVDS等。它具有适应性的优点、可选的特性和考虑到被文件描述的硬件结构特征,这些特点可以改进和简化系统级的设计,为最终的产品设计和生产打下基础。设计中对包括20种IO标准在内的各电器参数按照用户手册描述进行仿真验证,性能参数已达到预期标准。
上传时间: 2013-05-15
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可配置端口电路是FPGA芯片与外围电路连接关键的枢纽,它有诸多功能:芯片与芯片在数据上的传递(包括对输入信号的采集和输出信号输出),电压之间的转换,对外围芯片的驱动,完成对芯片的测试功能以及对芯片电路保护等。 本文采用了自顶向下和自下向上的设计方法,依据可配置端口电路能实现的功能和工作原理,运用Cadence的设计软件,结合华润上华0.5μm的工艺库,设计了一款性能、时序、功耗在整体上不亚于xilinx4006e[8]的端口电路。主要研究以下几个方面的内容: 1.基于端口电路信号寄存器的采集和输出方式,本论文设计的端口电路可以通过配置将它设置成单沿或者双沿的触发方式[7],并完成了Verilog XL和Hspiee的功能和时序仿真,且建立时间小于5ns和保持时间在0ns左右。和xilinx4006e[8]相比较满足设计的要求。 2.基于TAP Controller的工作原理及它对16种状态机转换的控制,对16种状态机的转换完成了行为级描述和实现了捕获、移位、输出、更新等主要功能仿真。 3.基于边界扫描电路是对触发器级联的构架这一特点,设计了一款边界扫描电路,并运用Verilog XL和Hspiee对它进行了功能和时序的仿真。达到对芯片电路测试设计的要求。 4.对于端口电路来讲,有时需要将从CLB中的输出数据实现异或、同或、与以及或的功能,为此本文采用二次函数输出的电路结构来实现以上的功能,并运用Verilog XL和Hspiee对它进行了功能和时序的仿真。满足设计要求。 5.对于0.5μm的工艺而言,输入端口的电压通常是3.3V和5V,为此根据设置不同的上、下MOS管尺寸来调整电路的中点电压,将端口电路设计成3.3V和5V兼容的电路,通过仿真性能上已完全达到这一要求。此外,在输入端口处加上扩散电阻R和电容C组成噪声滤波电路,这个电路能有效地抑制加到输入端上的白噪声型噪声电压[2]。 6.在噪声和延时不影响电路正常工作的范围内,具有三态控制和驱动大负载的功能。通过对管子尺寸的大小设置和驱动大小的仿真表明:在实现TTL高电平输出时,最大的驱动电流达到170mA,而对应的xilinx4006e的TTL高电平最大驱动电流为140mA[8];同样,在实现CMOS高电平最大驱动电流达到200mA,而xilinx4006e的CMOS驱动电流达到170[8]mA。 7.与xilinx4006e端口电路相比,在延时和面积以及功耗略大的情况下,本论文研究设计的端口电路增加了双沿触发、将输出数据实现二次函数的输出方式、通过添加译码器将配置端口的数目减少的新的功能,且驱动能力更加强大。
上传时间: 2013-07-20
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:准确地在线测量直流母线电压、电流及输出的三相电流信号,是设计高性能 变频器产品的必备条件之一,本文通过对电压、电流检测方案比较、分析,提供了设计 变频器中具有很好参考价值的几种实用电路,并给出了相应的实验结果。
上传时间: 2013-07-21
上传用户:几何公差
系统采用ATME189S52 为微控制器(MCE)核心,实现了可控的恒定直流电流源设计。核心恒流模块采用自反馈电路连接大功率场效应管IRFZ44NL,使得电流输出范围达到20~2000
上传时间: 2013-07-05
上传用户:cy_ewhat
电池作为手持设备中的电源,通常直接给升压DC/DC 转换器供电。由于升压DC/DC 转化器本身拓扑结构的缺陷,从电池到负载始终有一条电流通路,如图1 所示。一旦负载短路到地(GND),短路产生
上传时间: 2013-04-24
上传用户:mopdzz
常规的压控电源采用的是并联电流负反馈电路,这种电路输出电压柔性较差,电压输出效率低,因为取样电阻要占掉很大一部分的电压,并且常规的压控电流源不能实现一端接地,这也是并联电流负反馈本身的
上传时间: 2013-07-02
上传用户:yyyyyyyyyy
SD4840/4841/4842/4843/4844是用于开关电源的内置高压MOSFET电流模式PWM控制器系列产品。该电路待机功耗低,启动电流低。在待机模式下,电路进入打嗝模式,从而有效地降低电路的
上传时间: 2013-04-24
上传用户:gcs333
说明了电子负载原理。附带电路图,想了解电子负载的下
标签: 电子负载
上传时间: 2013-06-27
上传用户:ylwleon
随着现代电力系统向大容量、高电压方向发展,广泛用于大型发电机组测量和保护用的大电流互感器的研制就变得很紧迫。考虑到大电流互感器具有大电流、强电磁干扰和多相运行等特点,在设计大电流互感器时,必须采取有效的屏蔽措施,屏蔽来自邻相的杂散磁通。传统的屏蔽方案是采用金属屏蔽罩,尽管有效,但设备笨重。本文中,作者对有外层屏蔽绕组的大电流互感器进行了各种研究。 大电流互感器采用绕组屏蔽方式后,如何优化设计屏蔽绕组,使屏蔽绕组能够充分有效地屏蔽杂散磁通对环形铁心的影响呢?针对上述的问题,本文作者主要完成如下几个方面的工作: 1、首先对国内外大电流互感器的发展与研究现状进行了叙述,并成功设计了15000/5A大电流互感器。 2、对精典的电磁场理论和场路耦合法的数学理论进行了深入的研究,建立了大电流互感器的三维场路耦合有限元分析的数学模型和仿真模型。应用有限元软件ANSYS建立三维有限元仿真模型和基于场路耦合原理的外部耦合电路。 3、理论分析了杂散磁通对电流互感器铁心的影响;重点分析了绕组屏蔽杂散磁通理论;通过等值电流法,得到无论三相还是多相电流互感器条件下,中间相的电流互感器所受到的杂散磁通是最为严重的,为大电流互感器的有效保护提供了科学依据。 4、为了得到最优化屏蔽绕组,对屏蔽绕组的匝数采用离散化替代连续性,再考虑屏蔽绕组在环形铁心上的位置,共提出了多种优化方案;根据三维场路耦合有限元分析模型,精确计算出屏蔽绕组中的电流、电流分布、环形铁心中的磁感应强度分布和外层绕组的局部最高温升,通过比较多种计算结果,得到大电流互感器屏蔽绕组的最优化方案。 5、最后建立了大电流互感器的等效磁势法和降流回路法两种试验方案模型,通过比较试验方案仿真计算结果和出厂试验结果,证明了仿真计算结果是正确的,可靠的。 通过对屏蔽绕组进行优化设计后,有效地削弱了杂散磁通,使得大电流互感器轻型化、小型化,节约了大量的铜材料,使得其运输更加方便。
上传时间: 2013-04-24
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针对常用电流模式的升压转换器结构,提出了一种高精度电流检测电路。该电路在保证响应速度的 前提下,通过增加电路环路增益,降低误差源等方法,提高检测电路的电流检测精度。与其他结构电路相 比,有结构简单,响应速度快,电流检测精度高的优点。基于Chartered 的0.35μm 的3.3 V/13.5 V CMOS 工 艺,使用Spectre 仿真器,对该电路进行了仿真与验证。结果证明,在输入电压为2.5 V~5.5 V,电感电流为 100 mA~500 mA,工作频率为1 MHz 的情况下,能够正常稳定工作,并且电流精度高达93%。
上传时间: 2013-04-24
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