基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等
上传时间： 2013-08-18
上传用户：问题问题
自己设计的Smartcard功能模块，已经通过vcs仿真和FPGA验证，可以使用。
上传时间： 2013-08-26
上传用户：小鹏
智能机器小车主要完成寻迹功能，由机械结构和控制单元两个部分组成。机械结构是一个由底盘、前后辅助轮、控制板支架、传感器支架、左右驱动轮、步进电机等组成。控制单元部分主要由主要包含传感器及其调理电路、步进电机及驱动电路、控制器三个部分。本设计的核心为控制器部分，采用Altera MAX7000S系列的EPM7064LC84-15作主控芯片。CPLD芯片的设计主要在MAX+plusⅡ10.0环境下利用VHDL语言编程实现。驱动步进电机电路主要利用ULN2803作为驱动芯片。
上传时间： 2013-08-30
上传用户：ve3344
基于CPLD的多功能信号发生器设计.PDF
上传时间： 2013-09-02
上传用户：lnnn30
一款很好的protel设计小工具增强了protel99的鼠标功能，是电路设计的好帮手
上传时间： 2013-09-11
上传用户：ming529
pcb 设计工具 altium designer6.3新功能教程，
上传时间： 2013-09-13
上传用户：wang0123456789
C8051F020芯片的多功能计数器设计
上传时间： 2014-01-24
上传用户：362279997
多功能数字钟的VHDL设计
上传时间： 2013-10-29
上传用户：swz13842860183
为了提高数字集成电路芯片的驱动能力，采用优化比例因子的等比缓冲器链方法，通过Hspice软件仿真和版图设计测试，提出了一种基于CSMC 2P2M 0.6 μm CMOS工艺的输出缓冲电路设计方案。本文完成了系统的电原理图设计和版图设计，整体电路采用Hspice和CSMC 2P2M 的0.6 μm CMOS工艺的工艺库（06mixddct02v24）仿真，基于CSMC 2P2M 0.6 μm CMOS工艺完成版图设计，并在一款多功能数字芯片上使用，版图面积为1 mm×1 mm，并参与MPW（多项目晶圆）计划流片，流片测试结果表明，在输出负载很大时，本设计能提供足够的驱动电流，同时延迟时间短、并占用版图面积小。
上传时间： 2013-10-09
上传用户：小鹏
PADS高级教程，PADS BlazeRouter功能简介之交互式高速PCB设计。 BlazeRouter设计环境
标签： BlazeRouter PADS PCB 交互式
上传时间： 2013-11-05
上传用户：浩子GG
