数字三相锁相环中含有大量乘法运算和三角函数运算,占用大量的硬件逻辑资源。为此,提出一种数字三相锁相环的优化实现方案,利用乘法模块复用和CORDIC算法实现三角函数运算,并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿真和实验结果表明,优化后的数字三相锁相环大大节省了FPGA的资源,并能快速、准确地锁定相位,具有良好的性能。
标签: FPGA 数字 三相 优化设计
上传时间: 2013-11-15
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标签: 4159 ADF ADI 锁相环
上传时间: 2013-10-27
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标签: 效能评估
上传时间: 2013-12-11
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上传时间: 2014-12-29
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标签: 电阻应变式 测量仪 转矩转速
上传时间: 2013-11-13
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标签: 压力传感器
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标签: WZPKPt 100 铂电阻
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