单片机指令系统 3.1 MCS－51指令简介 3.2 指令系统 3.1 MCS－51指令简介 二、MCS－51系列单片机指令系统分类 按寻址方式分为以下七种：按功能分为以下四种： 1、立即立即寻址 1、数据传送指令位操 2、直接寻址 2、算术运算指令 3、寄存器寻址 3、逻辑运算指令 4、寄存器间接寻址指令 4、控制转移类指令 5、相对寻址 5、位操作指令 6、变址寻址 7、位寻址 三、寻址方式 3、寄存器间接寻址 MOV A, @R1 操作数是通过寄存器间接得到的。 4、立即寻址 MOV A, #40H 操作数在指令中直接给出。 5、基址寄存器加变址寄存器寻址 以DPTR或PC为基址寄存器，以A为变址寄存器， 以两者相加形成的16位地址为操作数的地址。 MOVC A, @A+DPTR MOVC A, @A+PC 四、指令中常用符号说明 Rn——当前寄存器区的8个工作寄存器R0～R7(n＝0～7)； Ri——当前寄存器区可作地址寄存器的2个工作寄存器R0和R1(i＝0，1)； direct——8位内部数据存储器单元的地址及特殊功能寄存器的地址； #data——表示8位常数（立即数）； #datal6——表示16位常数； add 16——表示16位地址； addrll——表示11位地址； rel——8位带符号的地址偏移量； bit——表示位地址； @——间接寻址寄存器或基址寄存器的前缀； ( )——表示括号中单元的内容 (( ))——表示间接寻址的内容； 五、MCS－51指令简介 1. 以累加器A为目的操作数的指令 2. 以Rn为目的操作数的指令 3. 以直接地址为目的操作数的指令 4. 以寄存器间接地址为目的操作数指令 应用举例1 8段数码管显示 应用举例2 3.2 指令系统 2、堆栈操作指令 3. 累加器A与外部数据传输指令 4. 查表指令 MOVC A, @A+PC 例子： 5. 字节交换指令 6. 半字节交换指令 二、算术操作类指令 PSW寄存器 2. 带进位加法指令 3. 加1指令 4. 十进制调整指令 5. 带借位减法指令（Subtraction） 6. 减1指令（Decrease） 7. 乘法指令（Multiplication） 8. 除法指令（Division） 三、逻辑运算指令 1. 简单逻辑操作指令 2. 循环指令 带进位左循环指令（Rotate Accumulator Left through Carry flag） 右循环指令（Rotate Accumulator Right） 带进位右循环指令（Rotate A Right with C） 3. 逻辑与指令 4. 逻辑或指令 5. 逻辑异或指令 四、控制转移类指令 1. 跳转指令 相对转移指令 SJMP rel PC←(PC)+2 PC←(PC)+rel 程序中标号与地址之间的关系 2. 条件转移指令 3. 比较不相等转移指令 4. 减 1 不为 0 转移指令 5. 调用子程序指令 7. 中断返回指令 五、位操作指令 1. 数据位传送指令 2. 位变量逻辑指令 3. 条件转移类指令
上传时间： 2013-10-27
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PC机之间串口通信的实现一、实验目的 １．熟悉微机接口实验装置的结构和使用方法。 ２．掌握通信接口芯片8251和8250的功能和使用方法。 ３．学会串行通信程序的编制方法。 二、实验内容与要求 １．基本要求主机接收开关量输入的数据（二进制或十六进制），从键盘上按“传输”键（可自行定义），就将该数据通过8251A传输出去。终端接收后在显示器上显示数据。具体操作说明如下：（１）出现提示信息“start with R in the board!”，通过调整乒乓开关的状态，设置8位数据；（２）在小键盘上按“R”键，系统将此时乒乓开关的状态读入计算机I中，并显示出来，同时显示经串行通讯后，计算机II接收到的数据；（３）完成后，系统提示“do you want to send another data? Y/N”，根据用户需要，在键盘按下“Y”键，则重复步骤（1），进行另一数据的通讯；在键盘按除“Y”键外的任意键，将退出本程序。２．提高要求 能够进行出错处理，例如采用奇偶校验，出错重传或者采用接收方回传和发送方确认来保证发送和接收正确。 三、设计报告要求 １．设计目的和内容 ２．总体设计 ３．硬件设计：原理图（接线图）及简要说明 ４．软件设计框图及程序清单５．设计结果和体会（包括遇到的问题及解决的方法） 四、8251A通用串行输入/输出接口芯片由于CPU与接口之间按并行方式传输，接口与外设之间按串行方式传输，因此，在串行接口中，必须要有“接收移位寄存器”（串→并）和“发送移位寄存器”（并→串）。能够完成上述“串←→并”转换功能的电路，通常称为“通用异步收发器”（UART：Universal Asynchronous Receiver and Transmitter）,典型的芯片有：Intel 8250/8251。8251A异步工作方式：如果8251A编程为异步方式，在需要发送字符时，必须首先设置TXEN和CTS#为有效状态，TXEN(Transmitter Enable)是允许发送信号，是命令寄存器中的一位；CTS#(Clear To Send)是由外设发来的对CPU请求发送信号的响应信号。然后就开始发送过程。在发送时，每当CPU送往发送缓冲器一个字符，发送器自动为这个字符加上1个起始位，并且按照编程要求加上奇／偶校验位以及1个、1.5个或者2个停止位。串行数据以起始位开始，接着是最低有效数据位，最高有效位的后面是奇／偶校验位，然后是停止位。按位发送的数据是以发送时钟TXC的下降沿同步的，也就是说这些数据总是在发送时钟TXC的下降沿从8251A发出。数据传输的波特率取决于编程时指定的波特率因子，为发送器时钟频率的1、1/16或1/64。当波特率指定为16时，数据传输的波特率就是发送器时钟频率的1/16。CPU通过数据总线将数据送到8251A的数据输出缓冲寄存器以后，再传输到发送缓冲器，经移位寄存器移位，将并行数据变为串行数据，从TxD端送往外部设备。在8251A接收字符时，命令寄存器的接收允许位RxE(Receiver Enable)必须为1。8251A通过检测RxD引脚上的低电平来准备接收字符，在没有字符传送时RxD端为高电平。8251A不断地检测RxD引脚，从RxD端上检测到低电平以后，便认为是串行数据的起始位，并且启动接收控制电路中的一个计数器来进行计数，计数器的频率等于接收器时钟频率。计数器是作为接收器采样定时，当计数到相当于半个数位的传输时间时再次对RxD端进行采样，如果仍为低电平，则确认该数位是一个有效的起始位。若传输一个字符需要16个时钟，那么就是要在计数8个时钟后采样到低电平。之后，8251A每隔一个数位的传输时间对RxD端采样一次，依次确定串行数据位的值。串行数据位顺序进入接收移位寄存器，通过校验并除去停止位，变成并行数据以后通过内部数据总线送入接收缓冲器，此时发出有效状态的RxRDY信号通知CPU，通知CPU8251A已经收到一个有效的数据。一个字符对应的数据可以是5～8位。如果一个字符对应的数据不到8位，8251A会在移位转换成并行数据的时候，自动把他们的高位补成0。 五、系统总体设计方案根据系统设计的要求，对系统设计的总体方案进行论证分析如下：1．获取8位开关量可使用实验台上的8255A可编程并行接口芯片，因为只要获取8位数据量，只需使用基本输入和8位数据线，所以将8255A工作在方式0，PA0-PA7接实验台上的8位开关量。2．当使用串口进行数据传送时，虽然同步通信速度远远高于异步通信，可达500kbit/s，但由于其需要有一个时钟来实现发送端和接收端之间的同步，硬件电路复杂，通常计算机之间的通信只采用异步通信。3．由于8251A本身没有时钟，需要外部提供，所以本设计中使用实验台上的8253芯片的计数器2来实现。4：显示和键盘输入均使用DOS功能调用来实现。设计思路框图，如下图所示： 六、硬件设计硬件电路主要分为8位开关量数据获取电路，串行通信数据发送电路，串行通信数据接收电路三个部分。1．8位开关量数据获取电路该电路主要是利用8255并行接口读取8位乒乓开关的数据。此次设计在获取8位开关数据量时采用8255令其工作在方式0，A口输入8位数据，CS#接实验台上CS1口，对应端口为280H-283H，PA0-PA7接8个开关。2．串行通信电路串行通信电路本设计中8253主要为8251充当频率发生器，接线如下图所示。
上传时间： 2013-12-19
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7.1 并行接口概述并行接口和串行接口的结构示意图并行接口传输速率高，一般不要求固定格式，但不适合长距离数据传输7.2 可编程并行接口芯片82C55 7.2.1 8255的基本功能 8255具有2个独立的8位I/O口（A口和B口）和2个独立的4位I/O（C口上半部和C口下半部），提供TTL兼容的并行接口。作为输入时提供三态缓冲器功能，作为输出时提供数据锁存功能。其中，A口具有双向传输功能。8255有3种工作方式，方式0、方式1和方式2，能使用无条件、查询和中断等多种数据传送方式完成CPU与I/O设备之间的数据交换。B口和C口的引脚具有达林顿复合晶体管驱动能力，在1.5V时输出1mA电流，适于作输出端口。C口除用做数据口外，当8255工作在方式1和方式2时，C口的部分引脚作为固定的联络信号线。
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上传时间： 2013-10-25
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3.1 总线与接口概述 3.1.1 总线和接口及其标准的概念 总线：是在模块和模块之间或设备与设备之间的一组进行互连和传输信息的信号线，信息包括指令、数据和地址。 总线标准 指芯片之间、扩展卡之间以及系统之间，通过总线进行连接和传输信息时，应该遵守的一些协议与规范。 接口标准 外设接口的规范，涉及接口信号线定义、信号传输速率、传输方向和拓扑结构，以及电气特性和机械特性等多个方面。 3.1.2 总线的分类 1) 按总线功能或信号类型划分为： 数据总线：双向三态逻辑，线宽表示了总线数据传输的能力。地址总线：单向三态逻辑，线宽决定了系统的寻址能力。控制总线：就某根来说是单向或双向。控制总线最能体现总线特点，决定总线功能的强弱和适应性。2) 按总线的层次结构分为： CPU总线：微机系统中速度最快的总线，主要在CPU内部，连接CPU内部部件，在CPU周围的小范围内也分布该总线，提供系统原始的控制和命令。局部总线：在系统总线和CPU总线之间的一级总线，提供CPU和主板器件之间以及CPU到高速外设之间的快速信息通道。系统总线：也称为I/O总线，是传统的通过总线扩展卡连接外部设备的总线。由于速度慢，其功能已经被局部总线替代。通信总线：也称为外部总线，是微机与微机，微机与外设之间进行通信的总线。3.1.3 总线的主要性能参数1．总线频率：MHz表示的工作频率，是总线速率的一个重要参数。2．总线宽度：指数据总线的位数。3．总线的数据传输率 总线的数据传输率=(总线宽度/8位)×总线频率 例：PCI总线的总线频率为33.3MHz，总线宽度为64位的情况下，总线数据传输率为266MB/s 。
上传时间： 2013-11-17
上传用户：shen954166632
简要介绍了CAN总线技术与USB总线技术的特点，给出了通过将两特点相结合，并选用微控制器AT89C52尧USB控制芯片CH372和独立CAN控制芯片SJA1000实现USB-CAN数据传输系统的设计方案遥该系统不但能实现CAN总线与USB总线之间的数据转化，并可在两台主机配合下完成两个节点之间数据的透明传输。关键词 通用串行总线USB CAN总线 数据通信
上传时间： 2013-10-15
上传用户：plsee
//芯片资料请到www.elecfans.com查找 //DS1820 C51 子程序//这里以11.0592M晶体为例，不同的晶体速度可能需要调整延时的时间//sbit DQ =P2^1;//根据实际情况定义端口 typedef unsigned char byte;typedef unsigned int word; //延时void delay(word useconds){ for(;useconds>0;useconds--);} //复位byte ow_reset(void){ byte presence; DQ = 0; //pull DQ line low delay(29); // leave it low for 480us DQ = 1; // allow line to return high delay(3); // wait for presence presence = DQ; // get presence signal delay(25); // wait for end of timeslot return(presence); // presence signal returned} // 0=presence, 1 = no part //从 1-wire 总线上读取一个字节byte read_byte(void){ byte i; byte value = 0; for (i=8;i>0;i--) { value>>=1; DQ = 0; // pull DQ low to start timeslot DQ = 1; // then return high delay(1); //for (i=0; i<3; i++); if(DQ)value|=0x80; delay(6); // wait for rest of timeslot } return(value);} //向 1-WIRE 总线上写一个字节void write_byte(char val){ byte i; for (i=8; i>0; i--) // writes byte, one bit at a time { DQ = 0; // pull DQ low to start timeslot DQ = val&0x01; delay(5); // hold value for remainder of timeslot DQ = 1; val=val/2; } delay(5);} //读取温度char Read_Temperature(void){ union{ byte c[2]; int x; }temp; ow_reset(); write_byte(0xCC); // Skip ROM write_byte(0xBE); // Read Scratch Pad temp.c[1]=read_byte(); temp.c[0]=read_byte(); ow_reset(); write_byte(0xCC); //Skip ROM write_byte(0x44); // Start Conversion return temp.x/2;}
上传时间： 2013-11-03
上传用户：hongmo
并行接口电路：微处理器与I/O设备进行数据传输时均需经过接口电路实现系统与设备互连的匹配。并行接口电路中每个信息位有自己的传输线，一个数据字节各位可并行传送，速度快，控制简单。由于电气特性的限制，传输距离不能太长。8255A是通用的可编程并行接口芯片，功能强，使用灵活。适合一些并行输入/输出设备的使用。8255A并行接口逻辑框图三个独立的8位I/O端口,口A、口B、口C。口A有输入、输出锁存器及输出缓冲器。口B与口C有输入、输出缓冲器及输出锁存器。在实现高级的传输协议时，口C的8条线分为两组，每组4条线，分别作为口A与口B在传输时的控制信号线。口C的8条线可独立进行置1/置0的操作。口A、口B、口C及控制字口共占4个设备号。8255A并行接口的控制字工作模式选择控制字：口A有三种工作模式，口B有二种工作模式。口C独立使用时只有一个工作模式，与口A、口B配合使用时，作为控制信号线。三种工作模式命名为：模式0、模式1及模式2。模式 0 为基本I/O端口，模式1为带选通的I/O端口，模式 2 为带选通的双向I/O端口。口A可工作在三种模式下，口B可工作在模式 0与模式 1下，口C可工作在模式0下或作为控制线配合口A、口B工作。
上传时间： 2013-11-07
上传用户：xitai
8086总线操作：8086微处理器与片外存储器或I/O接口进行数据传输时，经BIU执行8086规定的总线操作。总线周期的组成：8086的基本总线周期为4个时钟周期，每个时钟周期间隔称为一个T状态。8086的中断系统：8086微处理器可处理256种中断。8086对外部硬件中断请求INTR的响应： 当INTR有一高电平，即有可屏蔽中断请求。若此时IF=1且当前指令执行完，进入中断响应周期，处理过程如下：INTA#在两个总线周期中分别发出有效信号，第二周期中8086读到中断类型码保护现场：标志寄存器入栈，清除IF和TF标志位，保护断点（下一条指令地址入栈）。8086总线请求：在一个系统中，若存在多个可控制总线的主模块时，总线使用权的转移存在着一个请求与响应的过程。
上传时间： 2013-10-21
上传用户：皇族传媒
摘要：设计并实现了一个USB/EPP 转接系统，给出其硬件设计方案并讨论了相关技术细节， 使其实现USB 接口到EPP接口的相互数据转发。使仅具有EPP 接口的传统仪器设备借助于USB/EPP 转接系统拥有USB 总线所提供的即插即用和设备插架特性， 方便其通过USB 接口灵活接入同时拥有多个外设的计算机主机系统。关键词：USB；EPP；转接系统中图分类号：TP368.3 文献标识码：A文章编号:1008- 0570(2005)11- 2- 0166- 03 在传统的I/O 模式中，计算机外设通常映射为CPU 中固定I/O 地址，要求由主机分配一个指定的IRQ 中断请求。由于PC 机的端口和中断资源有限，因而使外设的可扩展性受到局限；同时，随着电脑应用的拓展，PC 机的外设接口越来越多，外设对系统资源的独占性也容易导致系统资源冲突。由于各种外部设备不断增加，容易导致各种I/O 冲突。由Intel、Compaq、Microsoft、IBM等厂商所提出的USB 总线标准，基于即插即用和设备插架技术，设备接入时不影响应用程序的运行，具有良好的可扩充性和扩展的方便性。目前USB 协议已经发展到了最新的2.0 版本，可支持峰值传输速率为480Mbps 的高速外设，可提供4～8 个USB 2.0 接口，同时通过USB 集线器（HUB）的扩展还可以支持多达127 个外设同时连接，基本上解决了各种外设同时存在同时使用的所有问题。基于USB 接口的上述优点，目前的计算机，特别是笔记本计算机基本上都只配备USB 接口，而取消了传统的串口和并口，这对那些以前购置的需要与计算机进行通信而只有串口或并口的各种仪器的继续使用造成了极大的障碍。 针对传统的数字化仪器与计算机通信中存在的接口不足的问题，本文设计了一个USB/EPP 转接系统，使其能够从计算机的USB 接口接收数据，经过格式转换，从USB/EPP 转接系统的并行接口EPP 发送给传统的仪器设备；同时也能够从USB/EPP 转接系统的并行接口EPP 接收数据，将其转化为USB 帧格式，并发送到计算机的USB 接口。从而使仅具有EPP 接口的传统仪器设备借助于USB/EPP 转接系统，可以继续正常使用。2 USB 总线2.1 USB 系统描述及总线协议USB 是一种电缆总线，支持在主机和各种即插即用外设之间进行数据传输。由主机预定的标准协议使各种设备分享USB 带宽，当其它设备和主机在运行时，总线允许添加、设置、使用以及拆除外设，这为多个仪器设备共享同一个主计算机提供了可能。USB 协议采用了管道模型的软硬件协议，摒弃了一般外设协议的端口映射方式，从而有效地避免了计算机应用系统I/O 端口地址冲突。根据功能划分，一个USB 系统由三个部分组成：即USB 互连、USB 主机和USB 设备。图1 给出了USB系统的通用拓扑结构。
上传时间： 2013-10-09
上传用户：半熟1994
1. RS-232-C 详解 22. 串口通信基本接线方法 123. 串口通讯的概念及接口电路 134. 有关RS232和RS485接口的问答 145. 同步通信方式 166. 通信协议197. 实战串行通讯258. 全双工和半双工方式 339. 浅析PC 机串口通讯流控制 3410. 奇偶校验 3511. 开发通信软件的技术与技巧 3612. 接口技术的基本知识 4113. 一个单片机串行数据采集/传输模块的设计 4414. 单工、半双工和全双工的定义 4815. 从RS232 端口获得电源4916. 串行同步通信的应用5017. 串行通信波特率的一种自动检测方法5318. RS-232、RS-422 与RS-485 标准及应用5619. 串口泵 6串行通信接口标准经过使用和发展，目前已经有几种。但都是在RS-232标准的基础上经过改进而形成的。所以，以RS-232C为主来讨论。RS-323C 标准是美国EIA(电子工业联合会）与BELL等公司一起开发的1969 年公布的通信协议。它适合于数据传输速率在0～20000b/s 范围内的通信。这个标准对串行通信接口的有关问题，如信号线功能、电器特性都作了明确规定。由于通行设备厂商都生产与RS-232C制式兼容的通信设备，因此，它作为一种标准，目前已在微机通信接口中广泛采用。在讨论RS-232C 接口标准的内容之前，先说明两点：首先，RS-232-C标准最初是远程通信连接数据终端设备DTE(Data Terminal Equipment)与数据通信设备DCE（Data Communication Equipment)而制定的。因此这个标准的制定，并未考虑计算机系统的应用要求。但目前它又广泛地被借来用于计算机（更准确的说，是计算机接口）与终端或外设之间的近端连接标准。显然，这个标准的有些规定及和计算机系统是不一致的，甚至是相矛盾的。有了对这种背景的了解，我们对RS-232C标准与计算机不兼容的地方就不难理解了。其次，RS-232C 标准中所提到的“发送”和“接收”，都是站在DTE 立场上，而不是站在DCE 的立场来定义的。由于在计算机系统中，往往是CPU 和I/O设备之间传送信息，两者都是DTE，因此双方都能发送和接收。
上传时间： 2013-11-21
上传用户：crazyer
