计数器是一种重要的时序逻辑电路，广泛应用于各类数字系统中。介绍以集成计数器74LS161和74LS160为基础，用归零法设计N进制计数器的原理与步骤。用此方法设计了3种36进制计数器，并用Multisim10软件进行仿真。计算机仿真结果表明设计的计数器实现了36进制计数的功能。基于集成计数器的N进制计数器设计方法简单、可行，运用Multisim 10进行电子电路设计和仿真具有省时、低成本、高效率的优越性。
上传时间： 2013-10-11
上传用户：gtzj
论述了过采样Σ一AADC的基本原理及结构，分析了Σ一△调制器的频域传输特性和系统的信噪比，给出了实现不同的A／D转换精度必须满足的条件和用单片机实现Σ一AADC的具体方法和电路．实际使用表明，该方法测量结果可靠，具有实用价值．
上传时间： 2013-11-17
上传用户：gaome
本文介绍了O P207 双极运算放大器的60CoC射线、不同能量电子和质子的辐照试验以及60CoC和电子辐射损伤在室温和100℃高温条件下的退火效应, 揭示了双极运算放大器电参数对不同射线的辐照响应规律; 研究了不同辐射源对双极运算放大器的不同辐射损伤机理; 并对质子辐照损伤程度与能量的依赖关系以及质子辐照损伤同60CoC和电子辐照损伤的差异进了探讨. 结果表明, 界面态的产生是60CoC和电子辐照损伤的主要原因, 而位移效应造成的体损伤在质子辐照效应中占有重要地位.
上传时间： 2013-11-12
上传用户：gououo
在无线通信系统全面进入3G并开始迈向 4G的过程中，使用数字预失真技术（Digital Pre-distortion，以下简称DPD）对发射机的功放进行线性化是一门关键技术。功率放大器是通信系统中影响系统性能和覆盖范围的关键部件，非线性是功放的固有特性。非线性会引起频谱增长(spectral re-growth)，从而造成邻道干扰，使带外杂散达不到协议标准规定的要求。非线性也会造成带内失真，带来系统误码率增大的问题。
上传时间： 2013-10-19
上传用户：yy_cn
电子学名词1、 电阻率---又叫电阻系数或叫比电阻。是衡量物质导电性能好坏的一个物理量，以字母ρ表示，单位为欧姆*毫米平方/米。在数值上等于用那种物质做的长1米截面积为1平方毫米的导线，在温度20C时的电阻值，电阻率越大，导电性能越低。则物质的电阻率随温度而变化的物理量，其数值等于温度每升高1C时，电阻率的增加与原来的电阻电阻率的比值，通常以字母α表示，单位为1/C。2、 电阻的温度系数----表示物质的电阻率随温度而变化的物理量，其数值等于温度每升高1C时，电阻率的增加量与原来的电阻率的比值，通常以字母α表示，单位为1/C。3、 电导----物体传导电流的本领叫做电导。在直流电路里，电导的数值就是电阻值的倒数，以字母ɡ表示，单位为欧姆。4、 电导率----又叫电导系数，也是衡量物质导电性能好坏的一个物理量。大小在数值上是电阻率的倒数，以字母γ表示，单位为米/欧姆*毫米平方。5、 电动势----电路中因其他形式的能量转换为电能所引起的电位差，叫做电动势或者简称电势。用字母E表示，单位为伏特。6、 自感----当闭合回路中的电流发生变化时，则由这电流所产生的穿过回路本身磁通也发生变化，因此在回路中也将感应电动势，这现象称为自感现象，这种感应电动势叫自感电动势。7、 互感----如果有两只线圈互相靠近，则其中第一只线圈中电流所产生的磁通有一部分与第二只线圈相环链。当第一线圈中电流发生变化时，则其与第二只线圈环链的磁通也发生变化，在第二只线圈中产生感应电动势。这种现象叫做互感现象。8、 电感----自感与互感的统称。9、 感抗----交流电流过具有电感的电路时，电感有阻碍交流电流过的作用，这种作用叫做感抗，以Lx表示，Lx=2πfL。10、容抗----交流电流过具有电容的电路时，电容有阻碍交流电流过的作用，这种作用叫做容抗，以Cx表示，Cx=1/12πfc。11、脉动电流----大小随时间变化而方向不变的电流，叫做脉动电流。12、振幅----交变电流在一个周期内出现的最大值叫振幅。13、平均值----交变电流的平均值是指在某段时间内流过电路的总电荷与该段时间的比值。正弦量的平均值通常指正半周内的平均值，它与振幅值的关系：平均值=0.637*振幅值。14、有效值----在两个相同的电阻器件中，分别通过直流电和交流电，如果经过同一时间，它们发出的热量相等，那么就把此直流电的大小作为此交流电的有效值。正弦电流的有效值等于其最大值的0.707倍。15、有功功率----又叫平均功率。交流电的瞬时功率不是一个恒定值，功率在一个周期内的平均值叫做有功功率，它是指在电路中电阻部分所消耗的功率，以字母P表示，单位瓦特。16、视在功率----在具有电阻和电抗的电路内，电压与电流的乘积叫做视在功率，用字母Ps来表示，单位为瓦特。17、无功功率----在具有电感和电容的电路里，这些储能元件在半周期的时间里把电源能量变成磁场（或电场）的能量存起来，在另半周期的时间里对已存的磁场（或电场）能量送还给电源。它们只是与电源进行能量交换，并没有真正消耗能量。我们把与电源交换能量的速率的振幅值叫做无功功率。用字母Q表示，单位为芝。
标签： 电子学
上传时间： 2013-11-23
上传用户：zhoujunzhen
摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。 关键词: 时钟分相技术; 应用 中图分类号: TN 79 文献标识码:A 文章编号: 025820934 (2000) 0620437203 时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的 性能。尤其现代电子系统对性能的越来越高的要求, 迫使我们集中更多的注意力在更高频率、 更高精度的时钟设计上面。但随着系统时钟频率的升高。我们的系统设计将面临一系列的问 题。 1) 时钟的快速电平切换将给电路带来的串扰(Crosstalk) 和其他的噪声。 2) 高速的时钟对电路板的设计提出了更高的要求: 我们应引入传输线(T ransm ission L ine) 模型, 并在信号的匹配上有更多的考虑。 3) 在系统时钟高于100MHz 的情况下, 应使用高速芯片来达到所需的速度, 如ECL 芯 片, 但这种芯片一般功耗很大, 再加上匹配电阻增加的功耗, 使整个系统所需要的电流增大, 发 热量增多, 对系统的稳定性和集成度有不利的影响。 4) 高频时钟相应的电磁辐射(EM I) 比较严重。 所以在高速数字系统设计中对高频时钟信号的处理应格外慎重, 尽量减少电路中高频信 号的成分, 这里介绍一种很好的解决方法, 即利用时钟分相技术, 以低频的时钟实现高频的处 理。 1 时钟分相技术 我们知道, 时钟信号的一个周期按相位来分, 可以分为360°。所谓时钟分相技术, 就是把 时钟周期的多个相位都加以利用, 以达到更高的时间分辨。在通常的设计中, 我们只用到时钟 的上升沿(0 相位) , 如果把时钟的下降沿(180°相位) 也加以利用, 系统的时间分辨能力就可以 提高一倍(如图1a 所示)。同理, 将时钟分为4 个相位(0°、90°、180°和270°) , 系统的时间分辨就 可以提高为原来的4 倍(如图1b 所示)。 以前也有人尝试过用专门的延迟线或逻辑门延时来达到时钟分相的目的。用这种方法产生的相位差不够准确, 而且引起的时间偏移(Skew ) 和抖动 (J itters) 比较大, 无法实现高精度的时间分辨。 近年来半导体技术的发展, 使高质量的分相功能在一 片芯片内实现成为可能, 如AMCC 公司的S4405, CY2 PRESS 公司的CY9901 和CY9911, 都是性能优异的时钟 芯片。这些芯片的出现, 大大促进了时钟分相技术在实际电 路中的应用。我们在这方面作了一些尝试性的工作: 要获得 良好的时间性能, 必须确保分相时钟的Skew 和J itters 都 比较小。因此在我们的设计中, 通常用一个低频、高精度的 晶体作为时钟源, 将这个低频时钟通过一个锁相环(PLL ) , 获得一个较高频率的、比较纯净的时钟, 对这个时钟进行分相, 就可获得高稳定、低抖动的分 相时钟。 这部分电路在实际运用中获得了很好的效果。下面以应用的实例加以说明。2 应用实例 2. 1 应用在接入网中 在通讯系统中, 由于要减少传输 上的硬件开销, 一般以串行模式传输 图3 时钟分为4 个相位 数据, 与其同步的时钟信号并不传输。 但本地接收到数据时, 为了准确地获取 数据, 必须得到数据时钟, 即要获取与数 据同步的时钟信号。在接入网中, 数据传 输的结构如图2 所示。 数据以68MBös 的速率传输, 即每 个bit 占有14. 7ns 的宽度, 在每个数据 帧的开头有一个用于同步检测的头部信息。我们要找到与它同步性好的时钟信号, 一般时间 分辨应该达到1ö4 的时钟周期。即14. 7ö 4≈ 3. 7ns, 这就是说, 系统时钟频率应在300MHz 以 上, 在这种频率下, 我们必须使用ECL inp s 芯片(ECL inp s 是ECL 芯片系列中速度最快的, 其 典型门延迟为340p s) , 如前所述, 这样对整个系统设计带来很多的困扰。 我们在这里使用锁相环和时钟分相技术, 将一个16MHz 晶振作为时钟源, 经过锁相环 89429 升频得到68MHz 的时钟, 再经过分相芯片AMCCS4405 分成4 个相位, 如图3 所示。 我们只要从4 个相位的68MHz 时钟中选择出与数据同步性最好的一个。选择的依据是: 在每个数据帧的头部(HEAD) 都有一个8bit 的KWD (KeyWord) (如图1 所示) , 我们分别用 这4 个相位的时钟去锁存数据, 如果经某个时钟锁存后的数据在这个指定位置最先检测出这 个KWD, 就认为下一相位的时钟与数据的同步性最好(相关)。 根据这个判别原理, 我们设计了图4 所示的时钟分相选择电路。 在板上通过锁相环89429 和分相芯片S4405 获得我们所要的68MHz 4 相时钟: 用这4 个 时钟分别将输入数据进行移位, 将移位的数据与KWD 作比较, 若至少有7bit 符合, 则认为检 出了KWD。将4 路相关器的结果经过优先判选控制逻辑, 即可输出同步性最好的时钟。这里, 我们运用AMCC 公司生产的 S4405 芯片, 对68MHz 的时钟进行了4 分 相, 成功地实现了同步时钟的获取, 这部分 电路目前已实际地应用在某通讯系统的接 入网中。 2. 2 高速数据采集系统中的应用 高速、高精度的模拟- 数字变换 (ADC) 一直是高速数据采集系统的关键部 分。高速的ADC 价格昂贵, 而且系统设计 难度很高。以前就有人考虑使用多个低速 图5 分相技术应用于采集系统 ADC 和时钟分相, 用以替代高速的ADC, 但由 于时钟分相电路产生的相位不准确, 时钟的 J itters 和Skew 比较大(如前述) , 容易产生较 大的孔径晃动(Aperture J itters) , 无法达到很 好的时间分辨。 现在使用时钟分相芯片, 我们可以把分相 技术应用在高速数据采集系统中: 以4 分相后 图6 分相技术提高系统的数据采集率 的80MHz 采样时钟分别作为ADC 的 转换时钟, 对模拟信号进行采样, 如图5 所示。 在每一采集通道中, 输入信号经过 缓冲、调理, 送入ADC 进行模数转换, 采集到的数据写入存储器(M EM )。各个 采集通道采集的是同一信号, 不过采样 点依次相差90°相位。通过存储器中的数 据重组, 可以使系统时钟为80MHz 的采 集系统达到320MHz 数据采集率(如图6 所示)。 3 总结 灵活地运用时钟分相技术, 可以有效地用低频时钟实现相当于高频时钟的时间性能, 并 避免了高速数字电路设计中一些问题, 降低了系统设计的难度。
上传时间： 2013-12-17
上传用户：xg262122
要想获得最低的失调和漂移性能，斩波稳定(自稳零)放大器可能是唯一的解决方案。最好的双极性放大器的失调电压为25 V，漂移为0.1 V/ºC。斩波放大器尽管存在一些不利影响，但可提供低于5 V的失调电压，而且不会出现明显的失调漂移，
上传时间： 2013-12-25
上传用户：z754970244
1,电路板插件，浸锡，切脚的方法 1.制板(往往找专门制板企业制作，图纸由自己提供)并清洁干净。 2.插横插、直插小件，如1/4W的电阻、电容、电感等等贴近电路板的小尺寸元器件。 3.插大、中等尺寸的元器件，如470μ电解电容和火牛。 4.插IC，如贴片IC可在第一步焊好。 原则上来说将元器件由低至高、由小至大地安排插件顺序，其中高低原则优先于水平尺寸原则。 若手工焊接，则插件时插一个焊一个。若过炉的话直接按锡炉操作指南操作即可。 切脚可选择手工剪切也可用专门的切脚机处理，基本工艺要求就是刚好将露出锡包部分切除即可。 若你是想开厂进行规模生产的话，那么还是建议先熟读掌握相关国家和行业标准为好，否则你辛苦做出的产品会无人问津的。而且掌握标准的过程也可以帮助你对制作电路板流程进行制订和排序。 最后强烈建议你先找个电子厂进去偷师一番，毕竟眼见为实嘛。
上传时间： 2013-11-14
上传用户：asdfasdfd
过孔（via）是多层PCB的重要组成部分之一，钻孔的费用通常占PCB制板费用的30%到40%。简单的说来，PCB上的每一个孔都可以称之为过孔。从作用上看，过孔可以分成两类：一是用作各层间的电气连接；二是用作器件的固定或定位。如果从工艺制程上来说，这些过孔一般又分为三类，即盲孔(blind via)、埋孔(buried via)和通孔(through via)。盲孔位于印刷线路板的顶层和底层表面，具有一定深度，用于表层线路和下面的内层线路的连接，孔的深度通常不超过一定的比率(孔径)。埋孔是指位于印刷线路板内层的连接孔，它不会延伸到线路板的表面。上述两类孔都位于线路板的内层，层压前利用通孔成型工艺完成，在过孔形成过程中可能还会重叠做好几个内层。第三种称为通孔，这种孔穿过整个线路板，可用于实现内部互连或作为元件的安装定位孔。由于通孔在工艺上更易于实现，成本较低，所以绝大部分印刷电路板均使用它，而不用另外两种过孔。以下所说的过孔，没有特殊说明的，均作为通孔考虑。
上传时间： 2013-11-08
上传用户：chenhr
PCB 被动组件的隐藏特性解析 传统上，EMC一直被视为「黑色魔术（black magic）」。其实，EMC是可以藉由数学公式来理解的。不过，纵使有数学分析方法可以利用，但那些数学方程式对实际的EMC电路设计而言，仍然太过复杂了。幸运的是，在大多数的实务工作中，工程师并不需要完全理解那些复杂的数学公式和存在于EMC规范中的学理依据，只要藉由简单的数学模型，就能够明白要如何达到EMC的要求。本文藉由简单的数学公式和电磁理论，来说明在印刷电路板（PCB）上被动组件（passivecomponent）的隐藏行为和特性，这些都是工程师想让所设计的电子产品通过EMC标准时，事先所必须具备的基本知识。导线和PCB走线导线（wire）、走线（trace）、固定架……等看似不起眼的组件，却经常成为射频能量的最佳发射器（亦即，EMI的来源）。每一种组件都具有电感，这包含硅芯片的焊线（bond wire）、以及电阻、电容、电感的接脚。每根导线或走线都包含有隐藏的寄生电容和电感。这些寄生性组件会影响导线的阻抗大小，而且对频率很敏感。依据LC 的值（决定自共振频率）和PCB走线的长度，在某组件和PCB走线之间，可以产生自共振（self-resonance），因此，形成一根有效率的辐射天线。在低频时，导线大致上只具有电阻的特性。但在高频时，导线就具有电感的特性。因为变成高频后，会造成阻抗大小的变化，进而改变导线或PCB 走线与接地之间的EMC 设计，这时必需使用接地面（ground plane）和接地网格（ground grid）。导线和PCB 走线的最主要差别只在于，导线是圆形的，走线是长方形的。导线或走线的阻抗包含电阻R和感抗XL = 2πfL，在高频时，此阻抗定义为Z = R + j XL j2πfL，没有容抗Xc = 1/2πfC存在。频率高于100 kHz以上时，感抗大于电阻，此时导线或走线不再是低电阻的连接线，而是电感。一般而言，在音频以上工作的导线或走线应该视为电感，不能再看成电阻，而且可以是射频天线。
上传时间： 2013-10-09
上传用户：时代将军
