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时钟域

  • 基于DSP/FPGA的多波形数字脉冲压缩系统硬件的研究与实现

    现代雷达系统广泛采用脉冲压缩技术,用以解决作用距离与分辨能力之间的矛盾。脉冲压缩是指雷达通过发射宽脉冲,保证足够的最大作用距离,而接收时,采用相应的脉冲压缩法获得窄脉冲以提高距离分辨率的过程。同时,数字信号处理技术的迅猛发展和广泛应用,为雷达脉冲压缩处理的数字化实现提供了可能。 本文主要研究雷达多波形频域数字脉冲压缩系统的硬件系统实现。在匹配滤波理论的指导下,成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形频域数字脉冲压缩系统。该系统可处理时宽在42μs以内、带宽在5MHz以下的线性调频信号(LFM),非线性调频信号(NLFM)和Taylor四相码信号,且技术指标完全满足实用系统的设计要求。 本文完成的主要工作和创新之处有:(1)基于双通道模数转换器AD10242设计高精度数据采集电路,为整个脉压系统的工作提供必要的条件。完成了前端模拟信号输入电路的优化和差分输入时钟的产生,以实现高精度采样。 (2)根据协议和脉压系统的工作要求,以基于FPGAEP1K100QC208完成系统控制,使整个脉压系统正确稳定地工作。同时以该FPGA生成双口RAM,实现数据暂存,以匹配采样速率和脉压系统频率。 (3)设计基于4片高性能ADSP21160M的紧耦合并行处理系统,以完成多波形频域数字脉冲压缩的全部运算工作。4片DSP共享外部总线,且各DSP以链路口互连,进行数据通信。各DSP还使用一个链路口连接到接口板DSP,将脉压结果送出。 (4)以一片ADSP21160M和一片EP1K100QC208为核心,设计输出板电路,完成数据对齐、求模和数据向下一级的输出,并产生模拟输出。 (5)调试并改进处理板和输出板。

    标签: FPGA DSP 多波形 压缩系统

    上传时间: 2013-06-11

    上传用户:qq277541717

  • 带时钟的数字温度计的设计与制作

    本文设计一个智能时钟日历温度计,要求既能掌握时间又能了解天气温度的变化,方便又适用的智能时钟日历温度计是以单片机(AT89C51)为核心,使用温度采集芯片DS18B20来对当时室温进行采集,通过液晶屏TS1602-1来显示,DS12C887时钟芯片来读取时间。时钟芯片需要初始化进行启动,设置初值后不用再反复设置,并且可以准确显示年、月、日、时、分、秒,少于31天的月份自动地调整,包括闰年补偿,还可以设置闹铃并通过蜂鸣器鸣报来提示,电路安装四个按键来控制温度及时间的修改,通过选择键分别对要修改的值进行修改

    标签: 时钟 数字温度计

    上传时间: 2013-04-24

    上传用户:GavinNeko

  • 单片机电子时钟课程设计

    单片机电子时钟课程设计,主要基于DS1302时钟芯片的的设计

    标签: 单片机 电子时钟

    上传时间: 2013-06-01

    上传用户:nanjixehun

  • 电子时钟

    万年历 电子时钟 可调 可置数 电路图

    标签: 电子时钟

    上传时间: 2013-06-27

    上传用户:shinnsiaolin

  • PowerPC 和Dallas 的时钟芯片接口设计1

    分析摩托罗拉的PowerPC 系列处理器和Dallas 的实时时钟芯片的时序,并详细给出一种较为实用的接口设计方法。

    标签: PowerPC Dallas 时钟芯片 接口设计

    上传时间: 2013-07-08

    上传用户:greenmile

  • DS12C887中文资料 (实时时钟芯片)

    DS12C887 实时时钟芯片功能丰富,可以用来直接代替IBM PC 上的时钟日历芯片DS12887,同时,它的管脚也和MC146818B、DS12887 相兼容。由于DS12C887 能够自动产生世

    标签: C887 12C 887 DS

    上传时间: 2013-06-20

    上传用户:hhkpj

  • FPGA内嵌200MHz低噪声锁相环时钟发生器

    FPGA器件在通信、消费类电子等领域应用越来越广泛,随着FPGA规模的增大、功能的加强对时钟的要求也越来越高。在FPGA中嵌入时钟发生器对解决该问题是一个不错的选择。本论文首先,描述并分析了电荷泵锁相环时钟发生器的体系结构、组成单元及各单元的非理想特性;然后讨论并分析了电荷泵锁相环的小信号特性和瞬态特性;并给出了电荷泵锁相环器件参数的计算表达式。其次,研究了环形振荡器和锁相环的相位噪声特性。由于噪声性能是时钟发生器设计中的关键指标,本工作对此进行了较为详细的分析。相位噪声和抖动是衡量时钟信号的两个主要指标。文中从理论上推导了一阶锁相环的噪声特性,并建立了由噪声分析抖动和由抖动分析噪声的解析表达式关系,并讨论了环路低噪声设计的基本原则。在前面讨论和分析的基础上,利用Hynix0.35umCMOS工艺设计了200MHz电荷泵锁相环时钟发生器,并进行了仿真。设计中环形振荡器的延迟单元采用replica偏置结构,把延迟单元输出摆幅限定在确定范围,尾电流源采用cascode结构,增强电路对电源和衬底噪声的抑制作用。通过增加限流管,改善电荷泵中的开关的非理想特性。

    标签: FPGA 200 MHz 内嵌

    上传时间: 2013-04-24

    上传用户:变形金刚

  • 单片机时钟系统

    教你如何做时钟,做一个你想要的万年历,不错的哦,想的请下载

    标签: 单片机 时钟

    上传时间: 2013-05-16

    上传用户:hainan_256

  • 椭圆曲线密码体制中标量乘法运算的优化和FPGA实现

    信息技术的不断发展,对信息的安全提出了更高的要求.在应用公钥密码体制的时候,对密钥长度要求越来越大,处理的速度要求越来越快.而基于椭圆曲线离散对数问题的椭圆曲线密码体制,因其每比特最大的安全性,受到了越来越广泛的注意.椭圆曲线密码体制(ECC:Elliptic Curve Cryptosystem)的快速实现也成为一个关注的方面.该文按照确定有限域、选取曲线参数、划分结构模块、优化模块算法、实现模块设计,验证模块功能的顺序进行书写.为了硬件实现上的方便,设计选择了含有Ⅱ型优化正规基的伽略域GF(2191),并在该域上构造了随机的椭圆曲线.根据层次化、结构化的设计思路,将椭圆曲线上的标量乘法运算划分成两个运算层次:椭圆曲线上的运算和有限域上的运算.模块划分之后,利用自底向上的设计思路,主要针对有限域上的乘法运算进行了重要的改进,并对加法群中的标量乘运算的算法进行了分析、证明,以达到面积优化和快速执行的效果.具体设计中,采用硬件描述语言Verilog HDL,在Mentor Graphics公司出品的FPGA Advantage平台上进行电路设计.完成了各个模块的设计输入和仿真.设计选用了Altera公司的APEX Ⅱ系列器件,利用第一方软件Quartus Ⅱ 2.2进行综合、布局、布线和时序仿真.文中给出了椭圆曲线上的点加、倍点和标量乘法模块的具体设计结构框图.并且根据椭圆曲线的标量乘特点,提出了合适的验证方案.该设计完成了椭圆曲线上的标量乘法运算.设计主要针对资源受限的应用环境:改进了有限域上的乘法运算、使用了没有预处理的标量乘算法.改进后的椭圆曲线标量乘法需要2,741,998个逻辑单元,在100MHz的时钟约束下,运行一次标量乘法运算需要567.69us.该次设计的结果可以直接用来构造椭圆曲线上的签名、验证、密钥交换等算法.

    标签: FPGA 椭圆曲线 密码体制 乘法运算

    上传时间: 2013-05-24

    上传用户:zhuo0008

  • LED旋转时钟制作的相关资料

    超级绚丽的LED旋转时钟,相关的制作资料,,,,,

    标签: LED 旋转时钟

    上传时间: 2013-05-24

    上传用户:luominghua