与许多电子检测与测量工具相同，逻辑分析仪是针对特定问题提供的解决方案。该工具能够帮助人们实施数字硬件故障检测，功能多样；同时，它还是设计数字电路的工程师必不可少的数字设计工具。逻辑分析仪用于涉及大量信号或复杂的触发器要求的数字测量。本文档将使您了解什么是逻辑分析仪，它如何工作。在逻辑分析仪简介部分中，我们首先关注数字示波器以及逻辑分析仪测量结果评估，随后学习简单逻辑分析仪的构造；拥有上述基础知识后，您将了解逻辑分析仪的重要功能以及针对特定应用时，分析仪为什么成为一种主要选择。
标签： 逻辑仪
上传时间： 2015-01-03
上传用户：mickey008
通过数组，指针和图形进行逻辑判断！ 通过键盘操作，图形界面的小程序。
标签： 数组
上传时间： 2014-01-27
上传用户：410805624
一款数独游戏的Java源代码，采用逻辑规则求解，不采用搜索算法求解，算法很经典，值得研究。
上传时间： 2013-12-31
上传用户：gundamwzc
基于Verilog-HDL的硬件电路的实现 9.2 具有LCD显示单元的可编程单脉冲发生器 9.2.1 LCD显示单元的工作原理 9.2.2 显示逻辑设计的思路与流程 9.2.3 LCD显示单元的硬件实现 9.2.4 可编程单脉冲数据的BCD码化 9.2.5 task的使用方法 9.2.6 for循环语句的使用方法 9.2.7 二进制数转换BCD码的硬件实现 9.2.8 可编程单脉冲发生器与显示单元的接口 9.2.9 具有LCD显示单元的可编程单脉冲发生器的硬件实现 9.2.10 编译指令-"文件包含"处理的使用方法
标签： Verilog-HDL LCD 9.2 显示单元
上传时间： 2014-06-23
上传用户：xc216
知识要点：理解熟悉单片机的逻辑运算 运行结果：P1 口输出结果为01100000,注意1 为灭0 为亮,从1.7 到1.0 排列 ANL 0FH就是把数据与00001111相与那么遇1得原来的数遇0则为0,结果是前面的4位变 0, 后面的4 位保留
上传时间： 2015-11-07
上传用户：wxhwjf
把所有端口的同时置高置低,不断闪烁 2 p1 口3 路流水灯理解2 进制数与端口的关系 3 单片机的加法:把52h+0fch 结果送p1 口 4 单片机的乘法:把ff*03h 结果送p1 5 单片机的二进制加法 6 单片机的两位计数器 7 学习单片机的逻辑运算 8 进一步学习单片机的逻辑运算 9 循环移位指令的流水灯 10 理解熟悉散转结构的程序 11 位操作指令的学习 12 比较指令的学习与cy位
上传时间： 2013-12-25
上传用户：kr770906
概论：程序设计的基本概念与基本 1 . 方法；怎样才能学好这门基础课 2. 程序的基本结构 3. 编程关键：逻辑思维与问题求解 人是怎样让计算机帮助自己解题的 4. 数据的组织方式一：数组 5. 模块化：函数与函数调用 6. 分治思想：递归算法及其实现 7. 逻辑指代与物理指代：指针 8. 数据的组织方式二：结构 9. 蒙特卡洛法 10.贪心法 11.动态规划 12. 数据的组织方式三：链表与树 13.数据的组织方式四：文件，数据的 永久存储与重复使用 14.面向对象程序设计的概念及特点
上传时间： 2013-12-19
上传用户：1966640071
坐标映射 Coping、CSize和CRect 颜色和颜色对话框 图形设备接口 画 笔 画 刷 绘 图 示 例 字体和字体对话框 常用文本输出函数 文本格式化属性 计算字符的几何尺寸 文档内容显示及其字体 改变 使用图形编辑器 位 图 图标 光 标 打印与打印预览机制 打印与打印预览的设计 完整的示例
上传时间： 2016-01-27
上传用户：pinksun9
SX-CPLD/FPGA 数字逻辑电路设计实验仪 SX-CPLD/FPGA 数字逻辑电路设计实验仪 产品介绍 1.利用CPLD/FPGA 提供的软硬件开发环境学习最新逻辑IC 设计，以取代TTL/CMOS 复杂的硬件设计。 2.可使用电路绘图法、ABEL 语言、波形图和数字硬件描述语言法(VHDL/AHDL)来开发电路。 3.CPLD/ FPGA 提供引脚可任意设定,故作测试实验时不需要做硬件连接,可节省大量连线焊接时间,快速学习软硬件的运用。 4.CPLD/ FPGA 每一I/O Pin 皆有逻辑状态监视器，以便迅速了解每一引脚状态。 5.清楚标示每一管脚的脚位，易于观察和测量。 6.使用并口在开发系统下直接下载。 7.可在线将CPLD/ FPGA 程序到FLASH ROM，实验仪可独立运行，适合大学生EDA 电子竞赛。 8.可做8051 和CPLD/ FPGA 的组合电路实验。 9.适用于WINDOWS95/98/NT/2000/XP 操作系统。 10.数万门的现场可编程芯片让设计所思即所得。
上传时间： 2016-03-14
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稀疏矩阵运算器 本程序要求用“带行逻辑链接信息”的三元组顺序表表示稀疏矩阵，实现两个矩阵相加、相减和相乘的运算。具体有以下几点： 1.本程序中稀疏矩阵的输入形式采用三元组表示，而运算结果的矩阵则以通常的阵列形式列出。本实验的三元组输入顺序为在行号小的优先的条件下，列号小的输入！要求输入的行数与列数不大于20，且输入三元组的结束标志为“0 0 0”。 2.程序执行过程： （1）运行后，打印出功能选项，可供选择。 （2）选择相应功能后，若选1~3，则要求输入两个矩阵的行数与列数，再以三元组顺序输入矩阵，并且打印出响应的运算结果。接着循环执行（1），（2）。 （3）若选择4，quit。则直接退出程序。
上传时间： 2013-12-22
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