FPGA/CPLD数字电路设计经验分享，有助于设计能力提高
标签： FPGA CPLD 数字 电路设计
上传时间： 2013-08-17
上传用户：flg0001
FPGA/CPLD数字电路设计经验分享。大唐公司的！
标签： FPGA CPLD 数字 大唐
上传用户：wangchong
在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL电路时序模型的基础上，采用合理的设计方法在设计复杂数字系统是行之有效的，通过许多设计实例证明采用这种方式可以使电路的后仿真通过率大大提高，并且系统的工作频率可以达到一个较高水平
标签： 数字电路
上传时间： 2013-08-18
上传用户：nairui21
CPLD数字电路设计——使用MAX+plusⅡ入门篇.rar 不能错过的书籍
标签： CPLD plus MAX
上传时间： 2013-08-22
上传用户：zhtzht
基于VHDL语言 智力抢答器的设计 本人的课程设计
标签： VHDL 语言 抢答器
上传时间： 2013-08-27
上传用户：CHINA526
关键词：FPGA 数字电路 时序 时延路径 建立时间 保持时间
标签： FPGA 数字电路 保持 时序
上传时间： 2013-08-31
上传用户：梧桐
摘要本文介绍了一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法，详细分析了设计原理并给出了相应的仿真结果．这种设计方法已在我们研制的GPS，GLONASS兼容机中得到实际应用。
标签： CPLD GPS 数字
上传时间： 2013-09-01
上传用户：wangdean1101
CPLD数字电路设计硬件描述语言一例+一本经典教材，入门专用
标签： CPLD 数字 电路设计 硬件描述语言
上传时间： 2013-09-04
上传用户：as275944189
数字电路仿真，数字电路课程设计，proteus仿真，详细电路图
标签： 数字电路 仿真
上传时间： 2013-09-25
上传用户：ynsnjs
高速数字电路测试技术
标签： 高速数字电路 测试技术
上传时间： 2013-11-17
上传用户：hakim
