遥控直流立扇FSA-TM888FLZ控制说明
上传时间： 2021-11-11
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本章重点组合逻辑电路在电路结构和逻辑功能上的特点组合逻辑电路的设计方法常用中规模集成组合电路器件的应用竞争－冒险现象及其成因，消除竞争冒险现象的方法本章重点组合逻辑电路在电路结构和逻辑功能上的特点组合逻辑电路的设计方法常用中规模集成组合电路器件的应用竞争－冒险现象及其成因，消除竞争冒险现象的方法
标签： 51单片机
上传时间： 2021-12-04
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产品型号：VK36Q4 产品品牌：VINKA/永嘉微电/永嘉微 封装形式：DFN10 产品年份：新年份 联 系 人：许先生 深圳市永嘉微电科技有限公司，原厂直销，原装现货更有优势！工程服务，技术支持，让您的生产高枕无忧！ 量大价优，保证原装正品。您有量，我有价！QT176 1.概述 VK36Q4具有4个触摸按键，可用来检测外部触摸按键上人手的触摸动作。该芯片具有较 高的集成度，仅需极少的外部组件便可实现触摸按键的检测。 提供了4路直接输出功能。芯片内部采用特殊的集成电路，具有高电源电压抑制比，可 减少按键检测错误的发生，此特性保证在不利环境条件的应用中芯片仍具有很高的可靠性。 此触摸芯片具有自动校准功能，低待机电流，抗电压波动等特性，为各种触摸按键+IO 输出的应用提供了一种简单而又有效的实现方法。 特点 • 工作电压 2.4-5.5V • 待机电流7uA/3.0V,14uA/5V • 上电复位功能（POR） • 低压复位功能（LVR） • 触摸输出响应时间： 工作模式 48mS 待机模式160mS • CMOS输出，低电平有效，支持多键 • 有效键最长输出16S • 无触摸4S自动校准 • 专用脚接对地电容调节灵敏度(1-47nF） • 各触摸通道单独接对地小电容微调灵敏度（0-50pF）. • 上电0.25S内为稳定时间，禁止触摸. • 封装 DFN10L(3.0mm x 3.0mm PP=0,5mm)
标签： 3MM 0.75 36Q DFN VK 36 10 Q4 体积 4通道
上传时间： 2021-12-24
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FPGA的作用与简介.pdf1. 什么是 FPGA ? 一个 FPGA 是一种包含有一个可重配置的门阵列逻辑电路矩阵的设备。通过配置， FPGA 的内部电路以一定方式相连接，从而创建了软件应用的一个硬件实现。与处 理器不同，FPGA 使用专用硬件进行逻辑处理，而不具有操作系统。FPGA 在本质 上是完全并行的，故不同的处理操作不必竞争相同的资源。因此，增加额外的处理 时，应用某一部分的性能不会受影响。而且，多个控制循环可以以不同的速率在单 个 FPGA 设备上运行。基于 FPGA 的控制系统可以加强关键互锁逻辑，也可以通 过设计防止操作人员强夺 I/O。然而，不同于拥有固定硬件资源的硬连接的印制电 路板（PCB）设计，基于 FPGA 的系统可以完全重新连接其内部电路，以支持控制 系统在现场部署后可以重新配置。FPGA 设备提供了专用硬件电路所特有的性能与 可靠性。 单个 FPGA 可以通过在单个集成电路（IC）芯片上集成数百万个逻辑门以代替数 以千计的分立元件。一个 FPGA 芯片的内部资源包括一个被 I/O 组块环围的可配置 逻辑组块（CLB）矩阵。在 FPGA 矩阵内，信号通过可编程的互连开关和连线传递。 CompactRIO 入门教程 2 CompactRIO 入 门 教 程 图 2.FPGA 芯片的内部构造
标签： fpga
上传时间： 2022-02-18
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1. 目的 规范产品的PCB焊盘设计工艺， 规定PCB焊盘设计工艺的相关参数，使得PCB 的设计满足可生产性、可测试性、安规、EMC、EMI 等的技术规范要求,在产品设计过程中构建产品的工艺、技术、质量、成本优势。 2. 适用范围本规范适用于空调类电子产品的PCB 工艺设计，运用于但不限于PCB 的设计、PCB 批产工艺审查、单板工艺审查等活动。本规范之前的相关标准、规范的内容如与本规范的规定相抵触的，以本规范为准3.引用/参考标准或资料TS-S0902010001 <〈信息技术设备PCB 安规设计规范〉>TS—SOE0199001 <〈电子设备的强迫风冷热设计规范〉〉TS—SOE0199002 〈<电子设备的自然冷却热设计规范>>IEC60194 〈<印制板设计、制造与组装术语与定义>> （Printed Circuit Board designmanufacture and assembly-terms and definitions)IPC—A-600F 〈<印制板的验收条件>〉 （Acceptably of printed board)IEC609504。规范内容4。1焊盘的定义 通孔焊盘的外层形状通常为圆形、方形或椭圆形。具体尺寸定义详述如下，名词定义如图所示。1) 孔径尺寸:若实物管脚为圆形：孔径尺寸(直径)=实际管脚直径+0。20∽0。30mm（8。0∽12。0MIL）左右；若实物管脚为方形或矩形：孔径尺寸（直径）=实际管脚对角线的尺寸+0.10∽0。20mm（4.0∽8。0MIL）左右。2) 焊盘尺寸： 常规焊盘尺寸=孔径尺寸（直径)+0.50mm（20.0 MIL)左右.…………
标签： PCB
上传时间： 2022-05-24
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ADS1256 是TI（Texas I nstruments ）公司推出的一款低噪声高分辨率的24 位Si gma - Delta（"- #）模数转换器（ADC）。"- #ADC 与传统的逐次逼近型和积分型ADC 相比有转换误差小而价格低廉的优点，但由于受带宽和有效采样率的限制，"- #ADC 不适用于高频数据采集的场合。该款ADS1256 可适合于采集最高频率只有几千赫兹的模拟数据的系统中，数据输出速率最高可为30K 采样点／秒（SPS），有完善的自校正和系统校正系统， SPI 串行数据传输接口。本文结合笔者自己的应用经验，对该ADC 的基本原理以及应用做简要介绍。ADs1256 的总体电气特性下面介绍在使用ADs1256 的过程中要注意的一些电气方面的具体参数：模拟电源（AVDD ）输入范围+ 4 . 75V !+ 5 .25V，使用的典型值为+ 5 .00V；数字电源（DVDD ）输入范围+ 1 . 8V !+ 3 .6V，使用的典型值+ 3 .3V；参考电压值（VREF= VREFP- VREFN）的范围+ 0 .5V!+ 2 .6V，使用的典型值为+ 2 .5V；耗散功率最大为57mW；每个模拟输入端（AI N0 !7 和AI NC M）相对于模拟地（AGND）的绝对电压值范围在输入缓冲器（BUFFER）关闭的时候为AGND-0 .1 !AVDD+ 0 . 1 ，在输入缓冲器打开的时候为AGND !AVDD-2 .0 ；满刻度差分模拟输入电压值（VI N = AI NP -AI NN）为+ ／-（2VREF／PGA）；数字输入逻辑高电平范围0 .8DVDD!5 .25V（除D0 !D3 的输入点平不可超过DVDD 外），逻辑低点平范围DGND!0 .2DVDD；数字输出逻辑高电平下限为0 .8DVDD，逻辑低电平上限为0 .2DVDD，输出电流典型值为5mA；主时钟频率由外部晶体振荡器提供给XTAL1和XTAL2 时，要求范围为2 M!10 MHz ，仅由CLKI N 输入提供时，范围为0 .1 M!10 MHz 。
上传时间： 2022-06-10
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比较器用于开环系统，旨在从其输出端驱动逻辑电路，以及在高速条件下工作，通常比较稳定。虽然运算放大器过驱时会饱和，使得其工作在类似于比较器模式，但当运算放大器饱和时，器件需要相对较长的时间从饱和中恢复，因此，如果发生饱和，其速度将比始终不饱和时慢得多异同：速度上的区别输出逻辑上的区别输入上的区别应用上的区别。。。
上传时间： 2022-06-30
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1Quartus II软件的安装2Quartus II软件的使用、开发板的使用本章将通过3个完整的例子，一步一步的手把手的方式完成设计，完成这3个设计，并得到正确的结果，将会快速、有效的掌握在Altera Quartusll软件环境下进行FPGA设计与开发的方法、流程，并熟悉开发板的使用。2.1原理图方式设计3-8译码器一、设计目的1、通过设计一个3-8译码器，掌握祝组合逻辑电路设计的方法。2、初步了解Quartusll采用原理图方式进行设计的流程。3、初步掌握FPGA开发的流程以及基本的设计方法、基本的仿真分析方法。二、设计原理三、设计内容四、设计步骤1、建立工程文件1）双击桌面上的Quartus II的图标运行此软件。
上传时间： 2022-07-18
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华为硬件工程师手册目前最全版本（159页) -2019-11-13 16:37 华为大规模逻辑电路设计指导书 -2019-11-13 16:37 华为同步电路设计规范（密码：openfree） -2019-11-13 16:37 华为以太网时钟同步技术_时钟透传技术白皮书 -2019-11-13 16:37 华为专利——一种将异步时钟域转换成同步时钟域的方法 -2019-11-13 16:37 华为coding style -2019-11-13 16:37 华为VHDL设计风格和实现 -2019-11-13 16:37 华为FPGA设计规范.doc 131KB2019-11-13 16:37 华为FPGA设计流程指南 -2019-11-13 16:37 Verilog典型电路设计 华为.pdf 310KB2019-11-13 16:37 Verilog HDL 华为入门教程.pdf 281KB2019-11-13 16:37 Synplify工具使用指南(华为文档)[1].rar___20074616444853030 -2019-11-13 16:37 HuaWei Verilog 约束.pdf 111KB2019-11-13 16:37 FPGA设计高级技巧 Xilinx篇.pdf 2.9M2019-11-13 16:37 静态时序分析与逻辑[1] -2019-11-13 16:37 华为面经
标签： 模
上传时间： 2013-05-24
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超声理论与技术的快速发展，使超声设备不断更新，超声检查已成为预测和评价疾病及其治疗结果不可缺少的重要方法。超声诊断技术不仅具有安全、方便、无损、廉价等优点，其优越性还在于它选用诊断参数的多样性及其在工程上实现的灵活性。 全数字B超诊断仪基于嵌入式ARM9+FPGA硬件平台、LINUX嵌入式操作系统，是一种新型的、操作方便的、技术含量高的机型。它具有现有黑白B超的基本功能，能够对超声回波数据进行灵活的处理，从而使操作更加方便，图象质量进一步提高，并为远程医疗、图像存储、拷贝等打下基础，是一种很有发展前景、未来市场的主打产品。全数字B型超声诊断仪的基本技术特点是用数字硬件电路来实现数据量极其庞大的超声信息的实时处理，它的实现主要倚重于FPGA技术。现在FPGA已经成为多种数字信号处理（DSP）应用的强有力解决方案。硬件和软件设计者可以利用可编程逻辑开发各种DSP应用解决方案。可编程解决方案可以更好地适应快速变化的标准、协议和性能需求。 本论文首先阐述了医疗仪器发展现状和嵌入式计算机体系结构及发展状况，提出了课题研究内容和目标。然后从B超诊断原理及全数字B超诊断仪设计入手深入分析了B型超声诊断仪的系统的硬件体系机构。对系统的总体框架和ARM模块设计做了描述后，接着分析了超声信号进行数字化处理的各个子模块、可编程逻辑器件的结构特点、编程原理、设计流程以及ARM处理模块和FPGA模块的主要通讯接口。接着，本论文介绍了基于ARM9硬件平台的LINUX嵌入式操作系统的移植和设备驱动的开发，详细描述了B型超声诊断仪的软件环境的架构及其设备驱动的详细设计。最后对整个系统的功能和特点进行了总结和展望。
上传时间： 2013-05-28
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