给定两个集合A、B，集合内的任一元素x满足1 ≤ x ≤ 109，并且每个集合的元素个数不大于105。我们希望求出A、B之间的关系。 任 务 ：给定两个集合的描述，判断它们满足下列关系的哪一种： A是B的一个真子集，输出“A is a proper subset of B” B是A的一个真子集，输出“B is a proper subset of A” A和B是同一个集合，输出“A equals B” A和B的交集为空，输出“A and B are disjoint” 上述情况都不是，输出“I m confused!”
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上传时间： 2017-03-15
上传用户：yulg
编译实现循环码的产生，用FOR循环分别对其中的码元进行设置。
上传时间： 2017-06-07
上传用户：lvzhr
完整的仿真源代码，完整的循环冗余码生成与校验过程仿真
上传时间： 2013-12-11
上传用户：WMC_geophy
循环冗余校验码是目前通信系统中被广泛使用的一种编码方法，主要用在同步通信上。循环冗余校验码CRC是一种编码简单、且高效、可靠的差错控制方法，也是被广泛采用的多项式编码，由分组线性码的分支而来，编码简单且误判概率很低，在工业测控和数据通信领域中得到了广泛的应用。
上传时间： 2017-10-23
上传用户：asdfgh513315
基于Proteus仿真前言：本文详细介绍了DS18B20原理，并在后面举例说明了其在单片机中的应用，所举例子包含Proteus仿真电路图，源程序，程序注释详细清楚。1、DS18B20简介：DS18B20温度传感器是DALLAS公司生产的1-wire式单总线器件，具有线路简单，体积小的特点，用它组成的温度测量系统线路非常简单，只要求一个端口即可实现通信。温度测量范围在一55℃~+125℃之间，分辨率可以从9~12位选择，内部还有温度上、下限报警设置。每个DS18B20芯片都有唯一的序列号，所以可以利用多个DS18B20同时连接在同一条总线上，组成多点测温系统。但最多只能连接8个，如果数量过多，会使供电电源电压过低，从而造成信号传输的不稳定。2、DS18B20结构：如右图所示，DS18B20有三只引脚，VCC、DQ和GND。DQ为数字信号输入/输出端（DQ一般接控制器（单片机）的一个1/0口上，由于单总线为开漏所以需要外接一个4.7K的上拉电阻）；GND为电源地；VDD为外接供电电源输入端（在寄生电源接线方式时接地）。DS18B20内部结构主要由四部分组成：64位光刻ROM、温度传感器、非挥发的温度报警触发器TH和TL、配置寄存器。光刻ROM中的64位序列号是出厂前被光刻好的，它可以看作是该DS18B20的地址序列码。64位光刻ROM的排列是：开始8位是产品类型标号，接着的48位是该DS1B20自身的序列号，最后8位是前面56位的CRC校验码（循环冗余校验码）。光刻ROM的作用是使每一个DS18B20都各不相同，这样就可以实现一根总线上挂接多个DS18B20的目的。温度传感器可完成对温度的测量，以12位转化为例，用16位符号扩展的二进制补码读数形式提供。
上传时间： 2022-07-02
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资源包含以下内容：1.三菱PLC A系列 AD 变换模块A1S68AD.pdf2.三菱PLC A系列 CPU模块Q2ASCPU.pdf3.三菱PLC A系列 DA 变换模块A1S62DA .pdf4.三菱PLC A系列 GPPWLLT编程调试程序.pdf5.三菱PLC A系列 Io link 网络系统模块A1SJ51T64.pdf6.三菱PLC A系列 QnACPU 编程参考.pdf7.三菱PLC A系列 Q系列 CC-LINK网络系统.pdf8.三菱PLC A系列 余CPU模块Q4ARCPU.pdf9.三菱PLC A系列 模拟输入输出模块A1S66ADA.pdf10.三菱PLC A系列 热电偶温度数字变化模块A1S68TD .pdf11.三菱PLC A系列 网络系统.pdf12.三菱PLC A系列 网络系统设置.pdf13.三菱PLC A系列 远程网络篇.pdf14.三菱PLC A系列 高速记数模块A1SD62.pdf15.三菱PLC FX-20P-E手持编程器操作手册.pdf16.三菱PLC FX1N使用手册.pdf17.三菱PLC FX1S，FX1N，FX2N，FX2NC系列编程手册.pdf18.三菱PLC FX2N-10GM和20GM硬件、编程手册.pdf19.三菱PLC FX2N-10PG用户手册.pdf20.三菱PLC FX2N-2LC温度控制模块用户手册.pdf21.三菱PLC FX2N-5A特殊功能模块用户手册.pdf22.三菱PLC FX2N使用手册.pdf23.三菱PLC FX3U FX3UC编程手册(基本)应用指令说明书.pdf24.三菱PLC FX3UC使用手册（硬件篇）.pdf25.三菱PLC FX3U·FX3UC用户手册(定位控制篇).pdf26.三菱PLC FX3U·FX3UC用户手册（模拟量控制篇）.pdf27.三菱PLC FX3U硬件手册.pdf28.三菱PLC FX中文文字版002.pdf29.三菱PLC FX系列特殊功能模块手册b.pdf30.三菱PLC FX系列特殊功能模块用户手册.pdf31.三菱PLC FX通讯用户手册.pdf32.三菱PLC QCPU用户手册（功能解说－程序基础篇）.pdf33.三菱PLC QCPU（Q系列）QnACPU编程手册（PID控制指令篇）.pdf34.三菱PLC QCPU－QnACPU 编程手册（SFC 控制指令篇）.pdf35.三菱PLC Q系列 +series+temperature+control+module+user+manual.pdf36.三菱PLC Q系列 CC-LinK Safety系统 主站模块 详细篇.pdf37.三菱PLC Q系列 CC-LINK SAFETY系统远程Io模块 详细篇.pdf38.三菱PLC Q系列 CC-Link数字模拟变换模块.pdf39.三菱PLC Q系列 CC-Link本地站模块.pdf40.三菱PLC Q系列 CC-link系统主站本地站模块用户手册.pdf41.三菱PLC Q系列 CC-link系统小型IO模块用户手册（详细篇）.pdf42.三菱PLC Q系列 CC-Link远程IO模块.pdf43.三菱PLC Q系列 CPU 功能解说 程序基础.pdf44.三菱PLC Q系列 Fl net(OPCN-2)接口模块用户手册.pdf45.三菱PLC Q系列 GX comfinurator-DP Version.pdf46.三菱PLC Q系列 G网络系统 控制网络篇.pdf47.三菱PLC Q系列 H网络系统 plc至plc网络.pdf48.三菱PLC Q系列 IO模块用户手册.pdf49.三菱PLC Q系列 manual list price 2005-07.pdf50.三菱PLC Q系列 MELSEC通讯协议用户手册.pdf51.三菱PLC Q系列 MES接口模块.pdf52.三菱PLC Q系列 PROFIBUS-DP从站模块.pdf53.三菱PLC Q系列 PROFIBUS-DP接口模块（详细篇）.pdf54.三菱PLC Q系列 Q62DA,Q64DA,Q68DAI,Q68DAV用户手册.pdf55.三菱PLC Q系列 Q62HLC用户手册.pdf56.三菱PLC Q系列 Q64RD 热电阻输入模块用户手册.pdf57.三菱PLC Q系列 Q66DA-G用户手册（详细篇）.pdf58.三菱PLC Q系列 QCPU+Users+Manual(Hardware+Design).pdf59.三菱PLC Q系列 QCPU用户手册（多CPU系统）.pdf60.三菱PLC Q系列 QD62,QD62D,QD62E用户参考手册.pdf61.三菱PLC Q系列 QD70定位模块用户手册.pdf62.三菱PLC Q系列 QD72P3C3型内置计数器功能定位模块 详细篇.pdf63.三菱PLC Q系列 QD75P定位模块用户手册(硬件篇).pdf64.三菱PLC Q系列 QD75P定位模块用户手册(详细篇).pdf65.三菱PLC Q系列 QJ61CL12用户手册（详细篇）.pdf66.三菱PLC Q系列 QJ71PB92D用户手册（详细篇）.pdf67.三菱PLC Q系列 QJ71PB93D用户手册.pdf68.三菱PLC Q系列 QJ71WS96用户手册（详细篇）.pdf69.三菱PLC Q系列 QnACPU编程手册 公共指令.pdf70.三菱PLC Q系列 QnACPU编程手册（PID控制指令篇）.pdf71.三菱PLC Q系列 QnAprogram(add).pdf72.三菱PLC Q系列 QnA编程手册.pdf73.三菱PLC Q系列 QnPRHCPU用户手册冗余系统篇.pdf74.三菱PLC Q系列 QnPRHCPU编程手册（过程控制指令).pdf75.三菱PLC Q系列 QS CPU 功能解说 程序基础篇.pdf76.三菱PLC Q系列 QS CPU 硬件设计 维护点检篇.pdf77.三菱PLC Q系列 QSCPU公共指令篇.pdf78.三菱PLC Q系列 Q基本模式CPU硬件设计保养.pdf79.三菱PLC Q系列 Q系列H网主－从站使用手册.pdf80.三菱PLC Q系列 Q系列I-O模块使用手册.pdf81.三菱PLC Q系列 Q系列MELSECNETH网络系统参考手册（远程IO网络）.pdf82.三菱PLC Q系列 Q系列MELSECNETH远程IO模块.pdf83.三菱PLC Q系列 Q高性能CPU功能解说程序基础.pdf84.三菱PLC Q系列 SW0IVNT-CSKP通信包入门手册.pdf85.三菱PLC Q系列 以太网模块基础.pdf86.三菱PLC Q系列 以太网模块用户手册（web功能篇）.pdf87.三菱PLC Q系列 以太网（应用篇）.pdf88.三菱PLC Q系列 冗余系统用户手册.pdf89.三菱PLC Q系列 基本模式CPU功能解说程序基础篇.pdf90.三菱PLC Q系列 多通道高速计数器模块 详细篇.pdf91.三菱PLC Q系列 安全应用程序指南.pdf92.三菱PLC Q系列 定位模块QD75P QD75D详细篇.pdf93.三菱PLC Q系列 数模转换模块.pdf94.三菱PLC Q系列 模数转换模块 用户手册.pdf95.三菱PLC Q系列 模数转换模块.pdf96.三菱PLC Q系列 温度控制模块用户手册.pdf97.三菱PLC Q系列 热电偶输入模块 通道绝缘形型电偶 微电压输入模块.pdf98.三菱PLC Q系列 类串行口通信模块 应用篇.pdf99.三菱PLC Q系列 编程手册(SFC).pdf100.三菱PLC Q系列 通信协议.pdf101.三菱PLC Q系列 高速计数器模块.pdf102.三菱PLC Q系列（硬件设计维护点检篇）.pdf103.三菱PLC Q系类 串行口通信模块 基础篇.pdf104.三菱PLC X2N-16CCL-M和FX2N-32CCL CC-Link主站模块和接口模块用户手册.pdf105.三菱PLC X3U用户手册（硬件手册）.pdf106.伺服电机使用手册Vol.2.pdf107.运动控制器(实模式).pdf108.运动控制器(虚模式).pdf109.运动控制器使用手册SFC编程手册.pdf110.运动控制器用户手册.pdf111.三菱PLC A系列、FX系列、Q系列资料合集
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上传时间： 2013-04-15
上传用户：eeworm
随着信息技术的飞速发展，数据吞吐量急剧增长，要求有更高的传输速度，来满足大量数据的传输，而原有的并行数据传输总线结构上存在自身无法克服的缺陷，在高频环境下容易串扰，而增大误码率。SATA串行总线技术应运而生。作为一种新型的总线接口，它提供了高达3.0Gbps的数据传输速率，使用8B/10B编码格式，采用LVDS NRZ串行数据传输方式，有良好的抗干扰性能，有更强的达到32位的循环冗余校验，并且提供了良好的物理接口特性，支持热拔插，代表着计算机总线接口技术的发展方向。FPGA作为一种低功耗的半导体器件，在高频工作环境中有优良的性能，将处理器与低功耗FPGA结合起来使用是数据存储应用的趋势，这样能够使得接口方案更加灵活。而在众多FPGA器件中，Xilinx公司的Virtex-4平台内部集成了PowerPC高性能处理器，并且其中提供了Rocket IO MGT这种嵌入式的多速率串行收发器，能够以6.25-622Mb/s的速度传送数据，并且支持包括SATA协议在内的多种串行通信协议。 本文从物理层、链路层、传输层分析了SATA1.0技术的接口协议，在此基础提出满足协议需求和适合FPGA设计的设计方案，并给出总体设计框图，依照FPGA的设计方法，采用Xilinx公司的Virtex-4设计了一个符合SATA1.0接口协议的嵌入式存储装置，实现数据的存储，仿真运行结果正常。
上传时间： 2013-04-24
上传用户：sz_hjbf
由于信道中存在干扰,数字信号在信道中传输的过程中会产生误码.为了提高通信质量,保证通信的正确性和可靠性,通常采用差错控制的方法来纠正传输过程中的错误.本文的目的就是研究如何通过差错控制的方法以提高通信质量,保证传输的正确性和可靠性.重点研究一种信道编解码的算法和逻辑电路的实现方法,并在硬件上验证,利用码流传输的测试方法,对设计进行测试.在以上的研究基础之上,横向扩展和课题相关问题的研究,包括FPGA实现和高速硬件电路设计等方面的研究. 纠错码技术是一种通过增加一定的冗余信息来提高信息传输可靠性的有效方法.RS码是一种典型的纠错码,在线性分组码中,它具有最强的纠错能力,既能纠正随机错误,也能纠正突发错误.在深空通信,移动通信以及数字视频广播等系统中具有广泛的应用,随着RS编码和解码算法的改进和相关的硬件实现技术的发展,RS码在实际中的应用也将更加广泛. 在研究中,对所研究的问题进行分解,集中精力研究课题中的重点和难点,在各个模块成功实现的基础上,成功的进行系统组合,协调各个模块稳定的工作. 在本文中的EDA设计中,使用了自顶向下的设计方法,编解码算法每一个子模块分开进行设计,最后在顶层进行元件例化,正确实现了编码和解码的功能. 本文首先介绍相关的数字通信背景；接着提出纠错码的设计方案,介绍RS(31,15)码的编译码算法和逻辑电路的实现方法,RTL代码编写和逻辑仿真以及时序仿真,并讨论了FPGA设计的一般性准则以及高速数字电路设计的一些常用方法和注意事项；最后设计基于FPGA的硬件电路平台,并利用静态和动态的方法对编解码算法进行测试. 通过对编码和解码算法的充分理解,本人使用Verilog HDL语言对算法进行了RTL描述,在Altera公司Cyclone系列FPGA平台上面实现了编码和解码算法. 其中,编码的最高工作频率达到158MHz,解码的最高工作频率达到91MHz.在进行硬件调试的时候,整个系统工作在30MHz的时钟频率下,通过了硬件上的静态测试和动态测试,并能够正确实现预期的纠错功能.
上传时间： 2013-07-01
上传用户：liaofamous
低密度校验码（LDPC，Low Density Parity Check Code）是一种性能接近香农极限的信道编码，已被广泛地采用到各种无线通信领域标准中，包括我国的数字电视地面传输标准、欧洲第二代卫星数字视频广播标准（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至将来4G通信系统中的核心技术之一。 当今LDPC码构造的主流方向有两个，分别是结合准循环（QC，Quasi Cyclic）移位结构的单次扩展构造和类似重复累积（RA，Repeat Accumulate）码构造。相应地，主要的LDPC码编码算法有基于生成矩阵的算法和基于迭代译码的算法。基于生成矩阵的编码算法吞吐量高，但是需要较多的寄存器和ROM资源；基于迭代译码的编码算法实现简单，但是吞吐量不高，且不容易构造高性能的好码。 本文在研究了上述几种码构造和编码算法之后，结合编译码器综合实现的复杂度考虑，提出了一种切实可行的基于二次扩展（Dex，Duplex Expansion）的QC-LDPC码构造方法，以实现高吞吐量的LDPC码收发端；并且充分利用该类码校验矩阵准循环移位结构的特点，结合RU算法，提出了一种新编码器的设计方案。 基于二次扩展的QC-LDPC码构造方法，是通过对母矩阵先后进行乱序扩展（Pex，Permutation Expansion）和循环移位扩展（CSEx，Cyclic Shift Expansion）实现的。在此基础上，为了实现可变码长、可变码率，一般编译码器需同时支持多个乱序扩展和循环移位扩展的扩展因子。本文所述二次扩展构造方法的特点在于，固定循环移位扩展的扩展因子大小不变，支持多个乱序扩展的扩展因子，使得译码器结构得以精简；构造得到的码字具有近似规则码的结构，便于硬件实现；（伪）随机生成的循环移位系数能够提高码字的误码性能，是对硬件实现和误码性能的一种折中。 新编码器在很大程度上考虑了资源的复用，使得实现复杂度近似与码长成正比。考虑到吞吐量的要求，新编码器结构完全抛弃了RU算法中串行的前向替换（FS，Forward Substitution）模块，同时简化了流水线结构，由原先RU算法的6级降低为4级；为了缩短编码延时，设计时安排每一级流水线计算所需的时钟数大致相同。 这种码字构造和编码联合设计方案具有以下优势：相比RU算法，新方案对可变码长、可变码率的支持更灵活，吞吐量也更大；相比基于生成矩阵的编码算法，新方案节省了50％以上的寄存器和ROM资源，单位资源下的吞吐量更大；相比类似重复累积码结构的基于迭代译码的编码算法，新方案使高性能LDPC码的构造更为方便。以上结果都在Xilinx Virtex II pro 70 FPGA上得到验证。 通过在实验板上实测表明，上述基于二次扩展的QC-LDPC码构造和相应的编码方案能够实现高吞吐量LDPC码收发端，在实际应用中具有很高的价值。 目前，LDPC码正向着非规则、自适应、信源信道及调制联合编码方向发展。跨层联合编码的构造方法，及其对应的编码算法，也必将成为信道编码理论未来的研究重点。
上传时间： 2013-07-26
上传用户：qoovoop
纠错码技术是一种通过增加一定冗余信息来提高信息传输可靠性的有效方法。RS码是一种典型的纠错码，在线性分组码中，它具有最强的纠错能力，既能纠正随机错误，也能纠正突发错误，在深空通信、移动通信、磁盘阵列、光存储及数字视频广播(DVB)等系统中具有广泛的应用。 DVD是一种高容量的存储媒质。DVD技术的应用很广泛，在数字技术中占有重要地位。DVD系统中采用里德-所罗门乘积码(RS-PC：Reed-Solomon ProductCode)进行纠错，RS码译码器在伺服芯片中具有重要作用。 FPGA在开发阶段具有安全、方便、可随时修改设计等不可替代的优点，在电子系统中采用FPGA可以极大的提升硬件系统设计的灵活性，可靠性，同时提高硬件开发的速度和降低系统的成本。FPGA的固有优点使其得到越来越广泛的应用，FPGA设计技术也被越来越多的设计人员所掌握。 本文首先介绍了编码理论和常用的RS编译码算法，提出RS编码器实现方案，详细分析了译码器的ME算法和改进BM算法的实现，针对ME算法提出了一种流水线结构的纠删纠错RS译码器实现方案，在译码器复杂度和延时上作了折衷，降低了译码器的复杂度并提高了最高工作频率，利用有限域乘法器的特性对编译码电路进行优化。这些技术的采用大大的提高了RS编译码器的效率，节省了RS编译码器占用的资源。在Xilinx公司的Virtex-II系列FPGA上设计并成功实现了RS(208，192)编译码器。
上传时间： 2013-07-20
上传用户：xinshou123456
