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上传时间： 2016-03-14
上传用户：WMC_geophy
这是一功能相对很完美的汽车维修管理系统的一个例子
上传时间： 2016-03-17
上传用户：zukfu
ccs编译环境,C语言编程,模拟I2C总线时序
上传时间： 2016-03-17
上传用户：liglechongchong
<系统时序基础理论.doc>,9页 虽然简短,但从其文其图及其公式可以看出,是CPLD/FPGA设计的必修课.
上传时间： 2014-01-12
上传用户：许小华
提高卫星通信系统容量的一种新技术的完美论文。
上传时间： 2016-03-18
上传用户：爺的气质
此程序用于视频采集过程中CPLD对时序的转换与组合代码，每两行采集一行，两列采集一列，减小数据量，同时能保证采集完整的一幅图像（输出OUT用于DSP或者单片机中断）
上传时间： 2013-12-25
上传用户：lingzhichao
采用等精度测频原理的频率计的程序与仿真,用verilog语言实现,可以仿真综合得到所想时序!
上传时间： 2016-03-20
上传用户：Altman
verilog语言实现方波模块设计,可以仿真综合,可以得到理想的时序波形!
上传时间： 2013-12-27
上传用户：xfbs821
VB6无疑是当前最先进的编程工具之一,无论是它的代码编写还是与视窗98的完美结合, 都令人们特别是程序员们赞叹不已。在这里,我将自己在编程实践中对LISTVIEW控件的一些使用经验和心得体会与广大的同仁们作以探讨,希望大家批评指正,或者有所借鉴
上传时间： 2016-03-22
上传用户：guanliya
werilog语言中关于 组合逻辑时序逻辑的表达
上传时间： 2013-12-21
上传用户：dapangxie
